ADS5292
- 最高采样速率: 80 MSPS/12位
- 高信噪比
- 在 5 MHz/80 MSPS 时 SNR 为 70-dBFS
- 在 5 MHz/80 MSPS 并且抽取滤波器=2 时 SNR 为 71.5-dBFS
- 在 5 MHz/80 MSPS 时 SFD R为 85-dBc
- 低功耗
- 50 MSPS 时为 48 mW/CH
- 65 MSPS 时为 54 mW/CH
- 80 MSPS 时为 66 mW/CH (每通道 2 个LVDS 线束)
- 数字处理块
- 可编程 FIR 抽取滤波器和过度取样以将谐波干扰降到最低
- 可编程IIR高通滤波器以将 DC 偏移降至最低
- 可编程数字增益: 0 dB 至 12 dB
- 2-或者 4-通道均衡
- 灵活串行化 LVDS 输出:
- 根据 ADC 采样率,每通道有一个或者两个 LVDS 线束输出线路
- ADC 输入通道和 LVDS 输出引脚间的可编程映射--简化主板设计
- 由 FPGA/接收器提供的用于确认数据捕捉的多种测试样式
- 内部和外部参考值
- 用于低功耗的 1.8 V 操作
- 低频噪音抑制
- 在 1 个时钟周期内从 6-dB 过载中恢复
- 封装方式: 12-mm × 12-mm 80-引脚 QFP
使用 CMOS 处理技术和创新的电路技术,ADS5292 是一款低功率 80 MSPS 8 通道 ADC。 低功耗,高 SNR,低 SFDR,和持续过载恢复使用户能够设计高性能系统。
ADS5292 是一款数字处理块设备,此设备集成了几个可改进系统性能的常用数字功能。 它包括一个数字滤波器模块,此模块具有内置抽取滤波去(具有低通、高通和带通特性)。 抽取率同样由程序控制 (乘 2,乘 4,或者乘 8)。 这使得此设备非常适合窄带应用,在窄带应用中,滤波器可很方便的被用于提升 SNR 和终止谐波,同时减少输出数据率。 此设备包括一个均衡模式,在此模式下,2 通道(或者甚至 4 通道)可以被平均达到负担均衡以提升 SNR。
串行 LVDS 输出减少了接口线路数量并实现最高系统集成。 根据 ADC 采样率的不同,来自每个通道 ADC 的数字数据可通过 LVDS 输出线路的一个或者两个线束输出。 此两线束接口帮助保持较低的串行数据率,这样即使在高采样率的情况下,也可以使用基于低成本 FPGA 的接收器。 一个非常独特的功能是允许可编程映射模块允许输入通道和 LVDS 输出引脚间的灵活映射。 这有助于大大减少 LVDS 输出路由的复杂性并可能通过减少 PCB 的层数来降低系统主板的成本。
此设备集成了一个内部基准,此基准被调整为与全部设备匹配。 通过内部基准模式可以获得最佳性能。 此设备也可由外部基准驱动。
此器件采用 12 mm × 12 mm 80-引脚 QFP 封装。 它的额定工作温度范围为 –40℃ 至 85℃。 ADS5292 与 ADS5294 引脚和寄存器完全兼容。
技术文档
类型 | 项目标题 | 下载最新的英语版本 | 日期 | |||
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* | 数据表 | 8 通道 12-位,80 MSPS 和低功率 ADC 数据表 (Rev. B) | 下载英文版本 (Rev.B) | PDF | HTML | 2012年 7月 25日 | |
应用手册 | Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) | 2015年 5月 22日 | ||||
EVM 用户指南 | ADS5292 EVM (Rev. A) | 2015年 3月 5日 | ||||
应用手册 | Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) | 2013年 7月 19日 | ||||
应用手册 | Understanding Serial LVDS Capture in High-Speed ADCs | 2013年 7月 10日 | ||||
应用手册 | 所选封装材料的热学和电学性质 | 2008年 10月 16日 | ||||
应用手册 | 模数规格和性能特性术语表 (Rev. A) | 下载最新的英文版本 (Rev.B) | 2008年 10月 16日 | |||
应用手册 | 高速数据转换 | 下载英文版本 | 2008年 10月 16日 |
设计和开发
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