14 位 125MSPS ADC 单通道 低功耗和高交流性能

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产品详细信息

参数

Sample rate (Max) (MSPS) 125 Resolution (Bits) 14 Number of input channels 1 Interface Parallel CMOS Analog input BW (MHz) 750 Features High Performance Rating Catalog Input range (Vp-p) 2.3 Power consumption (Typ) (mW) 780 Architecture Pipeline SNR (dB) 73.2 ENOB (Bits) 11.3 SFDR (dB) 84 Operating temperature range (C) -40 to 85 Input buffer No open-in-new 查找其它 高速 ADCs (>10MSPS)

封装|引脚|尺寸

HTQFP (PAP) 64 144 mm² 12 x 12 open-in-new 查找其它 高速 ADCs (>10MSPS)

特性

  • 14-Bit Resolution
  • 125 Msps Sample Rate
  • High SNR: 71.2 dBFS at 100-MHz fIN
  • High SFDR: 82 dBc at 100-MHz fIN
  • 2.3-VPP Differential Input Voltage
  • Internal Voltage Reference
  • 3.3-V Single-Supply Voltage
  • Analog Power Dissipation: 578 mW
  • Serial Programming Interface
  • TQFP-64 PowerPAD™ Package
  • Recommended Amplifiers: OPA695, OPA847, THS3201, THS3202, THS4503, THS4509, THS9001
  • APPLICATIONS
    • Wireless Communication
      • Communication Receivers
      • Base Station Infrastructure
    • Test and Measurement Instrumentation
    • Single and Multichannel Digital Receivers
    • Communication Instrumentation
      • Radar, Infrared
    • Video and Imaging
    • Medical Equipment

PowerPAD is a trademark of Texas Instruments.

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描述

The ADS5500 is a high-performance, 14-bit, 125 Msps analog-to-digital converter (ADC). To provide a complete converter solution, it includes a high-bandwidth linear sample-and-hold stage (S&H) and internal reference. Designed for applications demanding the highest speed and highest dynamic performance in little space, the ADS5500 has excellent power consumption of 578 mW at 3.3-V single-supply voltage. This allows an even higher system integration density. The provided internal reference simplifies system design requirements. Parallel CMOS-compatible output ensures seamless interfacing with common logic.

The ADS5500 is available in a 64-pin TQFP PowerPAD™ package and in both a commercial and industrial temperature grade device.

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技术文档

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类型 标题 下载最新的英文版本 发布
* 数据表 14-Bit, 125MSPS Analog-to-Digital Converter 数据表 2007年 2月 8日
应用手册 Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat 2015年 5月 22日
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应用手册 Clocking High-Speed Data Converters 2005年 1月 18日
应用手册 Implementing a CDC7005 Low Jitter Clock Solution for HIgh Speed High IF ADC Dev 2004年 6月 25日
更多文献资料 ADS5500 + CDC7005 Product Bulletin 2004年 6月 23日
应用手册 ADS5500, OPA695: PC Board Layout for Low Distortion High-Speed ADC Drivers 2004年 4月 22日
更多文献资料 Analogue-to-Digital Converters Support Multicarrier Systems 2004年 3月 2日

设计与开发

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软件开发

编程工具 下载
高速 ADC SPI 编程工具
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设计工具和仿真

仿真模型 下载
SBAC028C.ZIP (343 KB) - IBIS Model
计算工具 下载
用于 ADC 的抖动和 SNR 计算器
JITTER-SNR-CALC JITTER-SNR-CALC 可用于根据输入频率和时钟抖动来计算 ADC 的理论信噪比 (SNR) 性能。
物料清单 (BOM) 下载
SLWR028.ZIP (166 KB)

CAD/CAE 符号

封装 引脚 下载
HTQFP (PAP) 64 视图选项

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