产品详细信息

Number of input channels 4 Resolution (Bits) 14 Sample rate (Max) (MSPS) 500 Features Decimating Filter, Differential Inputs, High Dynamic Range, Nap Mode, Out of Range Indicator, Power Down Analog input BW (MHz) 900 SFDR (Typ) (dB) 89 SNR (Typ) (dB) 70.8 Power consumption (Typ) (mW) 2700 Logic voltage DV/DD (Max) (V) 2 Logic voltage DV/DD (Min) (V) 1.8 Analog voltage AVDD (Max) (V) 2 Analog voltage AVDD (Min) (V) 1.8 Operating temperature range (C) -40 to 85
Number of input channels 4 Resolution (Bits) 14 Sample rate (Max) (MSPS) 500 Features Decimating Filter, Differential Inputs, High Dynamic Range, Nap Mode, Out of Range Indicator, Power Down Analog input BW (MHz) 900 SFDR (Typ) (dB) 89 SNR (Typ) (dB) 70.8 Power consumption (Typ) (mW) 2700 Logic voltage DV/DD (Max) (V) 2 Logic voltage DV/DD (Min) (V) 1.8 Analog voltage AVDD (Max) (V) 2 Analog voltage AVDD (Min) (V) 1.8 Operating temperature range (C) -40 to 85
VQFNP (RMP) 72 100 mm² 10 x 10
  • 四通道
  • 14 位分辨率
  • 最大时钟速率:500MSPS
  • 输入带宽 (3dB):900MHz
  • 片上抖动
  • 具有高阻抗输入的模拟输入缓冲器
  • 输出选项:
    • Rx:2 倍抽取率和 4 倍抽取率(低通滤波器)
    • 200MHz 复带宽或 100MHz 实带宽支持
    • DPD FB:突发模式,14 位输出
  • 1.9 VPP 差分满量程输入
  • JESD204B 接口:
    • 支持子类 1
    • 每个 ADC 一条信道,速率高达 10Gsps
    • 专用于通道对的 SYNC 引脚
  • 支持多芯片同步
  • 72 引脚超薄型四方扁平无引线 (VQFN) 封装 (10mm × 10mm)
  • 主要技术规格:
    • 功耗:每通道 675mW
    • 频谱性能(未抽取)
      • fIN = 190MHz 中频 (IF)(–1dBFS 时):
        • 信噪比 (SNR):70.4dBFS
        • 噪声频谱密度 (NSD):–154.4dBFS/Hz
        • 无杂散动态范围 (SFDR):86dBc(HD2,HD3),
          95dBFS(非 HD2,HD3)
      • fIN = 370 MHz IF(–3dBFS 时):
        • SNR:68.5dBFS
        • NSD:–152.5dBFS/Hz
        • SFDR:81dBc(HD2,HD3),
          86dBFS(非 HD2,HD3)

应用

  • 多载波 GSM 蜂窝基础设施基站
  • 多载波多模式蜂窝基础设施基站
  • 电信接收器
  • 电信数字预失真 (DPD) 观测接收器

All trademarks are the property of their respective owners.

  • 四通道
  • 14 位分辨率
  • 最大时钟速率:500MSPS
  • 输入带宽 (3dB):900MHz
  • 片上抖动
  • 具有高阻抗输入的模拟输入缓冲器
  • 输出选项:
    • Rx:2 倍抽取率和 4 倍抽取率(低通滤波器)
    • 200MHz 复带宽或 100MHz 实带宽支持
    • DPD FB:突发模式,14 位输出
  • 1.9 VPP 差分满量程输入
  • JESD204B 接口:
    • 支持子类 1
    • 每个 ADC 一条信道,速率高达 10Gsps
    • 专用于通道对的 SYNC 引脚
  • 支持多芯片同步
  • 72 引脚超薄型四方扁平无引线 (VQFN) 封装 (10mm × 10mm)
  • 主要技术规格:
    • 功耗:每通道 675mW
    • 频谱性能(未抽取)
      • fIN = 190MHz 中频 (IF)(–1dBFS 时):
        • 信噪比 (SNR):70.4dBFS
        • 噪声频谱密度 (NSD):–154.4dBFS/Hz
        • 无杂散动态范围 (SFDR):86dBc(HD2,HD3),
          95dBFS(非 HD2,HD3)
      • fIN = 370 MHz IF(–3dBFS 时):
        • SNR:68.5dBFS
        • NSD:–152.5dBFS/Hz
        • SFDR:81dBc(HD2,HD3),
          86dBFS(非 HD2,HD3)

应用

  • 多载波 GSM 蜂窝基础设施基站
  • 多载波多模式蜂窝基础设施基站
  • 电信接收器
  • 电信数字预失真 (DPD) 观测接收器

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ADS58J63 是一款低功耗、高带宽、14 位、500MSPS、四通道电信接收器。 ADS58J63 支持 JESD204B 串行接口,每个通道上具有 1 条信道,数据传输速率高达 10Gbps。 经缓冲的模拟输入可在较宽频率范围内提供统一输入阻抗,并最大程度地降低采样和保持毛刺脉冲能量。 ADS58J63 以超低功耗在宽输入频率范围内提供出色的无杂散动态范围 (SFDR)。 数字信号处理模块包含复混频器,后接低通滤波器。低通滤波器具有 2 倍抽取率和 4 倍抽取率两个选项,支持高达 200MHz 的接收器带宽。 此外,ADS58J63 在突发模式下还支持 14 位、500MSPS 输出,因此适用于 DPD 观测接收器。

JESD204B 接口减少了接口线路数,从而实现高系统集成度。 内部锁相环 (PLL) 会将传入的模数转换器 (ADC) 采样时钟加倍,以获得串行化各通道的 14 位数据时所使用的位时钟。

ADS58J63 是一款低功耗、高带宽、14 位、500MSPS、四通道电信接收器。 ADS58J63 支持 JESD204B 串行接口,每个通道上具有 1 条信道,数据传输速率高达 10Gbps。 经缓冲的模拟输入可在较宽频率范围内提供统一输入阻抗,并最大程度地降低采样和保持毛刺脉冲能量。 ADS58J63 以超低功耗在宽输入频率范围内提供出色的无杂散动态范围 (SFDR)。 数字信号处理模块包含复混频器,后接低通滤波器。低通滤波器具有 2 倍抽取率和 4 倍抽取率两个选项,支持高达 200MHz 的接收器带宽。 此外,ADS58J63 在突发模式下还支持 14 位、500MSPS 输出,因此适用于 DPD 观测接收器。

JESD204B 接口减少了接口线路数,从而实现高系统集成度。 内部锁相环 (PLL) 会将传入的模数转换器 (ADC) 采样时钟加倍,以获得串行化各通道的 14 位数据时所使用的位时钟。

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 ADS58J63 四通道、14 位、500MSPS 电信接收器 数据表 (Rev. A) 下载英文版本 (Rev.A) 2015年 8月 18日
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用户指南 ADS54J/58J6x Evaluation Module User's Guide (Rev. D) 2016年 1月 13日
设计指南 ADS58J63_A_DESIGN_PACKAGE 2015年 6月 17日
应用手册 所选封装材料的热学和电学性质 2008年 10月 16日
应用手册 模数规格和性能特性术语表 (Rev. A) 下载最新的英文版本 (Rev.B) 2008年 10月 16日
应用手册 高速数据转换 下载英文版本 2008年 10月 16日

设计与开发

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评估板

ADS58J63EVM — ADS63J58 评估模块

ADS58J63EVM 是一种评估模块 (EVM),可用于对德州仪器 (TI) 的 ADS58J63 和 LMK04828 时钟抖动消除器进行评估。ADS58J63 是一款宽带宽、双 14 位、500 MSPS 的低功耗四通道模数转换器 (ADC),拥有具备 JESD204B 接口的缓冲模拟输入和输出。该 EVM 具备变压器耦合模拟输入,可适应广泛的信号源和频率。LMK04828 提供一个超低抖动和相位噪声的 ADC 采样时钟,以及系统参考时钟和器件采样时钟,从而实现一套完整的 JESD204B 子类 1 计时解决方案。

ADS58J63 和 LMK04828 通过一个易于使用的软件 GUI 进行控制,可针对各种使用情况进行快速配置。

ADS58J63EVM 可通过高速 FMC 连接器直接连接到 TSW14J56EVM 数据采集硬件。使用 TSW14J56EVM 时,也可使用高速数据转换器专业软件进行数据采集和分析支持。

现货
数量限制: 3
固件

TI-JESD204-IP — JESD204 Rapid Design IP for FPGAs connected to TI high-speed data converters

JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计,可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时,可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路,对其进行定制,以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后,TI 将会通过安全的下载链接提供该 IP。

JESD204 快速设计 IP 支持以下 FPGA 系列:

  • Xilinx® Virtex™ UltraScale™ 和 UltraScale+™
  • Xilinx Kintex™ UltraScale 和 UltraScale+
  • Xilinx Zynq™ UltraScale+ 和 Zynq UltraScale+ (Auto)
  • Xilinx Artix™ 7 和 Artix 7 (Auto)
  • Xilinx Virtex 7
  • Xilinx (...)
支持软件

DATACONVERTERPRO-SW — High Speed Data Converter Pro 软件

此高速数据转换器专业 GUI 是一款 PC 程序(兼容 Windows® XP/7/10),旨在帮助评估大多数 TI 高速数据转换器和模拟前端 (AFE) 平台。DATACONVERTERPRO-SW 支持整个 TSW14xxx 系列的数据采集和模式生成卡,为分析时域和频域中的数据转换器提供了快速强大的解决方案以及单音调、多音调和调制信号支持。此 GUI 还兼容用于快速合成单音调、多音调和调制信号的 TI 模式生成 GUI。

用户可以为 DATACONVERTERPRO-SW 提供定制模式,以加载到 TI 数模转换器 (DAC)。支持从模数转换器 (ADC) 采集内导出 CSV 文件,以进行外部分析。

DATACONVERTERPRO-SW 兼容相关器件部分中列出的所有 ADC、DAC 和 AFE。如果不清楚 TSW14xx 是否支持相关的器件,请在数据转换器的 e2e 论坛上咨询。

仿真模型

ADS58J63 IBIS Model

SBAM251.ZIP (46 KB) - IBIS Model
仿真模型

ADS54J20/40/60 IBIS-AMI Model

SBAM325.ZIP (5519 KB) - IBIS-AMI Model
光绘文件

ADS54Jxx Design File (Rev. A)

SBAC155A.ZIP (3977 KB)
封装 引脚 下载
VQFN (RMP) 72 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

支持与培训

视频