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产品详细信息

参数

Sample rate (Max) (MSPS) 160 Resolution (Bits) 14 Number of input channels 1 Interface type JESD204A Analog input BW (MHz) 480 Features High Performance Rating Catalog Input range (Vp-p) 2 Power consumption (Typ) (mW) 583 Architecture Pipeline SNR (dB) 75 ENOB (Bits) 11.7 SFDR (dB) 77 Operating temperature range (C) -40 to 85 Input buffer Yes open-in-new 查找其它 高速 ADCs (>10MSPS)

封装|引脚|尺寸

VQFN (RHA) 40 36 mm² 6 x 6 open-in-new 查找其它 高速 ADCs (>10MSPS)

特性

  • 输出接口:
    • 单信道和双信道接口
    • 最大数据速率:3.125Gbps
    • 符合 JEDEC JESD204A 技术规范
    • 可在 2mA 至 32mA 之间对电流进行设定的电流模式逻辑 (CML) 输出
  • 功率耗散:
    • 双信道模式下,160MSPS 时为 583mW
    • 功率等级随着时钟速率下降
  • 输入接口:经缓冲的模拟输入
  • 185MHz IF 时的信噪比 (SNR):-72.7dBFS
  • 模拟输入动态范围:2VPP
  • 基准支持:
    外部和内部(已调整)
  • 电源:
    • 模拟和数字电源:1.8V
    • 输入缓冲器:3.3V
  • 可编程数字增益:0dB 至 6dB
  • 输出:标准偏移二进制码或
    二进制补码
  • 封装:6mm x 6mm 四方扁平无引线 (QFN)-40 封装

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应用范围

  • 无线基站基础设施
  • 测试和测量仪器
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描述

ADS61JB46 是一款高性能、低功耗、单通道模数转换器,此转换器具有一个集成的 JESD204A 输出接口。 采用 6mm x 6mm QFN 封装,并具有单信道和双信道输出模式,此器件提供了空前的紧凑性。 此输出接口与 JESD204A 标准兼容,并具有一个额外的模式(符合 IEEE 标准 802.3-2002 第 3 部分,第 36.2.4.12 条),以实现与 TI TLK 串化解串 (SERDES) 收发器系列产品的无缝对接。 同样引人注目的是其包含一个片载模拟输入缓冲器,从而提供了采样/保持开关间的隔离以及更高、更加持续的输入阻抗。

此器件可在工业温度范围(-40°C 至 +85°C)内工作。

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技术文档

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类型 标题 下载最新的英文版本 日期
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应用手册 高速数据转换 下载英文版本 2008年 10月 16日

设计与开发

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软件开发

固件 下载
JESD204 Rapid Design IP for FPGAs connected to TI high-speed data converters
TI-JESD204-IP JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计,可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时,可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路,对其进行定制,以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后,TI 将会通过安全的下载链接提供该 IP。

JESD204 快速设计 IP 支持以下 FPGA 系列:

  • Xilinx® Virtex™ UltraScale™ 和 UltraScale+™
  • Xilinx Kintex™ UltraScale 和 UltraScale+
  • Xilinx Zynq™ UltraScale+ 和 Zynq UltraScale+ (Auto)
  • Xilinx Artix™ 7 和 Artix 7 (Auto)
  • Xilinx Virtex 7
  • Xilinx (...)
特性
  • 与 JEDEC JESD204a/b/c 协议兼容
  • 支持子类 1 确定性延迟和多器件同步
  • 支持的通道速率
    • 在 8b/10b 模式下高达 16.375Gbps
    • 在 64b/66b 模式下高达 20Gbps
  • 支持协议相关的所有错误检测和报告功能
  • 集成的传输层可将通道数据转换为样本(HD 模式不支持该功能)
  • 优化了 FPGA 中的逻辑和内存占用量,所释放的资源将可用于应用逻辑(并在可能的情况下获得尺寸更小/成本更低的 FPGA)
  • 新颖的设计特性,包括在与线路速率异步的时钟速率下导出数据
评估模块 (EVM) 的 GUI 下载
SLAC530.ZIP (82937 KB)

设计工具和仿真

仿真模型 下载
SLOM341.ZIP (110 KB) - IBIS Model
仿真工具 下载
PSPICE® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库,您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案,然后再进行布局和制造,可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中,您可以搜索 TI 器件、了解产品系列、打开测试台并对您的设计进行仿真,从而进一步分析选定的器件。您还可对多个 TI 器件进行联合仿真,以更好地展现您的系统。

除了一个完整的预加载模型库之外,您还可以在 PSPICE-FOR-TI 工具中轻松访问 TI 器件的全新技术资料。在您确认找到适合您应用的器件后,可访问 TI store 购买产品。 

借助 PSpice for TI,您可使用合适的工具来满足您在整个设计周期(从电路探索到设计开发和验证)的仿真需求。免费获取、轻松入门。立即下载 PSpice 设计和仿真套件,开始您的设计。

入门

  1. 申请使用 PSPICE-FOR-TI 仿真器
  2. 下载并安装
  3. 观看有关仿真入门的培训
特性
  • 利用 Cadence PSpice 技术
  • 带有一套数字模型的预装库可在最坏情形下进行时序分析
  • 动态更新确保您可以使用全新的器件型号
  • 针对仿真速度进行了优化,且不会降低精度
  • 支持对多个产品进行同步分析
  • 基于 OrCAD Capture 框架,提供对业界广泛使用的原理图捕获和仿真环境的访问权限
  • 可离线使用
  • 在各种工作条件和器件容许范围内验证设计,包括
    • 自动测量和后处理
    • Monte Carlo 分析
    • 最坏情形分析
    • 热分析

CAD/CAE 符号

封装 引脚 下载
VQFN (RHA) 40 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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支持与培训

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