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LMK00308

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具有 8 个可配置输出的 3.1GHz 差动时钟缓冲器/电平转换器

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产品详情

Number of outputs 9 Additive RMS jitter (typ) (fs) 51 Core supply voltage (V) 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type HCSL, LVCMOS, LVDS, LVPECL Input type CML, HCSL, HSTL, LVCMOS, LVDS, LVPECL, LVTTL, SSTL, XTAL
Number of outputs 9 Additive RMS jitter (typ) (fs) 51 Core supply voltage (V) 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type HCSL, LVCMOS, LVDS, LVPECL Input type CML, HCSL, HSTL, LVCMOS, LVDS, LVPECL, LVTTL, SSTL, XTAL
WQFN (RTA) 40 36 mm² 6 x 6
  • 3：1 输入多路复用器
    • 两个通用输入运行频率高达 3.1GHz，并且接受低电压正射极耦合逻辑 (LVPECL)，低压差分信令 (LVDS)，电流模式逻辑 (CML)，短截线串联端接逻辑 (SSTL), 高速收发器逻辑 (HSTL)，主机时钟信号电平 (HCSL) 或单端时钟
    • 一个晶振输入可接受 10 至 40MHz 的晶振或单端使能时钟
  • 每组具有 4 个差分输出的 2 个组
    • LVPECL，LVDS，HCSL 或高阻抗 (Hi-Z)（每个组可选）
    • LMK03806 时钟源为 156.25MHz 时，LVPECL 附加抖动：
      • 20fs RMS (10kHz - 1MHz)
      • 51fs RMS (12kHz - 20MHz)
  • 高电源抑制比 (PSRR)：156.25MHz 时为 -65/-76dBc (LVPECL/LVDS)
  • 具有同步使能驶入的 LVCMOS 输出
  • 由引脚控制的配置
  • VCC内核电源：3.3V ± 5%
  • 3 个独立的 VCCO输出电源：3.3V/2.5V ± 5%
  • 工业温度范围：-40°C 至 +85°C
  • 40 接线超薄型四方扁平无引线 (WQFN) 封装 (6mm x 6mm)

All trademarks are the property of their respective owners.

  • 3：1 输入多路复用器
    • 两个通用输入运行频率高达 3.1GHz，并且接受低电压正射极耦合逻辑 (LVPECL)，低压差分信令 (LVDS)，电流模式逻辑 (CML)，短截线串联端接逻辑 (SSTL), 高速收发器逻辑 (HSTL)，主机时钟信号电平 (HCSL) 或单端时钟
    • 一个晶振输入可接受 10 至 40MHz 的晶振或单端使能时钟
  • 每组具有 4 个差分输出的 2 个组
    • LVPECL，LVDS，HCSL 或高阻抗 (Hi-Z)（每个组可选）
    • LMK03806 时钟源为 156.25MHz 时，LVPECL 附加抖动：
      • 20fs RMS (10kHz - 1MHz)
      • 51fs RMS (12kHz - 20MHz)
  • 高电源抑制比 (PSRR)：156.25MHz 时为 -65/-76dBc (LVPECL/LVDS)
  • 具有同步使能驶入的 LVCMOS 输出
  • 由引脚控制的配置
  • VCC内核电源：3.3V ± 5%
  • 3 个独立的 VCCO输出电源：3.3V/2.5V ± 5%
  • 工业温度范围：-40°C 至 +85°C
  • 40 接线超薄型四方扁平无引线 (WQFN) 封装 (6mm x 6mm)

All trademarks are the property of their respective owners.

LMK00308 是一款 3GHz，8 路输出差动扇出缓冲器，此缓冲区用于高频、低抖动时钟/数据分配和电平转换。 可从两个通用输入或一个晶振输入中选择输入时钟。 所选择的的输入时钟被分配到 4 个差分输出和 1 个 LVCMOS 输出的 2 个组。 两个差分输出组可被独立配置为 LVPECL，LVDS 或 HCSL 驱动器，或者被禁用。 LVCMOS 输出具有用于在启用或禁用时实现无短脉冲运行的同步使能输入。 LMK00308 由一个 3.3V 内核电源和 3 个独立的 3.3V/2.5V 输出电源供电运行。

LMK00308 提供高性能、多用途和电源效率，这使得它成为在增加系统中的时序余裕的同时替代固定输出缓冲器器件的理想选择。

LMK00308 是一款 3GHz，8 路输出差动扇出缓冲器，此缓冲区用于高频、低抖动时钟/数据分配和电平转换。 可从两个通用输入或一个晶振输入中选择输入时钟。 所选择的的输入时钟被分配到 4 个差分输出和 1 个 LVCMOS 输出的 2 个组。 两个差分输出组可被独立配置为 LVPECL，LVDS 或 HCSL 驱动器，或者被禁用。 LVCMOS 输出具有用于在启用或禁用时实现无短脉冲运行的同步使能输入。 LMK00308 由一个 3.3V 内核电源和 3 个独立的 3.3V/2.5V 输出电源供电运行。

LMK00308 提供高性能、多用途和电源效率，这使得它成为在增加系统中的时序余裕的同时替代固定输出缓冲器器件的理想选择。
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设计与开发

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评估板

LMK00308EVM — LMK00308 评估板

The LMK00308 Evaluation Board allows functional and performance verification of the LMK00308 high-performance 8-output differential clock buffer device.

用户指南: PDF
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支持软件

CLOCKDESIGNTOOL — Clock Design Tool Software

The Clock Design Tool software helps with part selection, loop filter design and simulation of timing device solutions. When you enter desired output frequencies and a reference frequency (optional), the tool provides TI devices to meet the specified requirements, divider values and a recommended (...)

支持的产品和硬件

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SNAM050A.ZIP (109 KB) - IBIS Model
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CLOCK-TREE-ARCHITECT — 时钟树架构编程软件

时钟树架构是一款时钟树综合工具，可根据您的系统要求生成时钟树解决方案，从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据，然后生成系统级多芯片时钟解决方案。
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PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

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  • 引脚镀层/焊球材料
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