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CDCLVC1102

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低抖动 1:2 LVCMOS 扇出时钟缓冲器

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产品详情

Number of outputs 2 Additive RMS jitter (typ) (fs) 70 Core supply voltage (V) 2.5, 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
Number of outputs 2 Additive RMS jitter (typ) (fs) 70 Core supply voltage (V) 2.5, 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
TSSOP (PW) 8 19.2 mm² 3 x 6.4
  • High-Performance 1:2, 1:3, 1:4, 1:6, 1:8, 1:10, 1:12 LVCMOS Clock Buffer Family
  • Very Low Pin-to-Pin Skew < 50 ps
  • Very Low Additive Jitter < 100 fs
  • Supply Voltage: 3.3 V or 2.5 V
  • fmax = 250 MHz for 3.3 V
    fmax = 180 MHz for 2.5 V
  • Operating Temperature Range: –40°C to 85°C
  • Available in 8-, 14-, 16-, 20-, 24-Pin TSSOP Package (All Pin-Compatible)
  • High-Performance 1:2, 1:3, 1:4, 1:6, 1:8, 1:10, 1:12 LVCMOS Clock Buffer Family
  • Very Low Pin-to-Pin Skew < 50 ps
  • Very Low Additive Jitter < 100 fs
  • Supply Voltage: 3.3 V or 2.5 V
  • fmax = 250 MHz for 3.3 V
    fmax = 180 MHz for 2.5 V
  • Operating Temperature Range: –40°C to 85°C
  • Available in 8-, 14-, 16-, 20-, 24-Pin TSSOP Package (All Pin-Compatible)

The CDCLVC11xx is a modular, high-performance, low-skew, general-purpose clock buffer family from Texas Instruments.

The entire family is designed with a modular approach in mind. It is intended to round up TI’s series of LVCMOS clock generators.

Seven different fan-out variations, 1:2 to 1:12, are available. All of the devices are pin-compatible to each other for easy handling.

All family members share the same high performing characteristics such as low additive jitter, low skew, and wide operating temperature range.

The CDCLVC11xx supports an asynchronous output enable control (1G) which switches the outputs into a low state when 1G is low.

The CDCLVC11xx family operates in a 2.5-V and
3.3-V environment and are characterized for operation from –40°C to 85°C.

The CDCLVC11xx is a modular, high-performance, low-skew, general-purpose clock buffer family from Texas Instruments.

The entire family is designed with a modular approach in mind. It is intended to round up TI’s series of LVCMOS clock generators.

Seven different fan-out variations, 1:2 to 1:12, are available. All of the devices are pin-compatible to each other for easy handling.

All family members share the same high performing characteristics such as low additive jitter, low skew, and wide operating temperature range.

The CDCLVC11xx supports an asynchronous output enable control (1G) which switches the outputs into a low state when 1G is low.

The CDCLVC11xx family operates in a 2.5-V and
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设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

CDCLVC1104EVM — CDCLVC1104 评估模块

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TI.com 上无现货
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DLPDLCR4710EVM-G2 — 全高清 DLP4710 芯片组评估模块

DLP® LightCrafter Display 4710 EVM-G2 是一款易于使用的即插即用型评估平台，适用于全高清 DLP4710 芯片组。DLP4710 芯片组设计用于多种显示应用，如便携式投影仪、无屏电视、交互式显示器和数字标牌。DLP4710 芯片组由 DLP4710（0.47 英寸 1080p）全高清 DMD、DLPC3439 显示控制器和 DLPA3005 PMIC/LED 驱动器组成。此 EVM 配有生产就绪型光学引擎并以小巧外形实现了分辨率（全高清）、亮度和可编程性的完美结合。

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用户指南: PDF
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仿真模型

CDCLVC1102/03/04/06/08/10/12 IBIS Model (Rev. B)

SLLM088B.ZIP (263 KB) - IBIS Model
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CLOCK-TREE-ARCHITECT — 时钟树架构编程软件

时钟树架构是一款时钟树综合工具，可根据您的系统要求生成时钟树解决方案，从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据，然后生成系统级多芯片时钟解决方案。
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PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

支持的产品和硬件

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PSPICE-FOR-TI — PSpice® for TI 设计和仿真工具

PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库，您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案，然后再进行布局和制造，可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中，您可以搜索 TI (...)
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参考设计

TIDA-00207 — 符合 EN55011 标准，工业温度，10/100Mbps 以太网 PHY 砖型参考设计

此以太网 PHY 砖型参考设计使德州仪器 (TI) 客户能够采用 TI 工业以太网 PHY 收发器器件快速设计系统，并投放市场，完全符合 EN5501 A 类 EMI 要求。此参考设计中采用一个 50 引脚接口来连接基于 32 位 Cortex M4 处理器的控制器板。  该电路板采用小尺寸（2 英寸 x 3 英寸）设计，便于安装到现有产品中。 

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TIDA-00928 — 采用光纤或双绞线接口、符合 EMI/EMC 标准的 10/100Mbps 以太网砖型参考设计

这一以太网砖型参考设计提供了一种简化的解决方案，因而无需多个铜线或光纤接口板。该设计采用小尺寸、低功耗的 10/100Mbps 以太网收发器来减小板尺寸，提供成本优化且可扩展的解决方案，降低高温工业应用的功耗。DP83822 提供发送和接收数据所需的所有物理层功能—无论是通过标准双绞线电缆，还是连接至外部光纤（SC 或 ST 或 SFP）收发器。此设计可采用固定或可编程的 LDO 为模拟和 IO 电源配置不同的供电水平。砖型结构通过内部 MAC 连接到 TM4C129X TIVA™ MCU。此设计依照 IEC61000-4 标准级别 4 针对辐射发射、ESD 和 EFT 进行了测试。
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TIDA-00810 参考设计通过高精度交流电压和电流测量模拟前端 (AFE) 以及用于在宽动态范围测量的四通道、24 位同步采样差分输入 Δ-Σ ADC，精确测量模拟输入性能，并提供芯片诊断功能，有助于及早发现电源系统故障。ADC 配置为测量 0V 至 5V 单极。使用具有 2.5V 直流输出电平位移的固定增益放大器，将输入缩放到 ADC 测量范围。AFE 可用于测量电流互感器、具有模拟隔离功能的电位分压器和 Rogowski 有源积分器的输出。AFE 采用 10 位低分辨率逐次逼近寄存器 (SAR) ADC 与 24 位 ∑-∆ ADC 并行进行 ADS131A04 诊断。
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封装 引脚 CAD 符号、封装和 3D 模型
TSSOP (PW) 8 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

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包含信息：
  • RoHS
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  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

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