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CDCLVC1106

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低抖动 1:6 LVCMOS 扇出时钟缓冲器

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产品详情

Number of outputs 6 Additive RMS jitter (typ) (fs) 70 Core supply voltage (V) 2.5, 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
Number of outputs 6 Additive RMS jitter (typ) (fs) 70 Core supply voltage (V) 2.5, 3.3 Output supply voltage (V) 2.5, 3.3 Output skew (ps) 50 Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
TSSOP (PW) 14 32 mm² 5 x 6.4
  • High-Performance 1:2, 1:3, 1:4, 1:6, 1:8, 1:10, 1:12 LVCMOS Clock Buffer Family
  • Very Low Pin-to-Pin Skew < 50 ps
  • Very Low Additive Jitter < 100 fs
  • Supply Voltage: 3.3 V or 2.5 V
  • fmax = 250 MHz for 3.3 V
    fmax = 180 MHz for 2.5 V
  • Operating Temperature Range: –40°C to 85°C
  • Available in 8-, 14-, 16-, 20-, 24-Pin TSSOP Package (All Pin-Compatible)
  • High-Performance 1:2, 1:3, 1:4, 1:6, 1:8, 1:10, 1:12 LVCMOS Clock Buffer Family
  • Very Low Pin-to-Pin Skew < 50 ps
  • Very Low Additive Jitter < 100 fs
  • Supply Voltage: 3.3 V or 2.5 V
  • fmax = 250 MHz for 3.3 V
    fmax = 180 MHz for 2.5 V
  • Operating Temperature Range: –40°C to 85°C
  • Available in 8-, 14-, 16-, 20-, 24-Pin TSSOP Package (All Pin-Compatible)

The CDCLVC11xx is a modular, high-performance, low-skew, general-purpose clock buffer family from Texas Instruments.

The entire family is designed with a modular approach in mind. It is intended to round up TI’s series of LVCMOS clock generators.

Seven different fan-out variations, 1:2 to 1:12, are available. All of the devices are pin-compatible to each other for easy handling.

All family members share the same high performing characteristics such as low additive jitter, low skew, and wide operating temperature range.

The CDCLVC11xx supports an asynchronous output enable control (1G) which switches the outputs into a low state when 1G is low.

The CDCLVC11xx family operates in a 2.5-V and
3.3-V environment and are characterized for operation from –40°C to 85°C.

The CDCLVC11xx is a modular, high-performance, low-skew, general-purpose clock buffer family from Texas Instruments.

The entire family is designed with a modular approach in mind. It is intended to round up TI’s series of LVCMOS clock generators.

Seven different fan-out variations, 1:2 to 1:12, are available. All of the devices are pin-compatible to each other for easy handling.

All family members share the same high performing characteristics such as low additive jitter, low skew, and wide operating temperature range.

The CDCLVC11xx supports an asynchronous output enable control (1G) which switches the outputs into a low state when 1G is low.

The CDCLVC11xx family operates in a 2.5-V and
3.3-V environment and are characterized for operation from –40°C to 85°C.

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* 数据表 CDCLVC11xx 3.3-V and 2.5-V LVCMOS High-Performance Clock Buffer Family 数据表 (Rev. B) PDF | HTML 2017年 2月 24日
应用手册 How to Apply 1.8-V Signals to 3.3-V CDCLVC11xx Fanout Clock Buffer 2010年 11月 30日

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

CDCLVC1112EVM — CDCLVC1112 评估模块

CDCLVC1112 是一款高性能、低附加相位噪声 VCMOS 时钟缓冲器。它有 1 个 LVCMOS 输入和 12 个 LVCMOS 输出。它还有启动引脚。此评估模块 (EVM) 旨在演示 CDCLVC1112 的电性能。然而，那些对 CDCLVC1106、CDCLVC1108 或 CDCLVC1110 的性能评估感兴趣的客户也可以使用此 EVM。为达到最佳性能，该评估板配备有 50Ω SMA 连接器和受控良好的 50Ω 阻抗微带传输线。
用户指南: PDF
TI.com 上无现货
评估板

PP-SALB2-EVM — PP-SALB2-EVM 智能放大器扬声器特性板评估模块（学习板 2）

此电路板支持：TAS2555YZEVM、TAS2557EVM 和 TAS2559EVM。

智能放大器扬声器特性鉴定板与配套的 TI 智能放大器和 PurePath Console 软件配合使用时，可让用户测量扬声器偏移、温度和其他参数，以便与 TI 智能放大器产品配合使用。  整个解决方案提供了易用的分步流程，可指导您完成整个扬声器特性描述过程。  表征完成后，扬声器参数随后会自动加载到 PurePath Console，因此可以开始进行微调，通过扬声器保护实现出色音质。

用户指南: PDF
TI.com 上无现货
仿真模型

CDCLVC1102/03/04/06/08/10/12 IBIS Model (Rev. B)

SLLM088B.ZIP (263 KB) - IBIS Model
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设计工具

CLOCK-TREE-ARCHITECT — 时钟树架构编程软件

时钟树架构是一款时钟树综合工具，可根据您的系统要求生成时钟树解决方案，从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据，然后生成系统级多芯片时钟解决方案。
立即设计
设计工具

PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

支持的产品和硬件

支持的产品和硬件
下载选项
模拟工具

PSPICE-FOR-TI — PSpice® for TI 设计和仿真工具

PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库，您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案，然后再进行布局和制造，可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中，您可以搜索 TI (...)
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参考设计

TIDA-01555 — 用于多 ADC 的同步相干 DAQ 的灵活接口 (PRU-ICSS) 参考设计

此参考设计展示了一种接口实现方案，此方案通过 Sitara Arm 处理器连接多个高压双极输入、8 通道、多路复用输入 SAR ADC（6 个），从而使用可编程实时单元 (PRU-ICSS) 扩展输入通道的数量。通过对 ADC 进行配置，可在所有 ADC 之间同时采样相同的通道。此设计突出了 PRU-ICSS 能够应对 1536ksps（每个样本 = 16 位）的数据速率（在每个线路周期采样 640 个样本）。对于 50Hz 周期，这就相当于同时在 6 个 ADC 之间每通道为 32ksps（640 个样本/周期*50Hz*6 ADC*8 通道 = 1536ksps）。此外，还使用另一个 (...)
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原理图: PDF
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TIDA-01466 — 适用于超声波前端的低电压、低噪声电源参考设计

该参考设计是一款经过优化的电源，专门用于为超声波成像系统接收 AFE IC 的八个 16 通道供电。该设计使用单芯片直流/直流转换器 + LDO 组合稳压器将 LDO 输入设置为恰好高于压降电压，同时充分利用 LDO PSRR，从而减少器件数，同时最大限度地提高效率。  此外，超低噪声 LDO 有助于实现可能的最高模数转换分辨率，从而实现更高的图像质量。该设计能够使开关频率与主时钟频率和系统时钟频率同步，从而帮助系统设计人员应用简单的滤波技术来消除接地回路上的电源开关噪声，或使用扩频时钟来降低 EMI。此外，该设计实现了电子保险丝器件，从而提供一种简单灵活的过流保护方式。
设计指南: PDF
原理图: PDF
封装 引脚 CAD 符号、封装和 3D 模型
TSSOP (PW) 14 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

订购和质量

包含信息：
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

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