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产品详细信息

参数

Function Dual-loop PLL Number of outputs 15 RMS jitter (fs) 156 Output frequency (Min) (MHz) 0.315 Output frequency (Max) (MHz) 1250 Input type LVCMOS, LVDS, LVPECL Output type LVCMOS, LVDS, LVPECL Supply voltage (Min) (V) 3.15 Supply voltage (Max) (V) 3.45 Features JESD204B Operating temperature range (C) -40 to 85 open-in-new 查找其它 时钟抖动清除器和同步器

封装|引脚|尺寸

WQFN (NKD) 64 81 mm² 9 x 9 open-in-new 查找其它 时钟抖动清除器和同步器

特性

  • JEDEC JESD204B 支持
  • 超低 RMS 抖动
    • 156fs RMS 抖动(12kHz 至 20MHz)
    • 245fs RMS 抖动(100Hz 至 20MHz)
    • 245.76MHz 时具有 –162.5dBc/Hz 本底噪声
  • PLL2 提供多达 14 个差动器件时钟
    • 多达 7 个 SYSREF 时钟
    • 最高时钟输出频率:1.25GHz
    • PLL2 提供 LVPECL、LVDS 可编程输出
  • PLL1 提供缓冲的 VCXO 或晶体输出
    • LVPECL、LVDS、2xLVCMOS 可编程输出
  • 双环路 PLLatinum™锁相环 (PLL) 架构
  • PLL1
    • 多达 3 个冗余输入时钟
      • 自动和手动切换模式
      • 无中断切换和 LOS
    • 集成低噪声晶体振荡器电路
    • 输入时钟丢失时采用保持模式
  • PLL2
    • 标准 [1Hz] PLL 本底噪声为 -224dBc/Hz
    • 相位检测器频率高达 155MHz
    • OSCin 倍频器
    • 两个集成低噪声 VCO
  • 50% 占空比输出分配,1 至 32
    (偶数和奇数)
  • 精密数字延迟
  • 25ps 步长模拟延迟
  • 多模式:双 PLL 或单 PLL
  • 工业温度范围:–40°C 至 85°C
  • 3.15V 至 3.45V 工作电压
  • 封装:64 引脚 WQFN (9.0 × 9.0 × 0.8mm)
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描述

LMK04228 器件是支持 JEDEC JESD204B 且在业界具有高性能的时钟调节器。

PLL2 可以配置 14 个时钟输出以驱动 7 个 JESD204B 转换器或其他逻辑器件(使用器件和 SYSREF 时钟)。SYSREF 可以通过直流和交流耦合提供。不只是 JESD204B 应用,14 个输出中的每一个输出都可以单独配置为用于传统时钟系统的高性能输出。

LMK04228 既具有出色的性能, 又具有 多种特性,如功率和性能均衡调节、双 VCO、保持模式和可根据输出调节的模拟和数字延迟,是提供灵活的高性能时钟树的理想器件。

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 具有双环路 PLL 的 LMK04228 超低噪声且符合 JESD204B 标准的时钟抖动清除器 数据表 (Rev. A) 下载英文版本 (Rev.A) 2019年 10月 9日

设计与开发

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软件开发

应用软件和框架 下载
时钟设计工具 - 环路滤波器和器件配置 + 仿真
CLOCKDESIGNTOOL The Clock Design Tool software helps with part selection, loop filter design and simulation of timing device solutions. When you enter desired output frequencies and a reference frequency (optional), the tool provides TI devices to meet the specified requirements, divider values and a recommended (...)
应用软件和框架 下载
德州仪器 (TI) 时钟和合成器 (TICS) Pro 软件
TICSPRO-SW TICS 专业版软件用于对 CDC、LMK 和 LMX 的 EVM 进行编程。这些器件包含 PLL+VCO、合成器和时钟器件。
特性
  • 通过 USB2ANY 或板载 USB 接口对 EVM 进行编程。
  • 导出编程配置以在终端应用中使用。
IDE、配置、编译器或调试器 下载
CodeLoader 器件寄存器编程
CODELOADER The CodeLoader 4 software is used to program the LMX PLLs and LMK timing devices through either the USB or line print terminal (LPT) port of a computer. This software also provides information on how to program the device by showing the bits that are actually sent.


Which software do I use?

Product

Loop (...)

设计工具和仿真

仿真工具 下载
PSPICE® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库,您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案,然后再进行布局和制造,可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中,您可以搜索 TI 器件、了解产品系列、打开测试台并对您的设计进行仿真,从而进一步分析选定的器件。您还可对多个 TI 器件进行联合仿真,以更好地展现您的系统。

除了一个完整的预加载模型库之外,您还可以在 PSPICE-FOR-TI 工具中轻松访问 TI 器件的全新技术资料。在您确认找到适合您应用的器件后,可访问 TI store 购买产品。 

借助 PSpice for TI,您可使用合适的工具来满足您在整个设计周期(从电路探索到设计开发和验证)的仿真需求。免费获取、轻松入门。立即下载 PSpice 设计和仿真套件,开始您的设计。

入门

  1. 申请使用 PSPICE-FOR-TI 仿真器
  2. 下载并安装
  3. 观看有关仿真入门的培训
特性
  • 利用 Cadence PSpice 技术
  • 带有一套数字模型的预装库可在最坏情形下进行时序分析
  • 动态更新确保您可以使用全新的器件型号
  • 针对仿真速度进行了优化,且不会降低精度
  • 支持对多个产品进行同步分析
  • 基于 OrCAD Capture 框架,提供对业界广泛使用的原理图捕获和仿真环境的访问权限
  • 可离线使用
  • 在各种工作条件和器件容许范围内验证设计,包括
    • 自动测量和后处理
    • Monte Carlo 分析
    • 最坏情形分析
    • 热分析
设计工具 下载
时钟树架构编程软件
CLOCK-TREE-ARCHITECT 时钟树架构是一款时钟树综合工具,可根据您的系统要求生成时钟树解决方案,从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据,然后生成系统级多芯片时钟解决方案。
特性
  • 接受客户特定的设计要求,如输入频率、输出频率、时钟格式和时钟计数
  • 在生成时钟树时考虑各种高级规范,如本底噪声和相位确定性要求
  • 提供清晰且直观的方框图
  • 评估每个产品和系统的关键性能指标(面积、价格、抖动和功率)
  • 生成设计报告(带有指向数据表、培训材料和软件工具的快速链接),以供将来参考

CAD/CAE 符号

封装 引脚 下载
WQFN (NKD) 64 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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