具有集成 PLL 和 4 个 LVPECL 输出的 1 至 800MHz 精密时钟分配器

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产品详细信息

参数

Function Clock generator Number of outputs 4 Output frequency (Max) (MHz) 800 Core supply voltage (V) 3.3 Output supply voltage (V) 3.3 Input type LVCMOS, LVPECL Output type LVPECL Operating temperature range (C) -40 to 85 Features Integrated integer-N PLL, uWire Rating Catalog open-in-new 查找其它 时钟发生器

封装|引脚|尺寸

WQFN (RHS) 48 49 mm² 7 x 7 open-in-new 查找其它 时钟发生器

特性

  • 20 fs additive jitter
  • Integrated Integer-N PLL with outstanding normalized phase noise contribution of -224 dBc/Hz
  • Clock output frequency range of 1 to 800 MHz
  • 4 LVPECL clock outputs
  • Dedicated divider and delay blocks on each clock output
  • Pin compatible family of clocking devices
  • 3.15 to 3.45 V operation
  • Package: 48 pin LLP (7.0 x 7.0 x 0.8 mm)

  • Target Applications

  • Data Converter Clocking
  • Networking, SONET/SDH, DSLAM
  • Wireless Infrastructure
  • Medical
  • Test and Measurement
  • Military / Aerospace

  • open-in-new 查找其它 时钟发生器

    描述

    The LMK02002 precision clock conditioner combines the functions of jitter cleaning/reconditioning, multiplication, and distribution of a reference clock. The device integrates a high performance Integer-N Phase Locked Loop (PLL), and four LVPECL clock output distribution blocks.

    Each clock distribution block includes a programmable divider, a phase synchronization circuit, a programmable delay, a clock output mux, and an LVPECL output buffer. This allows multiple integer-related and phase-adjusted copies of the reference to be distributed to eight system components.

    The clock conditioner comes in a 48-pin LLP package and is footprint compatible with other clocking devices in the same family.


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    技术文档

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    应用手册 AN-1821 CPRI Repeater System (Rev. A) 2013年 4月 26日
    用户指南 Clock Conditioner Owner's Manual 2006年 11月 10日

    设计与开发

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    软件开发

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    CodeLoader 器件寄存器编程
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    设计工具和仿真

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    PSPICE® for TI design and simulation tool
    PSPICE-FOR-TI — PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

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    入门

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    特性
    • 利用 Cadence PSpice 技术
    • 带有一套数字模型的预装库可在最坏情形下进行时序分析
    • 动态更新确保您可以使用全新的器件型号
    • 针对仿真速度进行了优化,且不会降低精度
    • 支持对多个产品进行同步分析
    • 基于 OrCAD Capture 框架,提供对业界广泛使用的原理图捕获和仿真环境的访问权限
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      • 热分析
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    CLOCK-TREE-ARCHITECT 时钟树架构是一款时钟树综合工具,可根据您的系统要求生成时钟树解决方案,从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据,然后生成系统级多芯片时钟解决方案。
    特性
    • 接受客户特定的设计要求,如输入频率、输出频率、时钟格式和时钟计数
    • 在生成时钟树时考虑各种高级规范,如本底噪声和相位确定性要求
    • 提供清晰且直观的方框图
    • 评估每个产品和系统的关键性能指标(面积、价格、抖动和功率)
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