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模数转换器 (ADC)
高速 ADC (≥10 MSPS)

ADC09QJ1300-Q1

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具有 JESD204C 接口的汽车类四通道 9 位 1.3GSPS 模数转换器 (ADC)

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ADC09QJ1300-Q1

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产品详情

Sample rate (max) (Msps) 1300 Resolution (Bits) 9 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Automotive Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1800 Architecture Folding Interpolating SNR (dB) 53.5 ENOB (Bits) 8.5 SFDR (dB) 64 Operating temperature range (°C) -40 to 125 Input buffer Yes
Sample rate (max) (Msps) 1300 Resolution (Bits) 9 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Automotive Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1800 Architecture Folding Interpolating SNR (dB) 53.5 ENOB (Bits) 8.5 SFDR (dB) 64 Operating temperature range (°C) -40 to 125 Input buffer Yes
FCCSP (AAV) 144 100 mm² (10 mm × 10 mm)
  • 符合面向汽车应用的 AEC-Q100 标准：
    • 温度等级 1：–40°C 至 +125°C，TA
  • ADC 内核：
    • 分辨率：9 位
    • 最大采样率：1.3GSPS
    • 非交错式架构
    • 内部抖动可减少高次谐波
  • 性能规格 (–1dBFS)：
    • SNR (100MHz)：53.5dBFS
    • ENOB (100MHz)：8.5Bits
    • SFDR (100MHz)：64dBc
    • 本底噪声 (–20dBFS)：–143dBFS
  • 满量程输入电压：800mVPP-DIFF
  • 全功率输入带宽：6GHz
  • JESD204C 串行数据接口：
    • 总共支持 2 至 8 个（四通道/双通道）或 1 至 4 个（单通道）串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 编码模式
    • 子类 1 支持确定性延迟
    • 与 JESD204B 接收器兼容
  • 可选的内部采样时钟生成
    • 内部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可简化同步
  • 四个时钟输出可简化系统时钟
    • FPGA 或相邻 ADC 的参考时钟
    • 串行器/解串器收发器的参考时钟
  • 脉冲系统的时间戳输入和输出
  • 功耗 (1GSPS)：
    • 四通道：450mW/通道
    • 双通道：625mW/通道
    • 单通道：940mW
  • 电源：1.1V、1.9V
  • 符合面向汽车应用的 AEC-Q100 标准：
    • 温度等级 1：–40°C 至 +125°C，TA
  • ADC 内核：
    • 分辨率：9 位
    • 最大采样率：1.3GSPS
    • 非交错式架构
    • 内部抖动可减少高次谐波
  • 性能规格 (–1dBFS)：
    • SNR (100MHz)：53.5dBFS
    • ENOB (100MHz)：8.5Bits
    • SFDR (100MHz)：64dBc
    • 本底噪声 (–20dBFS)：–143dBFS
  • 满量程输入电压：800mVPP-DIFF
  • 全功率输入带宽：6GHz
  • JESD204C 串行数据接口：
    • 总共支持 2 至 8 个（四通道/双通道）或 1 至 4 个（单通道）串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 编码模式
    • 子类 1 支持确定性延迟
    • 与 JESD204B 接收器兼容
  • 可选的内部采样时钟生成
    • 内部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可简化同步
  • 四个时钟输出可简化系统时钟
    • FPGA 或相邻 ADC 的参考时钟
    • 串行器/解串器收发器的参考时钟
  • 脉冲系统的时间戳输入和输出
  • 功耗 (1GSPS)：
    • 四通道：450mW/通道
    • 双通道：625mW/通道
    • 单通道：940mW
  • 电源：1.1V、1.9V

ADC09xJ1300-Q1 是一系列 9 位、1.3GSPS 四通道/双通道/单通道模数转换器 (ADC)，由于具有低功耗、高采样率和 9 位分辨率等特性，因此非常适用于光检测和测距（激光雷达）系统。ADC09xJ1300-Q1 符合汽车级应用要求。

6GHz 的全功率输入带宽 (-3dB) 为调频连续波 (FMCW) 激光雷达系统提供平坦的频率响应，并为基于脉冲的系统提供窄脉冲响应。全功率输入带宽还支持高达 4GHz 的直接射频采样。

包含许多时钟功能以放宽系统硬件要求，例如带有集成压控振荡器 (VCO) 的内部锁相环 (PLL)，用于生成采样时钟。提供了四个时钟输出，以便对 FPGA 或 ASIC 的逻辑和串行器/解串器进行计时。为脉冲系统提供了时间戳输入和输出。

JESD204C 串行接口通过减少印刷电路板 (PCB) 布线量来减小系统尺寸。接口模式支持 2 至 8 个通道（双通道和四通道器件）或 1 至 4 个通道（单通道器件）和高达 17.16Gbps 的串行器/解串器波特率，从而使每个应用能够实现最佳配置。

ADC09xJ1300-Q1 是一系列 9 位、1.3GSPS 四通道/双通道/单通道模数转换器 (ADC)，由于具有低功耗、高采样率和 9 位分辨率等特性，因此非常适用于光检测和测距（激光雷达）系统。ADC09xJ1300-Q1 符合汽车级应用要求。

6GHz 的全功率输入带宽 (-3dB) 为调频连续波 (FMCW) 激光雷达系统提供平坦的频率响应，并为基于脉冲的系统提供窄脉冲响应。全功率输入带宽还支持高达 4GHz 的直接射频采样。

包含许多时钟功能以放宽系统硬件要求，例如带有集成压控振荡器 (VCO) 的内部锁相环 (PLL)，用于生成采样时钟。提供了四个时钟输出，以便对 FPGA 或 ASIC 的逻辑和串行器/解串器进行计时。为脉冲系统提供了时间戳输入和输出。

JESD204C 串行接口通过减少印刷电路板 (PCB) 布线量来减小系统尺寸。接口模式支持 2 至 8 个通道（双通道和四通道器件）或 1 至 4 个通道（单通道器件）和高达 17.16Gbps 的串行器/解串器波特率，从而使每个应用能够实现最佳配置。
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设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

ADC09QJ1300EVM — ADC09QJ1300 具有 JESD204C 接口的四通道 9 位 1.3GSPS ADC 评估模块

ADC09QJ1300 评估模块 (EVM) 用于评估 ADC09QJ1300-Q1 系列高速模数转换器 (ADC)。该 EVM 装配了 ADC09QJ1300-Q1，后者是一款具有 JESD204B 接口的 9 位四通道 1.3GSPS ADC，可评估 9 位系列中的所有采样率和单通道、双通道和四通道汽车类或工业级器件。
用户指南: PDF
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
评估板

TSW12QJ1600EVM — ADC12QJ1600-Q1 8 通道（两个同步 4 通道）12 位 1.6GSPS JESD204C 接口 ADC 评估模块

TSW12QJ1600 评估模块 (EVM) 用于评估具有不同前端选项的 ADC12QJ1600-Q1 系列高速模数转换器 (ADC)。该 EVM 装配了双通道 ADC12QJ1600-Q1（一个具有 JESD204B 接口的 12 位四通道 1.6GSPS ADC），可评估多个 ADC 同步和确定性延迟，并使用各种前端选项（交流耦合变压器；具有 LMH32401 的直流耦合选项）测试 ADC 的性能。该设计还展示了如何通过从一个 ADC 到另一个 ADC 菊链式连接 PLL 基准输出（PLLREFO+、PLLREFO-）来简化时钟方案，无需采用 JESD 器件通常需要的时钟分配芯片。
用户指南: PDF
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
固件

TI204C-IP — Request for JESD204 rapid design IP

JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计，可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时，可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路，对其进行定制，以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后，TI 将会通过安全的下载链接提供该 IP。

JESD204 (...)

支持的产品和硬件
评估模块 (EVM) 用 GUI

DATACONVERTERPRO-SW — 高速数据转换器专业 GUI 安装程序，v5.31

该高速数据转换器专业版 GUI 是一款 PC（与 Windows® XP/7/10 兼容）程序，旨在帮助评估大多数 TI 高速数据转换器 [模数转换器 (ADC) 和数模转换器 (DAC)] 和模拟前端 (AFE) 平台。DATACONVERTERPRO-SW 支持整个 TSW14xxx 系列的数据采集和图形生成卡，为分析时域和频域中的数据转换器提供了快速强大的解决方案以及单音、多音和调制信号支持。此 GUI 还兼容用于快速合成单音、多音和调制信号的 TI 图形生成 GUI。

用户可以向 DATACONVERTERPRO-SW 提供自定义图形以加载到 TI DAC。支持从 ADC 捕获导出 (...)

支持的产品和硬件
仿真模型

ADC09xJ800, ADC09xJ1300, ADC12xJ800 and ADC12xJ1600 IBIS-AMI Model (Rev. A)

SBAM512A.ZIP (22293 KB) - IBIS-AMI 模型
支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
FCCSP (AAV) 144 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

订购和质量

推荐产品可能包含与 TI 此产品相关的参数、评估模块或参考设计。

支持和培训

可获得 TI 工程师技术支持的 TI E2E™ 论坛

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