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产品详细信息

参数

Resolution (Bits) 14 Sample/update rate (MSPS) 8400 Number of DAC channels (#) 2 Interpolation 10x, 12x, 16x, 18x, 1x, 20x, 24x, 2x, 4x, 6x, 8x Power consumption (Typ) (mW) 3800 Operating temperature range (C) -40 to 85 open-in-new 查找其它 个发送器

封装|引脚|尺寸

FCBGA (AAV) 144 100 mm² 10 x 10 open-in-new 查找其它 个发送器

特性

  • 具有多模式运行方式的 14 位分辨率、9GSPS DAC
    • 16 位、双通道数据模式
      • 最大输入速率:2.5GSPS
      • 宽带数字上变频器
        • 插值:1、2、4、6、8、10、12、16、18、20、24x
    • 12 位、双通道数据模式
      • 最大输入速率:3.33GSPS
      • 宽带数字上变频器
        • 插值:1、2、24x
    • 8 位、单通道数据模式
      • 最大输入速率:9GSPS
  • JESD204B 接口
    • 子类 1 支持多芯片同步
    • 最大通道速率:12.5Gbps
  • 差分输出
    • 支持直流耦合
    • 射频满量程输出功率(采用 2:1 平衡-非平衡变压器):
      2.14GHz 时为 3dBm
  • 具有旁路功能的内部 PLL 和 VCO
    • DAC38RF82:fC(VCO) = 5.9 或 8.9GHz
    • DAC38RF89:fC(VCO) = 5 或 7.5GHz
  • 电源:-1.8V、1.0V、1.8V
  • 封装:10mm x 10mm BGA,间距为 0.8mm,
    144 个焊球

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描述

DAC38RF82 和 DAC38RF89 是高性能的宽带宽型射频采样数模转换器 (DAC),能够实现高达 3.33GSPS 的双通道输入数据速率或高达 9GSPS 的 8 位单通道运行状态。这些器件具有一个多达 8 通道的低功耗 JESD204B 接口,最大比特率为 12.5Gbps。

在双通道运行状态下,无插值时输入接口的数据速率高达 3.33GSPS(12 位分辨率)和 2.5GSPS(16 位分辨率)。当用作具有 2x 至 24x 插值模式的复合基带发送器时,DAC38RF82 或 DAC38RF89 可以合成具有 16 位输入分辨率的高达 2GHz 带宽的宽带信号和具有 12 位输入分辨率的 2.66GHz 带宽的宽带信号。

8 位模式允许以 9GSPS 的最大 DAC 采样率进行输入,并可合成 0 至 4.5GHz 的宽带信号。

可选的低抖动 PLL/VCO 通过允许使用频率较低的参考时钟来简化 DAC 时钟的生成。DAC38RF82 和 DAC38RF89 支持不同的 VCO 频率范围,如器件比较表 所示。

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 具有 JESD204B 接口、片上 PLL 和宽带插值的 DAC38RF8x 双通道、差分输出、14 位、9GSPS、射频采样 DAC 数据表 (Rev. C) 下载最新的英文版本 (Rev.D) 2020年 6月 15日
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应用手册 高速数据转换 下载英文版本 2008年 10月 16日

设计与开发

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硬件开发

评估板 下载
document-generic 用户指南
899
说明

DAC38RF89 评估模块 (EVM) 是用于评估 DAC38RF89 数模转换器 (DAC) 的电路板。该 DAC38RFEVM 可用于对采样率高达 9GSPS 的 DAC 进行性能评估,同时还设计用于与 TSW14J56EVM(修订版 B 及更高版本)搭配使用。提供的 FMC 连接器还可以将 DAC 与第三方供应商的 FPGA 开发板相连接。此外,借助易于使用的软件界面,还可通过 SPI 来控制 DAC 和板载 LMK04828 时钟芯片。

特性
  • 可对采样率高达 9GSPS 的 DAC38RF89 进行评估
  • 支持针对各类 FMC 的高达 12.5Gbps 的 SerDes 信令速率
  • 具有出色相位噪声的两个片上 PLL 可简化系统时钟生成;此外还支持外部时钟模式
  • 集成式阻抗变压器 (DAC38RF89) 可帮助提供交流耦合输出,实现平衡至不平衡转换
  • 简便易用的软件界面和数据信号生成工具

软件开发

固件 下载
JESD204 Rapid Design IP for FPGAs connected to TI high-speed data converters
TI-JESD204-IP JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计,可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时,可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路,对其进行定制,以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后,TI 将会通过安全的下载链接提供该 IP。

JESD204 快速设计 IP 支持以下 FPGA 系列:

  • Xilinx® Virtex™ UltraScale™ 和 UltraScale+™
  • Xilinx Kintex™ UltraScale 和 UltraScale+
  • Xilinx Zynq™ UltraScale+ 和 Zynq UltraScale+ (Auto)
  • Xilinx Artix™ 7 和 Artix 7 (Auto)
  • Xilinx Virtex 7
  • Xilinx (...)
特性
  • 与 JEDEC JESD204a/b/c 协议兼容
  • 支持子类 1 确定性延迟和多器件同步
  • 支持的通道速率
    • 在 8b/10b 模式下高达 16.375Gbps
    • 在 64b/66b 模式下高达 20Gbps
  • 支持协议相关的所有错误检测和报告功能
  • 集成的传输层可将通道数据转换为样本(HD 模式不支持该功能)
  • 优化了 FPGA 中的逻辑和内存占用量,所释放的资源将可用于应用逻辑(并在可能的情况下获得尺寸更小/成本更低的 FPGA)
  • 新颖的设计特性,包括在与线路速率异步的时钟速率下导出数据
固件 下载
SLAC779A.ZIP (48623 KB)
评估模块 (EVM) 的 GUI 下载
SLAC722D.ZIP (216778 KB)

设计工具和仿真

仿真模型 下载
SLAM304.ZIP (70 KB) - IBIS Model
原理图 下载
SLAC734.ZIP (10565 KB)

参考设计

参考设计 下载
优化 射频采样 DAC 中的杂波和相位噪声的电源参考设计
TIDA-01215 — 此参考设计在不牺牲性能的情况下为射频采样 DAC38RF8x 数模转换器 (DAC) 的加电启动提供了一种高效电源方案,并且可以降低板面积和 BOM。该参考设计使用直流/直流开关和 LDO 为 DAC38RF8x 加电,同时实现高的模拟性能(杂散噪声和相位噪声)并最大限度地减少电源效率折衷。可以将此处概括的设计方法扩展到其他射频采样数据转换器的电源设计。
document-generic 原理图 document-generic 用户指南

CAD/CAE 符号

封装 引脚 下载
FCBGA (AAV) 144 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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