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产品详细信息

参数

# of TX/RX 4T4R # of DUCs/TX 2 # of DDCs/RX 2 Data rate (MSPS) 750 Operating temperature range (C) -40 to 85 Applications General Purpose open-in-new 查找其它 射频采样收发器

封装|引脚|尺寸

FCBGA (ABJ) 400 289 mm² 17 x 17 open-in-new 查找其它 射频采样收发器

特性

  • 四通道、14 位 9GSPS DAC
    • 信号带宽高达 800MHz
    • 每通道 1个 DSA 调节输出功率
  • 四通道、14 位 3GSPS ADC
    • 信号带宽高达 800MHz
    • NSD:–151dBFS/Hz
    • fIN = 2.6GHz、–3dBFS 时的交流性能
      • SNR:55dBFS
      • SFDR:73dBc HD2 和 HD3
      • SFDR:91dBc(最严重毛刺)
    • 每通道 2 个 DSA 扩展动态范围
    • 射频和数字功率检测器
  • 射频频率范围:10MHz 至 6GHz
  • 快速跳频 < 1µs
  • 接收数字信号路径:
    • 每个 ADC 连接双通道 DDC
    • 每个 DDC 有 3 个相位同调 32 位 NCO
    • 抽取率:3 倍至 32 倍
  • 发送数字信号路径:
    • 每个带有 32 位 NCO 的 DAC 连接双通道 DUC
    • 插值率:8 倍至 36 倍
    • Sin(x)/x 校正和可配置延迟
    • 功率放大器保护 (PAP)
  • JESD204B 接口:
    • 8 个高达 15Gbps 的收发器
    • 子类 1 多芯片同步
  • 时钟:
    • 具有旁路选项的内部 PLL 和 VCO
    • 利用时钟分频器产生最高为 3GHz 的时钟输出
  • DAC 功耗:9GSPS 时为 1.7W/ch
  • ADC 功耗:3GSPS 时为 1.8W/ch
  • 封装:17mm x 17mm FC BGA,0.8mm 间距

All trademarks are the property of their respective owners.

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描述

AFE7444 是具有 14 位 9GSPS DAC 和 14 位 3GSPS ADC 的四路通道宽频带射频采样模拟前端 (AFE)。可在高达 6GHz 的射频下工作,此器件支持直接射频采样到 C 频带,无需其他频率转换阶段。密度和灵活性的改进实现了对高通道数、多任务系统的支持。

DAC 信号路径支持插值和数字上变频选项,提供高达 800MHz 信号带宽。差动输出路径包括支持输出功率调优的数字步进衰减器 (DSA)。

每个 ADC 输入路径包括一个双通道 DSA 和射频数字功率检测器。灵活的抽取选项提供数据带宽优化。

8 通道 (8 TX + 8 RX) 子类 1 兼容性 JESD204B 接口运行速度高达 15Gbps。可旁路片上 PLL 通过可选时钟输出简化时钟运行。

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More information

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 具有 14 位、9GSPS DAC 和 14 位、3GSPS ADC 的AFE7444 四通道射频采样 AFE 数据表 (Rev. A) 下载英文版本 (Rev.A) 2020年 1月 15日
应用手册 An Efficient PoL Power Supply Design for High-Speed Data Converters 2020年 9月 29日
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应用手册 Temp Profile to Maintain Optimum FIT Performance 2019年 7月 23日
技术文章 So, what are S-parameters anyway? 2019年 5月 23日
技术文章 How to achieve fast frequency hopping 2019年 3月 3日
应用手册 AFE74xx as a Single-Chip Wideband Repeater Using Loopback Mode 2019年 1月 29日
应用手册 Evaluating the Frequency Hopping Capability of the AFE74xx 2018年 12月 3日
用户指南 AFE7444/22 User's Guide 2018年 10月 10日

设计与开发

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硬件开发

评估板 下载
document-generic 用户指南
说明

The AFE7444 evaluation module (EVM) is an RF-sampling transceiver platform that can be configured to support up to four-transmit and four-receive (4T4R) channels simultaneously. The module evaluates the AFE7444 device, which is a quad-channel RF-sampling analog front end (...)

特性
  • Allows evaluation of 4T4R RF-sampling AFE7444 solutions
  • JESD204B data interface to simplify digital interface; compliant up to 15-Gbps lane rates
  • Supports JESD204B subclass 1 for synchronization and compatibility
  • Option for DC-DC-based LDO-less power-management solution
  • Onboard clocking solution (...)

软件开发

固件 下载
JESD204 rapid design IP for FPGAs connected to TI high-speed data converters
TI-JESD204-IP The JESD204 Rapid Design IP has been designed to enable FPGA engineers to achieve an accelerated path to a working JESD204 system. The IP has been architected in a way that the downstream digital processing and other application logic are isolated from most of the performance and timing critical (...)
特性
  • Compatible with the JEDEC JESD204a/b/c protocols
  • Supports sub-class 1 deterministic latency and multi-device synchronization
  • Supported lane rates
    • Up to 16.375 Gbps in 8b/10b mode
    • Up to 20 Gbps in 64b/66b mode
  • Supports all protocol related error detection and reporting features
  • Integrated transport layer (...)

设计工具和仿真

计算工具 下载
射频采样频率规划器、模拟滤波器和 DDC Excel™ 计算器
FREQ-DDC-FILTER-CALC 此 Excel 计算器为系统设计人员提供了一种方法,可用于简化直接射频采样接收器的设计和调试过程。它提供三种功能:频率规划、模拟滤波和抽取滤波器杂散位置。

在概念阶段,频率规划工具可微调 ADC 采样率和输入频率位置,以便在出现阻塞事件时优化无杂散动态范围 (SFDR)。一些设计在这两个方面都很灵活;而 L 波段接收器或无线基础设施基站等其他设计则处理固定频段,且只提供采样率调优。

外部射频滤波器响应很大程度上取决于系统 SFDR 目标和 ADC 本身的 SFDR 性能;模拟滤波器工具可在设计阶段提供相关帮助。

在系统启动期间,如果快速傅里叶变换 (FFT) 频谱中出现不需要的杂散,抽取滤波器杂散定位器工具可提供帮助。ADC 输出整个奈奎斯特区域时,确定原始频率很简单,但不一定是杂散源。但如果复杂混合数字抽取起作用并且只有部分 FFT 频谱(其中杂散呈折叠状态)可用,此简单工具会将 ADC 的原始杂散映射到其新位置。

特性
  • 频率规划
  • 模拟滤波
  • 抽取滤波器杂散位置

参考设计

参考设计 下载
适用于雷达和电子战应用的多通道射频收发器参考设计
TIDA-010132 — 该参考设计展示了一款 8 通道模拟前端 (AFE),它使用了两个 AFE7444 4 通道射频收发器和基于 LMK04828-LMX2594 的时钟子系统,该子系统可支持将设计扩展至 16 通道或更多通道。每个 AFE 通道都包含 14 位 9GSPS DAC 和 3GSPS ADC,该 ADC 可在 2.6GHz 下同步至低于 10ps 偏移并且动态范围大于 75dB。
document-generic 原理图
参考设计 下载
适用于雷达和无线 5G 测试仪的多通道射频收发器时钟参考设计
TIDA-010131 — 相控阵雷达、无线通信测试仪和电子战等高速终端设备的模拟前端需要同步的多收发器信号链。每个收发器信号链都包括高速模数转换器 (ADC)、数模转换器 (DAC) 和时钟子系统。时钟子系统提供低噪声采样时钟,具备精细的延迟调节功能,可实现最低的通道间偏差和最佳的系统性能,如信噪比 (SNR)、无杂散动态范围 (SFDR)、IMD3 和有效位数 (ENOB) 等。此参考设计通过 AFE7444 EVM 展示了多通道 JESD204B 时钟生成和系统性能。通过高达 2.6GHz 射频的 6GSPS/3GSPS DAC/ADC 时钟实现的优于 10ps 的通道间偏差以及 SNR 和 SFDR 等系统性能与 AFE7444 数据表规格相当。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本

CAD/CAE 符号

封装 引脚 下载
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