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产品详细信息

参数

Sample rate (Max) (MSPS) 80 Resolution (Bits) 12 Number of input channels 2 Interface type JESD204B Analog input BW (MHz) 450 Features Low Power Rating Catalog Input range (Vp-p) 2 Power consumption (Typ) (mW) 329 Architecture Pipeline SNR (dB) 70.4 ENOB (Bits) 11.4 SFDR (dB) 96 Operating temperature range (C) -40 to 85 Input buffer No open-in-new 查找其它 高速 ADCs (>10MSPS)

封装|引脚|尺寸

VQFN (RGZ) 48 49 mm² 7 x 7 open-in-new 查找其它 高速 ADCs (>10MSPS)

特性

  • 双通道
  • 12 位分辨率
  • 1.8V 单电源
  • 支持 1 分频,2 分频和 4 分频的灵活输入时钟缓冲器

  • fIN = 70MHz 时,信噪比 (SNR) = 70.3dBFS,无杂散动态范围 (SFDR) = 88dBc
  • 超低功耗:
    • 160MSPS 时为每通道 227mW
  • 通道隔离:105dB
  • 内部抖动
  • JESD204B 串口:
    • 兼容子类 0、1、2,速率最高达 3.2Gbps
    • 支持每个 ADC 一条通道(高达 160MSPS)
  • 支持多芯片同步
  • 与 14 位版本器件 (ADC32J4X) 引脚到引脚兼容
  • 封装:超薄四方扁平无引线 (VQFN)-48 (7mm x 7mm)

应用

  • 多载波、多模式蜂窝基站
  • 雷达和智能天线阵列
  • 炮弹制导
  • 电机控制反馈
  • 网络和矢量分析器
  • 通信测试设备
  • 无损检测
  • 微波接收器
  • 软件定义无线电 (SDR)
  • 正交和分集无线电接收器

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描述

ADC32J2x 属于高线性度、超低功耗、双通道、12 位、50MSPS 至 160MSPS 模数转换器 (ADC) 系列。 此类器件专门设计用于支持具有宽动态范围需求且要求苛刻的高输入频率信号。 时钟输入分频器可给予系统时钟架构设计更高的灵活性,SYSREF 输入可实现整个系统同步。 该器件支持 JESD204B 接口,从而减少接口线路的数量,实现高系统集成度。 JESD204B 接口是串行接口,仅通过一个差分对即可串行输出每个 ADC 的数据。 内部锁相环 (PLL) 会将传入的 ADC 采样时钟乘以 20,以获得串行输出各通道的 12 位数据时所使用的位时钟。 该器件支持子类 1,接口速率高达 3.2Gbps。

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 ADC32J2x 具有 JESD204B 接口的双通道、12 位、50MSPS 至 160MSPS 模数转换器 数据表 (Rev. A) 下载英文版本 (Rev.A) 2015年 9月 3日
技术文章 Keys to quick success using high-speed data converters 2020年 10月 13日
技术文章 How to achieve fast frequency hopping 2019年 3月 3日
用户指南 ADC3xxx, ADC3xJxx EVM User's Guide (Rev. D) 2018年 8月 24日
技术文章 RF sampling: Learning more about latency 2017年 2月 9日
技术文章 Why phase noise matters in RF sampling converters 2016年 11月 28日

设计与开发

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硬件开发

评估板 下载
ADC32J23 评估模块
ADC32J23EVM
document-generic 用户指南
299
说明

ADC32J23 EVM 展示了低功耗双通道 80Msps 12 位 ADC 的性能。它包含 ADC32J23 器件、一个可选的直流耦合 THS4541 有源接口信号路径、LMK04828 提供的 JESD204B 时钟以及用于提供必需电压的 TI 电压稳压器。该 ADC 的输入默认连接到变压器输入,而后者可连接到 50 欧姆单端信号源。如果需要直流耦合路径,则使用 THS4541 提供可选路径。这可以通过移动某些焊接跳线进行选择。通过变压器输入提供时钟基准输入,可将该时钟基准输入连接到 50 欧姆单端时钟源。可使用板载 LMK04828 生成必需的 JESD204B 时钟。通过板载 USB 连接和 GUI 提供寄存器访问。

特性
  • 单个 1.8V 电源,可简化电源要求
  • 具有 1/2/4 分频器的灵活输入时钟缓冲器,可简化时钟
  • 片上抖动,可提高 SFDR
  • JESD204B 数据接口,可简化数字接口,兼容高达 3.2Gbps 的通道速率
  • 支持子类 0、1、2,以实现同步性和兼容性
  • 与 12/14b 和双/四通道器件之间引脚兼容

软件开发

固件 下载
JESD204 Rapid Design IP for FPGAs connected to TI high-speed data converters
TI-JESD204-IP JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计,可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时,可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路,对其进行定制,以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后,TI 将会通过安全的下载链接提供该 IP。

JESD204 快速设计 IP 支持以下 FPGA 系列:

  • Xilinx® Virtex™ UltraScale™ 和 UltraScale+™
  • Xilinx Kintex™ UltraScale 和 UltraScale+
  • Xilinx Zynq™ UltraScale+ 和 Zynq UltraScale+ (Auto)
  • Xilinx Artix™ 7 和 Artix 7 (Auto)
  • Xilinx Virtex 7
  • Xilinx (...)
特性
  • 与 JEDEC JESD204a/b/c 协议兼容
  • 支持子类 1 确定性延迟和多器件同步
  • 支持的通道速率
    • 在 8b/10b 模式下高达 16.375Gbps
    • 在 64b/66b 模式下高达 20Gbps
  • 支持协议相关的所有错误检测和报告功能
  • 集成的传输层可将通道数据转换为样本(HD 模式不支持该功能)
  • 优化了 FPGA 中的逻辑和内存占用量,所释放的资源将可用于应用逻辑(并在可能的情况下获得尺寸更小/成本更低的 FPGA)
  • 新颖的设计特性,包括在与线路速率异步的时钟速率下导出数据

设计工具和仿真

仿真模型 下载
SBAM204.ZIP (79 KB) - IBIS Model
仿真工具 下载
PSPICE® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库,您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案,然后再进行布局和制造,可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中,您可以搜索 TI 器件、了解产品系列、打开测试台并对您的设计进行仿真,从而进一步分析选定的器件。您还可对多个 TI 器件进行联合仿真,以更好地展现您的系统。

除了一个完整的预加载模型库之外,您还可以在 PSPICE-FOR-TI 工具中轻松访问 TI 器件的全新技术资料。在您确认找到适合您应用的器件后,可访问 TI store 购买产品。 

借助 PSpice for TI,您可使用合适的工具来满足您在整个设计周期(从电路探索到设计开发和验证)的仿真需求。免费获取、轻松入门。立即下载 PSpice 设计和仿真套件,开始您的设计。

入门

  1. 申请使用 PSPICE-FOR-TI 仿真器
  2. 下载并安装
  3. 观看有关仿真入门的培训
特性
  • 利用 Cadence PSpice 技术
  • 带有一套数字模型的预装库可在最坏情形下进行时序分析
  • 动态更新确保您可以使用全新的器件型号
  • 针对仿真速度进行了优化,且不会降低精度
  • 支持对多个产品进行同步分析
  • 基于 OrCAD Capture 框架,提供对业界广泛使用的原理图捕获和仿真环境的访问权限
  • 可离线使用
  • 在各种工作条件和器件容许范围内验证设计,包括
    • 自动测量和后处理
    • Monte Carlo 分析
    • 最坏情形分析
    • 热分析

参考设计

参考设计 下载
用于高速 ADC 的高性能单端转差动有源接口
由 Dallas Logic Corporation 提供 此参考设计使用 ADC34J22 12b 50Msps JESD204B 数据转换器和 THS4541 全差动放大器,用以展示如何设计适用于高速 ADC 的高性能有源接口。  此类电路可用于传感器前端、电机控制以及测试和测量应用。  可展示电路模型和设计公式的推算结果,以及 PCB 上的实际实施情况。  可提供上述实施情况的结果,以便展示与无源交流耦合变压器接口相比极其相似的性能。
document-generic 原理图 document-generic 用户指南

CAD/CAE 符号

封装 引脚 下载
VQFN (RGZ) 48 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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支持与培训

可获得 TI E2E™ 论坛的工程师技术支持

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