DAC38RF82 单通道 8 位 9GSPS 或双通道 14 位 6.66GSPS
产品详细信息
参数
封装|引脚|尺寸
特性
- 具有多模式运行方式的 14 位分辨率、9GSPS DAC
- 16 位、双通道数据模式
- 最大输入速率：2.5GSPS
- 宽带数字上变频器
- 插值：1、2、4、6、8、10、12、16、18、20、24x
- 12 位、双通道数据模式
- 最大输入速率：3.33GSPS
- 宽带数字上变频器
- 插值：1、2、24x
- 8 位、单通道数据模式
- 最大输入速率：9GSPS
- 16 位、双通道数据模式
- JESD204B 接口
- 子类 1 支持多芯片同步
- 最大通道速率：12.5Gbps
- 差分输出
- 支持直流耦合
- 射频满量程输出功率（采用 2:1 平衡-非平衡变压器）：
2.14GHz 时为 3dBm
- 具有旁路功能的内部 PLL 和 VCO
- DAC38RF82：fC(VCO) = 5.9 或 8.9GHz
- DAC38RF89：fC(VCO) = 5 或 7.5GHz
- 电源：-1.8V、1.0V、1.8V
- 封装：10mm x 10mm BGA，间距为 0.8mm，
144 个焊球
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描述
DAC38RF82 和 DAC38RF89 是高性能的宽带宽型射频采样数模转换器 (DAC)，能够实现高达 3.33GSPS 的双通道输入数据速率或高达 9GSPS 的 8 位单通道运行状态。这些器件具有一个多达 8 通道的低功耗 JESD204B 接口，最大比特率为 12.5Gbps。
在双通道运行状态下，无插值时输入接口的数据速率高达 3.33GSPS（12 位分辨率）和 2.5GSPS（16 位分辨率）。当用作具有 2x 至 24x 插值模式的复合基带发送器时，DAC38RF82 或 DAC38RF89 可以合成具有 16 位输入分辨率的高达 2GHz 带宽的宽带信号和具有 12 位输入分辨率的 2.66GHz 带宽的宽带信号。
8 位模式允许以 9GSPS 的最大 DAC 采样率进行输入，并可合成 0 至 4.5GHz 的宽带信号。
可选的低抖动 PLL/VCO 通过允许使用频率较低的参考时钟来简化 DAC 时钟的生成。DAC38RF82 和 DAC38RF89 支持不同的 VCO 频率范围，如器件比较表 所示。
技术文档
| 类型 | 标题 | 下载最新的英文版本 | 发布 | |
|---|---|---|---|---|
| * | 数据表 | 具有 JESD204B 接口、片上 PLL 和宽带插值的 DAC38RF8x 双通道、差分输出、14 位、9GSPS、射频采样 DAC 数据表 (Rev. C) | 下载最新的英文版本 (Rev.D) | 2020年 6月 15日 |
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设计与开发
有关其他条款或所需资源，请点击下面的任何链接来查看详情页面。硬件开发
说明
特性
- 可对采样率高达 9GSPS 的 DAC38RF82/83/85/93 进行评估
- 支持针对各类 FMC 的高达 12.5Gbps 的 serdes 信令速率
- 集成低相位噪声、2 VCO 片上 PLL 可简化系统时钟生成。同时还支持外部时钟模式。
- 带有板载 2:1 阻抗的交流耦合、差动输出变压器可实现平衡至不平衡转换
- 方便易用的软件接口和数据模式生成工具
说明
TSW40RF82 评估模块 (EVM) 是一种双发双收 (2T2R) 射频采样收发器参考设计。该模块包含 DAC38RF82 双通道射频采样数模转换器 (DAC) 和 ADC32RF45 双通道射频采样模数转换器 (ADC)。
DAC38RF82 采样率高达 9GSPS，采用交流耦合，带有板载 2:1 阻抗变压器的差动输出，可实现平衡至不平衡转换。ADC32RF45 采样率高达 3GSPS。它可以选择在每个通道中使用双数字下变频器，或者通过旁路访问奈奎斯特全带宽。
TSW40RF82EVM 包括 LMK04828 时钟发生器，用于为 DAC PLL 提供参考信号，以及用于生成 JESD204B 协议所需的 SYSREF 信号。还包括 LMX2582 射频合成器，用于为 ADC 提供超低相位噪声时钟解决方案。
TSW40RF82EVM 仅使用直流/直流转换器，可为所需的电源轨提供无 LDO 的高效电源管理解决方案。该设计在符合 FMC 的标准宽度内适用，且与 TI 信号/采集卡解决方案 (TSW14J56) 以及许多 FPGA 开发套件相连。
特性
- 采用 JESD204B 接口的射频采样收发器
- 具有差动输出的 DAC38RF82 双路射频 DAC
- 具有旁路选项的 ADC32RF45 双路射频 ADC
- 无 LDO 的电源管理解决方案
- 板载时钟解决方案；四个不同的 ADC 时钟选项，其中包括 TX PLL 时钟输出
- 通过 FMC 连接器与 TSW14J56 或 FPGA 开发套件相连
软件开发
设计工具和仿真
参考设计
设计文件
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download TIDA-01435 BOM.pdf (96KB)
设计文件
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download TIDA-01215 BOM.pdf (257KB) -
download TIDA-01215 Assembly Drawing.pdf (114KB) -
download TIDA-01215 PCB.pdf (2454KB) -
download TIDA-01215 CAD Files.zip (2164KB) -
download TIDA-01215 Gerber.zip (978KB)
CAD/CAE 符号
| 封装 | 引脚 | 下载 |
|---|---|---|
| FCBGA (AAV) | 144 | 了解详情 |