固件
数据表
ADC12DJ5200RF
- ADC 内核：
- 12 位分辨率
- 单通道模式下的采样率高达 10.4 GSPS
- 双通道模式下的采样率高达 5.2 GSPS
- 性能规格：
- 本底噪声（-20 dBFS，VFS = 1VPP-DIFF）：
- 双通道模式：-151.8 dBFS/Hz
- 单通道模式：-154.4 dBFS/Hz
- ENOB（双通道，FIN = 2.4 GHz）：8.6 位
- 本底噪声（-20 dBFS，VFS = 1VPP-DIFF）：
- VCMI 为 0V 时的缓冲模拟输入：
- 模拟输入带宽 (-3dB)：8 GHz
- 可用输入频率范围：> 10 GHz
- 满量程输入电压（VFS，默认值）：0.8 VPP
- 无噪声孔径延迟 (tAD) 调节：
- 精确采样控制：19 fs 步长
- 简化同步和交错
- 温度和电压不变延迟
- 简便易用的同步特性：
- 自动 SYSREF 计时校准
- 样片标记时间戳
- JESD204C 串行数据接口：
- 最大通道速率：17.16 Gbps
- 支持 64b/66b 和 8b/10b 编码
- 8b/10b 模式兼容 JESD204B
- 可选数字下变频器 (DDC)：
- 4 倍、8 倍、16 倍和 32 倍复杂抽取
- 每个 DDC 均具有四个独立的 32 位 NCO
- 峰值射频输入功率 (Diff)：+26.5 dBm（+ 27.5 dBFS，560x 满量程功率）
- 可实现均衡的可编程 FIR 滤波器
- 功耗：4W
- 电源：1.1V/1.9V
ADC12DJ5200RF 器件是一款射频采样千兆采样模数转换器 (ADC)，可对从直流到 10GHz 以上的输入频率进行直接采样。 ADC12DJ5200RF 可配置为双通道 5.2GSPS ADC 或单通道 10.4GSPS ADC。支持高达 10GHz 的可用输入频率范围，可对频率捷变系统的 L、S、C 和 X 频带进行直接射频采样。
ADC12DJ5200RF 使用具有多达 16 个串行通道的高速 JESD204C 输出接口，支持高达 17.16Gbps 的线路速率。通过 JESD204C 子类 1 支持确定性延迟和多器件同步。JESD204C 接口可进行配置，对线路速率和通道数进行权衡。支持 8b/10b 和 64b/66b 数据编码方案。64b/66b 编码支持前向纠错 (FEC)，可改进误码率。接口向后兼容 JESD204B 接收器。
无噪声孔径延迟调节和 SYSREF 窗口等创新的同步特性可简化多通道应用的系统设计。提供可选的数字下变频器 (DDC)，以便将数字信号频谱下变频到基带信号并降低接口速率。可编程 FIR 滤波器可实现片上均衡。
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| 证书 | ADC12DJ5200RFEVM EU Declaration of Conformity (DoC) (Rev. B) | 2021年 3月 9日 | ||||
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设计和开发
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支持的产品和硬件
产品
高速 DAC (> 10MSPS)
发送器
接收器
高速 ADC (≥10MSPS)
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硬件开发
评估板
接口适配器
软件
支持软件
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支持的产品和硬件
产品
接收器
高速 ADC (≥10MSPS)
射频采样收发器
设计工具
SLVRBH0 — ADC12DJ5200RF-EVM Assembly Package
支持的产品和硬件
模拟工具
PSPICE-FOR-TI — 适用于 TI 设计和模拟工具的 PSpice®
PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。
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参考设计
TIDA-010128 — 适用于 12 位数字转换器的可扩展 20.8GSPS 参考设计
此参考设计介绍采用时序交错配置射频采样模数转换器 (ADC) 的 20.8GSPS 采样系统。时序交错法是一种经实践检验可提高采样率的传统方法，然而，匹配个别 ADC 失调电压、增益和采样时间不匹配是实现性能的关键。随着采样时钟频率的增加，交错复杂性也随之增加。ADC 之间的相位匹配是实现更出色的 SFDR 和 ENOB 的关键规格之一。本参考设计通过采用简化 20.8GSPS 交错实施的 19fs 精确相位控制措施，在 ADC12DJ5200RF 上应用了无噪声孔径延迟调节功能。本参考设计基于符合 12 位系统性能要求的 LMK04828 和 LMX2594，采用了板载低噪声 (...)
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TIDA-01028 — 适用于高速示波器和宽带数字转换器的 12.8-GSPS 模拟前端参考设计
此参考设计提供了一个用于实现 12.8GSPS 采样率的交错射频采样模数转换器 (ADC) 的实用示例。这可通过对两个射频采样 ADC 进行时序交错来实现。交错需要在 ADC 之间进行相移，此参考设计通过 ADC12DJ3200 的无噪声孔径延迟调节（tAD 调节）功能来实现相移。此功能还可用于最大限度地减少交错 ADC 常见的失配问题：最大程度地提升 SNR、ENOB 和 SFDR 性能。此参考设计还采用了支持 JESD204B 的低相位噪声时钟树，该时钟树通过 LMX2594 宽带 PLL、LMK04828 合成器以及抖动清除器来实现。
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| 封装 | 引脚数 | 下载 |
|---|---|---|
| FCCSP (AAV) | 144 | 了解详情 |
| FCCSP (ZEG) | 144 | 了解详情 |
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