我们品类齐全的时钟缓冲器产品系列具有低附加抖动性能、低输出偏斜和宽工作温度范围，适用于 LVCMOS、LVDS、LVPECL 和 HCSL 等业界通用的输出格式。这些缓冲器经过优化，可用于各种以性能为导向的成本敏感型应用。
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技术资源
应用手册
How to Apply 1.8-V Signals to 3.3-V CDCLVC11xx Fanout Clock Buffer
了解 CDCLVC11xx 系列低抖动 LVCMOS 扇出缓冲器如何通过实施外部 RC 网络支持电压电平高达 1.8V 的输入信号。
应用手册
AC Coupling Between Differential LVPECL, LVDS, HSTL and CML (Rev. C)
请参阅此应用报告，了解用于在不同逻辑电平之间进行连接的交流耦合技术，尤其是 LVPECL、LVDS、HSTL 和 CML。
应用手册
Clocking Design Guidelines: Unused Pins
这些指南可作为器件数据表的补充，提供有关未使用器件引脚的详细信息。