主页 时钟和计时 时钟缓冲器

时钟和计时

使用我们的时钟缓冲器简化您的时钟树设计

具有低附加抖动和偏斜的器件，可最大限度地降低系统复杂性

我们广泛的时钟缓冲器产品系列具有低附加抖动性能、输出偏斜和高工作温度范围。这些缓冲器已针对多种以性能为导向和成本敏感型的应用进行了优化。     

单端缓冲器

使用我们易于使用的单端缓冲器优化您的设计并生成 LVCMOS 时钟源的多个副本。这些缓冲器支持高达 350MHz 的频率，具有 100fs RMS 的附加抖动和 1.5V 至 3.3V 的电源。

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差分缓冲器

使用我们的差分缓冲器为 LVDS、LVPECL、HCSL 和 CML 生成多个输出频率。这些缓冲器支持高达 3.2GHz 的频率，具有 100fs RMS（典型值）的附加抖动和 2.5V 至 3.3V 的电源。

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可配置缓冲器

使用我们的可配置（引脚可编程）时钟缓冲器为一系列协议生成多个输出频率。这些缓冲器支持多种输入和输出格式，并具有低于 30fs RMS 的附加抖动。

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专用缓冲器

利用我们具有更低附加抖动的专用缓冲器产品系列优化工业和存储器应用中的系统设计，包括零延迟缓冲器、DDR 内存缓冲器和分频缓冲器。

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精选时钟缓冲器

LMK1C1104

具有 4 个 LVCMOS 输出、支持 1.8/2.5/3.3V 电源电压、附加抖动低于 50fs (RMS) 且向后兼容 CDCLVC1104 的输出缓冲器

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CDCLVD1204

具有四个 LVDS 输出、低于 300fs 的附加抖动并支持高达 800MHz 时钟频率的扇出缓冲器

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LMK00301

具有 10 个输出、低于 30fs 的超低附加抖动并支持高达 3GHz 输出频率的引脚可编程缓冲器

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CDCVF2505

由于集成 PLL 具有用于补偿延迟和重新调节信号的反馈环路，因此可用作零延迟缓冲器

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精选技术文档

How to supply 1.8V signals to 3.3V CDCLVC11xx

了解 CDCLVC11xx 系列低抖动 LVCMOS 扇出缓冲器如何通过实施外部 RC 网络支持电压电平高达 1.8V 的输入信号。

下载 (PDF, 518KB)

AC Coupling Between Differential LVPECL, LVDS, HSTL and CML (Rev. C)

请参阅此应用报告，以了解用于在不同逻辑电平之间进行连接的交流耦合技术，尤其是 LVPECL、LVDS、HSTL 和 CML。

下载 (PDF, 417KB)

Clocking Design Guidelines: Unused Pins

请将这些指南用作对器件数据表的补充，以了解有关未使用的器件引脚的详细信息。

下载 (PDF, 158KB)

其他技术资源

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时钟缓冲器参考设计

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