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ZHCSQH8A September 2025 – October 2025 TCAN5102-Q1

ADVANCE INFORMATION

请参考 PDF 数据表获取器件具体的封装图。

图 7-88 显示了 UART_FIFO_CTRL 寄存器，表 7-129 中对此进行了介绍。

返回到汇总表。

用于使能 FIFO 或清除 FIFO 内容的 FIFO 控制字段。

图 7-88 UART_FIFO_CTRL 寄存器

表 7-129 UART_FIFO_CTRL 寄存器字段说明

位	字段	类型	复位	说明
7-6	RX_TRG	R/WP	0h	设置 RX FIFO 的触发级别 0h = RX FIFO 中有 1 字节 1h = RX FIFO 中有 4 字节 2h =（最大大小）- RX FIFO 中有 16 字节 3h =（最大大小）- RX FIFO 中有 8 字节
5-4	TX_TRG	R/WP	0h	设置 TX FIFO 中空闲空间数的触发级别 0h = 16 字节空闲 1h = 32 字节空闲 2h =（最大大小）- 16 字节空闲 3h =（最大大小）- 8 字节空闲
3	RSVD	R	0h
2	CLR_TX	RH/W1S	0h	清除发送 FIFO 的内容。清除完成后，硬件将该位复位为 0。 0h = 不执行任何操作 1h = 清除发送 FIFO
1	CLR_RX	RH/W1S	0h	清除接收 FIFO 的内容。清除完成后，硬件将该位复位为 0。 0h = 不执行任何操作 1h = 清除接收 FIFO
0	FIFO_EN	R/WP	1h	使能 TX FIFO 和 RX FIFO 0h = 禁用发送和接收 FIFO 1h = 使能发送和接收 FIFO