ZHCSQC0C June   2022  – April 2025 ADC12DJ5200-SP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  电气特性：直流规格
    6. 5.6  电气特性：功耗
    7. 5.7  电气特性：交流规格（双通道模式）
    8. 5.8  电气特性：交流规格（单通道模式）
    9. 5.9  时序要求
    10. 5.10 开关特性
    11. 5.11 典型特性
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1  器件比较
      2. 6.3.2  模拟输入
        1. 6.3.2.1 模拟输入保护
        2. 6.3.2.2 满量程电压 (VFS) 调整
        3. 6.3.2.3 模拟输入失调电压调整
      3. 6.3.3  ADC 内核
        1. 6.3.3.1 ADC 工作原理
        2. 6.3.3.2 ADC 内核校准
        3. 6.3.3.3 模拟基准电压
        4. 6.3.3.4 ADC 超范围检测
        5. 6.3.3.5 误码率 (CER)
      4. 6.3.4  温度监测二极管
      5. 6.3.5  时间戳
      6. 6.3.6  时钟
        1. 6.3.6.1 无噪声孔径延迟调节（tAD 调节）
        2. 6.3.6.2 孔径延迟斜坡控制 (TAD_RAMP)
        3. 6.3.6.3 用于多器件同步和确定性延迟的 SYSREF 采集
          1. 6.3.6.3.1 SYSREF 位置检测器和采样位置选择（SYSREF 窗口）
          2. 6.3.6.3.2 自动 SYSREF 校准
      7. 6.3.7  可编程 FIR 滤波器 (PFIR)
        1. 6.3.7.1 双通道均衡
        2. 6.3.7.2 单通道均衡
        3. 6.3.7.3 时变滤波器
      8. 6.3.8  数字下变频器 (DDC)
        1. 6.3.8.1 舍入和饱和
        2. 6.3.8.2 数控振荡器和复频混频器
          1. 6.3.8.2.1 NCO 快速跳频 (FFH)
          2. 6.3.8.2.2 NCO 选择
          3. 6.3.8.2.3 基本 NCO 频率设置模式
          4. 6.3.8.2.4 合理 NCO 频率设置模式
          5. 6.3.8.2.5 NCO 相位偏移设置
          6. 6.3.8.2.6 NCO 相位同步
        3. 6.3.8.3 抽取滤波器
        4. 6.3.8.4 输出数据格式
        5. 6.3.8.5 抽取设置
          1. 6.3.8.5.1 抽取因子
          2. 6.3.8.5.2 DDC 增益提升
      9. 6.3.9  JESD204C 接口
        1. 6.3.9.1 传输层
        2. 6.3.9.2 扰频器
        3. 6.3.9.3 链路层
        4. 6.3.9.4 8B/10B 链路层
          1. 6.3.9.4.1 数据编码 (8B/10B)
          2. 6.3.9.4.2 多帧和本地多帧时钟 (LMFC)
          3. 6.3.9.4.3 代码组同步 (CGS)
          4. 6.3.9.4.4 初始通道对齐序列 (ILAS)
          5. 6.3.9.4.5 帧和多帧监控
        5. 6.3.9.5 64B/66B 链路层
          1. 6.3.9.5.1 64B/66B 编码
          2. 6.3.9.5.2 多块、扩展多块和本地扩展多块时钟 (LEMC)
          3. 6.3.9.5.3 使用同步报头的模块、多块和扩展多块对齐
            1. 6.3.9.5.3.1 循环冗余校验 (CRC) 模式
            2. 6.3.9.5.3.2 正向纠错 (FEC) 模式
          4. 6.3.9.5.4 初始通道对齐
          5. 6.3.9.5.5 模块、多块和扩展多块对齐监控
        6. 6.3.9.6 物理层
          1. 6.3.9.6.1 串行器/解串器预加重功能
        7. 6.3.9.7 JESD204C 启用
        8. 6.3.9.8 多器件同步和确定性延迟
        9. 6.3.9.9 在子类 0 系统中运行
      10. 6.3.10 报警监控
        1. 6.3.10.1 时钟翻转检测
        2. 6.3.10.2 FIFO 翻转检测
    4. 6.4 器件功能模式
      1. 6.4.1 双通道模式
      2. 6.4.2 单通道模式（DES 模式）
      3. 6.4.3 双输入单通道模式（双 DES 模式）
      4. 6.4.4 JESD204C 模式
        1. 6.4.4.1 JESD204C 工作模式表
        2. 6.4.4.2 JESD204C 模式（续）
        3. 6.4.4.3 JESD204C 传输层数据格式
        4. 6.4.4.4 64B/66B 同步报头流配置
      5. 6.4.5 断电模式
      6. 6.4.6 测试模式
        1. 6.4.6.1 串行器测试模式详细信息
        2. 6.4.6.2 PRBS 测试模式
        3. 6.4.6.3 时钟图形模式
        4. 6.4.6.4 斜坡测试模式
        5. 6.4.6.5 近程和远程传输测试模式
          1. 6.4.6.5.1 近程传输测试模式
        6. 6.4.6.6 D21.5 测试模式
        7. 6.4.6.7 K28.5 测试模式
        8. 6.4.6.8 重复 ILA 测试模式
        9. 6.4.6.9 修改的 RPAT 测试模式
      7. 6.4.7 校准模式和修整
        1. 6.4.7.1 前台校准模式
        2. 6.4.7.2 后台校准模式
        3. 6.4.7.3 低功耗后台校准 (LPBG) 模式
      8. 6.4.8 偏移校准
      9. 6.4.9 修整
    5. 6.5 编程
      1. 6.5.1 使用串行接口
        1. 6.5.1.1 SCS
        2. 6.5.1.2 SCLK
        3. 6.5.1.3 SDI
        4. 6.5.1.4 SDO
        5. 6.5.1.5 流模式
    6. 6.6 SPI 寄存器映射
  8. 7 应用信息免责声明
    1. 7.1 应用信息
    2. 7.2 典型应用
      1. 7.2.1 宽带射频采样接收器
        1. 7.2.1.1 设计要求
          1. 7.2.1.1.1 输入信号路径
          2. 7.2.1.1.2 时钟
        2. 7.2.1.2 详细设计过程
          1. 7.2.1.2.1 计算交流耦合电容的值
      2. 7.2.2 可重新配置的双通道 5 GSPS 或单通道 10 Gsps 示波器
        1. 7.2.2.1 设计要求
          1. 7.2.2.1.1 输入信号路径
          2. 7.2.2.1.2 时钟
          3. 7.2.2.1.3 ADC12DJ5200-SP 示波器应用
    3. 7.3 初始化设置
    4. 7.4 电源相关建议
      1. 7.4.1 电源时序
    5. 7.5 布局
      1. 7.5.1 布局指南
      2. 7.5.2 布局示例
  9. 8 器件和文档支持
    1. 8.1 器件支持
      1. 8.1.1 开发支持
    2. 8.2 文档支持
      1. 8.2.1 相关文档
    3. 8.3 接收文档更新通知
    4. 8.4 支持资源
    5. 8.5 商标
    6. 8.6 静电放电警告
    7. 8.7 术语表
  10. 9 修订历史记录
  11. 10机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

5.5 电气特性：直流规格

典型值为 TJ = 50°C、VA19 = 1.9V、VA11 = 1.1V、VD11 = 1.1V、默认全量程电压、fIN = 347MHz、AIN = –1dBFS、fCLK = 5.12GHz、滤波 1-VPP 正弦波时钟、JMODE = 1，抖动启用（采用默认设置）、VA11、VD11 和 VS11 噪声抑制 ON (EN_VA11_NOISE_SUPPR = EN_VD11_NOISE_SUPPR = EN_VS11_NOISE_SUPPR = 1)，和后台校准（除非另有说明）；最小值和最大值均为标称电源电压，超出了建议的工作条件表中的工作结温范围。
参数 测试条件 最小值 典型值 最大值 单位
直流精度
分辨率 无代码丢失时的分辨率 12 位
DNL 微分非线性 距离理想步长的最大正偏移 0.14 LSB
距离理想步长的最大负偏移 -0.13
INL 积分非线性 距离理想传递函数的最大正偏移 2.0 LSB
距离理想传递函数的最大负偏移 -2.4 LSB
模拟输入（INA+、INA–、INB+、INB–）
VOFF 偏移误差 CAL_OS = 0 ±0.50 mV
CAL_OS = 1 ±0.15 mV
VOFF_ADJ 输入失调电压调节范围 可用的偏移校正范围（请参见 OS_CAL 或 OADJ_x_INx） ±50 mV
VOFF_DRIFT 偏移漂移 仅限标称温度下的前台校准 18 µV/°C
每个温度下的前台校准 -5.5
每个温度下的前台校准和 FGOS 校准 0
VFS 模拟差分输入满量程 默认满量程电压 (FS_RANGE_A = FS_RANGE_B = 0xA000) 750 825 910 mVPP
最大满量程电压 (FS_RANGE_A = FS_RANGE_B = 0xFFFF) 975 1060
最小满量程电压 (FS_RANGE_A = FS_RANGE_B = 0x2000) 500 560
VFS_DRIFT 模拟差分输入满量程范围漂移 默认 FS_RANGE_A 和 FS_RANGE_B 设置，每个温度下的前台校准，由 50Ω 源驱动的输入，包括 RIN 漂移的影响 0.033 %/°C
VFS_MATCH 模拟差分输入满量程范围匹配 INA± 和 INB± 之间的匹配，默认设置，双通道模式 0.625%
RIN AGND 单端输入电阻 每个输入引脚端接至 AGND，在 TA = 25°C 时测量 48 50 52 Ω
RIN_TEMPCO 输入终端线性温度系数 14.7 mΩ/°C
CIN 单端输入电容 在直流时测量单通道模式 0.4 pF
在直流时测量双通道模式 0.4
温度二极管特性 (TDIODE+、TDIODE-)
ΔVBE 温度二极管电压斜率 100µA 的强制正向电流。失调电压（在 0°C 时约为 0.792V）随工艺不同而变化，必须针对每个器件进行测量。必须在器件未上电或 PD 引脚置位的情况下完成失调电压测量，以更大限度地减少器件自发热。 -1.65 mV/°C
带隙电压输出 (BG)
VBG 基准输出电压 IL ≤ 100µA 1.1 V
VBG_DRIFT 基准输出温度漂移 IL ≤ 100µA -64 µV/°C
时钟输入（CLK+、CLK–、SYSREF+、SYSREF–、TMSTP+、TMSTP–）
ZT 内部端接 DEVCLK_LVPECL_EN = 0、SYSREF_LVPECL_EN = 0 且 TMSTP_LVPECL_EN = 0 时的差分终端 100 Ω
在 DEVCLK_LVPECL_EN = 0、SYSREF_LVPECL_EN = 0、TMSTP_LVPECL_EN = 0 时单端终端至 GND （每引脚） 50
VCM 输入共模电压自偏置 交流耦合时 CLK± 的自偏置共模电压（DEVCLK_LVPECL_EN 必须设置为 0) 0.3 V
在交流耦合时（SYSREF_LVPECL_EN 必须设置为 0）且接收器启用 (SYSREF_RECV_EN = 1) 时，SYSREF± 的自偏置共模电压 0.28
在交流耦合（SYSREF_LVPECL_EN 必须设置为 0）且接收器被禁用 (SYSREF_RECV_EN = 0) 时，SYSREF± 的自偏置共模电压 0.28
CL_DIFF 差分输入电容 正负差分输入引脚之间 0.04 pF
CL_SE 单端输入电容 每个输入端接地 0.5 pF
串行器/解串器输出（DA[7:0]+、DA[7:0]–、DB[7:0]+、DB[7:0]–）
VOD 差分输出电压，峰峰值 100-Ω 负载 540 600 650 mVPP-DIFF
VCM 输出共模电压 交流耦合 VD11 / 2 V
ZDIFF 差分输出阻抗 100 Ω
CMOS 接口：SCLK、SDI、SDO、SCS、PD、NCOA0、NCOA1、NCOB0、NCOB1、CALSTAT、CALTRIG、ORA0、ORA1、ORB0、ORB1、SYNCSE
VIH 高电平输入电压 所需输入电压 0.7 V
VIL 低电平输入电压 所需输入电压 0.45 V
IIH 高电平输入电流 40 µA
IIL 低电平输入电流 -40 µA
CI 输入电容 3.4 pF
VOH 高电平输出电压 ILOAD = -400µA 1.65 V
VOL 低电平输出电压 ILOAD = 400µA 150 mV