ZHCSQC0C June   2022  – April 2025 ADC12DJ5200-SP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  电气特性：直流规格
    6. 5.6  电气特性：功耗
    7. 5.7  电气特性：交流规格（双通道模式）
    8. 5.8  电气特性：交流规格（单通道模式）
    9. 5.9  时序要求
    10. 5.10 开关特性
    11. 5.11 典型特性
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1  器件比较
      2. 6.3.2  模拟输入
        1. 6.3.2.1 模拟输入保护
        2. 6.3.2.2 满量程电压 (VFS) 调整
        3. 6.3.2.3 模拟输入失调电压调整
      3. 6.3.3  ADC 内核
        1. 6.3.3.1 ADC 工作原理
        2. 6.3.3.2 ADC 内核校准
        3. 6.3.3.3 模拟基准电压
        4. 6.3.3.4 ADC 超范围检测
        5. 6.3.3.5 误码率 (CER)
      4. 6.3.4  温度监测二极管
      5. 6.3.5  时间戳
      6. 6.3.6  时钟
        1. 6.3.6.1 无噪声孔径延迟调节（tAD 调节）
        2. 6.3.6.2 孔径延迟斜坡控制 (TAD_RAMP)
        3. 6.3.6.3 用于多器件同步和确定性延迟的 SYSREF 采集
          1. 6.3.6.3.1 SYSREF 位置检测器和采样位置选择（SYSREF 窗口）
          2. 6.3.6.3.2 自动 SYSREF 校准
      7. 6.3.7  可编程 FIR 滤波器 (PFIR)
        1. 6.3.7.1 双通道均衡
        2. 6.3.7.2 单通道均衡
        3. 6.3.7.3 时变滤波器
      8. 6.3.8  数字下变频器 (DDC)
        1. 6.3.8.1 舍入和饱和
        2. 6.3.8.2 数控振荡器和复频混频器
          1. 6.3.8.2.1 NCO 快速跳频 (FFH)
          2. 6.3.8.2.2 NCO 选择
          3. 6.3.8.2.3 基本 NCO 频率设置模式
          4. 6.3.8.2.4 合理 NCO 频率设置模式
          5. 6.3.8.2.5 NCO 相位偏移设置
          6. 6.3.8.2.6 NCO 相位同步
        3. 6.3.8.3 抽取滤波器
        4. 6.3.8.4 输出数据格式
        5. 6.3.8.5 抽取设置
          1. 6.3.8.5.1 抽取因子
          2. 6.3.8.5.2 DDC 增益提升
      9. 6.3.9  JESD204C 接口
        1. 6.3.9.1 传输层
        2. 6.3.9.2 扰频器
        3. 6.3.9.3 链路层
        4. 6.3.9.4 8B/10B 链路层
          1. 6.3.9.4.1 数据编码 (8B/10B)
          2. 6.3.9.4.2 多帧和本地多帧时钟 (LMFC)
          3. 6.3.9.4.3 代码组同步 (CGS)
          4. 6.3.9.4.4 初始通道对齐序列 (ILAS)
          5. 6.3.9.4.5 帧和多帧监控
        5. 6.3.9.5 64B/66B 链路层
          1. 6.3.9.5.1 64B/66B 编码
          2. 6.3.9.5.2 多块、扩展多块和本地扩展多块时钟 (LEMC)
          3. 6.3.9.5.3 使用同步报头的模块、多块和扩展多块对齐
            1. 6.3.9.5.3.1 循环冗余校验 (CRC) 模式
            2. 6.3.9.5.3.2 正向纠错 (FEC) 模式
          4. 6.3.9.5.4 初始通道对齐
          5. 6.3.9.5.5 模块、多块和扩展多块对齐监控
        6. 6.3.9.6 物理层
          1. 6.3.9.6.1 串行器/解串器预加重功能
        7. 6.3.9.7 JESD204C 启用
        8. 6.3.9.8 多器件同步和确定性延迟
        9. 6.3.9.9 在子类 0 系统中运行
      10. 6.3.10 报警监控
        1. 6.3.10.1 时钟翻转检测
        2. 6.3.10.2 FIFO 翻转检测
    4. 6.4 器件功能模式
      1. 6.4.1 双通道模式
      2. 6.4.2 单通道模式（DES 模式）
      3. 6.4.3 双输入单通道模式（双 DES 模式）
      4. 6.4.4 JESD204C 模式
        1. 6.4.4.1 JESD204C 工作模式表
        2. 6.4.4.2 JESD204C 模式（续）
        3. 6.4.4.3 JESD204C 传输层数据格式
        4. 6.4.4.4 64B/66B 同步报头流配置
      5. 6.4.5 断电模式
      6. 6.4.6 测试模式
        1. 6.4.6.1 串行器测试模式详细信息
        2. 6.4.6.2 PRBS 测试模式
        3. 6.4.6.3 时钟图形模式
        4. 6.4.6.4 斜坡测试模式
        5. 6.4.6.5 近程和远程传输测试模式
          1. 6.4.6.5.1 近程传输测试模式
        6. 6.4.6.6 D21.5 测试模式
        7. 6.4.6.7 K28.5 测试模式
        8. 6.4.6.8 重复 ILA 测试模式
        9. 6.4.6.9 修改的 RPAT 测试模式
      7. 6.4.7 校准模式和修整
        1. 6.4.7.1 前台校准模式
        2. 6.4.7.2 后台校准模式
        3. 6.4.7.3 低功耗后台校准 (LPBG) 模式
      8. 6.4.8 偏移校准
      9. 6.4.9 修整
    5. 6.5 编程
      1. 6.5.1 使用串行接口
        1. 6.5.1.1 SCS
        2. 6.5.1.2 SCLK
        3. 6.5.1.3 SDI
        4. 6.5.1.4 SDO
        5. 6.5.1.5 流模式
    6. 6.6 SPI 寄存器映射
  8. 7 应用信息免责声明
    1. 7.1 应用信息
    2. 7.2 典型应用
      1. 7.2.1 宽带射频采样接收器
        1. 7.2.1.1 设计要求
          1. 7.2.1.1.1 输入信号路径
          2. 7.2.1.1.2 时钟
        2. 7.2.1.2 详细设计过程
          1. 7.2.1.2.1 计算交流耦合电容的值
      2. 7.2.2 可重新配置的双通道 5 GSPS 或单通道 10 Gsps 示波器
        1. 7.2.2.1 设计要求
          1. 7.2.2.1.1 输入信号路径
          2. 7.2.2.1.2 时钟
          3. 7.2.2.1.3 ADC12DJ5200-SP 示波器应用
    3. 7.3 初始化设置
    4. 7.4 电源相关建议
      1. 7.4.1 电源时序
    5. 7.5 布局
      1. 7.5.1 布局指南
      2. 7.5.2 布局示例
  9. 8 器件和文档支持
    1. 8.1 器件支持
      1. 8.1.1 开发支持
    2. 8.2 文档支持
      1. 8.2.1 相关文档
    3. 8.3 接收文档更新通知
    4. 8.4 支持资源
    5. 8.5 商标
    6. 8.6 静电放电警告
    7. 8.7 术语表
  10. 9 修订历史记录
  11. 10机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

4 引脚配置和功能

ADC12DJ5200-SP ALR 封装、144 焊球倒装芯片 BGA（顶视图）图 4-1 ALR 封装、144 焊球倒装芯片 BGA
（顶视图）
表 4-1 引脚功能
引脚 类型 说明
名称 编号
AGND A1、A2、A3、A6、A7、B2、B3、B4、B5、B6、B7、C6、D1、D6、E1、E6、F2、F3、F6、G2、G3、G6、H1、H6、J1、J6、L2、L3、L4、L5、L6、L7、M1、M2、M3、M6、M7 — 模拟电源接地。将 AGND 和 DGND 连接到电路板上的公共接地层 (GND)。
BG C3 O 带隙电压输出。如建议运行条件 表中所指定，该引脚只能提供小电流并驱动有限的电容负载。该引脚可以在不使用时保持断开。
CALSTAT F7 O 前台校准状态输出或器件警报输出。功能通过 CAL_STATUS_SEL 进行编程。该引脚可以在不使用时保持断开。
CALTRIG E7 I 前台校准触发器输入。只有在 CAL_TRIG_EN 中选择硬件校准触发时才使用此引脚，否则将使用 CAL_SOFT_TRIG 执行软件触发。不使用时将此引脚连接到 GND。
CLK+ F1 I 器件（采样）时钟正输入。强烈建议将时钟信号交流耦合至这个输入以获得最佳性能。在单通道模式下，在上升沿和下降沿对模拟输入信号进行采样。在双通道模式下，在上升沿对模拟信号进行采样。该差分输入具有内部未修整 100Ω 差分终端，并且只要将 DEVCLK_LVPECL_EN 设置为 0，该差分输入就会自偏置为理想输入共模电压。
CLK– G1 I 器件（采样）时钟负输入。TI 强烈建议使用交流耦合以获得最佳性能。
DA0+ E12 O 用于通道 A、通道 0 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA0– F12 O 用于通道 A、通道 0 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA1+ C12 O 用于通道 A、通道 1 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA1– D12 O 用于通道 A、通道 1 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA2+ A10 O 用于通道 A、通道 2 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA2– A11 O 用于通道 A、通道 2 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA3+ A8 O 用于通道 A、通道 3 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA3– A9 O 用于通道 A、通道 3 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA4+ E11 O 用于通道 A、通道 4 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA4– F11 O 用于通道 A、通道 4 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA5+ C11 O 用于通道 A、通道 5 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA5– D11 O 用于通道 A、通道 5 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA6+ B10 O 用于通道 A、通道 6 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接，或者使用 0Ω 至 1MΩ 电阻连接到 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。该引脚可以在不使用时保持断开。
DA6– B11 O 用于通道 A、通道 6 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA7+ B8 O 用于通道 A、通道 7 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DA7– B9 O 用于通道 A、通道 7 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB0+ H12 O 用于通道 B、通道 0 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB0– G12 O 用于通道 B、通道 0 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB1+ K12 O 用于通道 B、通道 1 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开。
DB1– J12 O 用于通道 B、通道 1 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB2+ M10 O 用于通道 B、通道 2 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB2– M11 O 用于通道 B、通道 2 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB3+ M8 O 用于通道 B、通道 3 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB3– M9 O 用于通道 B、通道 3 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开。
DB4+ H11 O 用于通道 B、通道 4 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB4– G11 O 用于通道 B、通道 4 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB5+ K11 O 用于通道 B、通道 5 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB5– J11 O 用于通道 B、通道 5 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB6+ L10 O 用于通道 B、通道 6 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB6– L11 O 用于通道 B、通道 6 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB7+ L8 O 用于通道 B、通道 7 的高速串行化数据输出，正连接。该差分输出必须采用交流耦合，并且必须始终在接收器上使用 100Ω 差分终端进行端接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DB7– L9 O 用于通道 B、通道 7 的高速串行化数据输出，负连接。该引脚可以在不使用时保持断开，或使用 0Ω 至 1MΩ 电阻器将其连接至介于 GND (0V) 和 VD11 (1.1V) 之间的任何电压电平。
DGND A12、B12、D9、D10、F9、F10、G9、G10、J9、J10、L12、M12 — 数字电源接地。将 AGND 和 DGND 连接到电路板上的公共接地层 (GND)。
INA+ A4 I 通道 A 模拟输入正连接。为实现最佳性能，建议在单通道模式下使用 INA±。差分满量程输入电压由 FS_RANGE_A 寄存器确定（请参阅满量程电压（VFS） 调整 部分）。该输入通过 50Ω 终端电阻器端接至接地。输入共模电压通常设置为 0V (GND)，必须遵循建议运行条件 表中的建议。该引脚可以在不使用时保持断开。
INA- A5 I 通道 A 模拟输入负连接。为实现最佳性能，建议在单通道模式下使用 INA±。有关详细说明，请参阅 INA+ (pin A4)。该输入通过 50Ω 终端电阻器端接至接地。该引脚可以在不使用时保持断开。
INB+ M4 I 通道 B 模拟输入正连接。为实现最佳性能，建议在单通道模式下使用 INA±。差分满量程输入电压由 FS_RANGE_B 寄存器确定（请参阅满量程电压（VFS） 调整 部分）。该输入通过 50Ω 终端电阻器端接至接地。输入共模电压通常必须设置为 0V (GND)，必须遵循建议运行条件 表中的建议。该引脚可以在不使用时保持断开。
INB– M5 I 通道 B 模拟输入负连接。为实现最佳性能，建议在单通道模式下使用 INA±。有关详细说明，请参阅 INB+。该输入通过 50Ω 终端电阻器端接至接地。该引脚可以在不使用时保持断开。
NCOA0 C7 I

用于 DDC A 的 NCO 选择控制的最低有效位 (LSB)。当使用复数输出 JMODE 时，NCOA0 和 NCOA1 从四个可选的 NCO 中选出一个 NCO 用于数字混合。其余未选择的 NCO 继续运行以保持相位一致性，可以通过更改 NCOA0 和 NCOA1（当 CMODE = 1 时）的值来交换。此引脚属于异步输入类型的引脚。有关更多信息，请参阅 NCO 快速跳频 (FFH) 和 NCO 选择部分。不使用时将此引脚连接到 GND。
NCOA1 D7 I 用于 DDC A 的 NCO 选择控制的 MSB。如果不使用该引脚，则将其连接至 GND。
NCOB0 K7 I

用于 DDC B 的 NCO 选择控制的最低有效位 (LSB)。当使用复数输出 JMODE 时，NCOB0 和 NCOB1 从四个可选的 NCO 中选出一个 NCO 用于数字混合。其余未选择的 NCO 继续运行以保持相位一致性，可以通过更改 NCOB0 和 NCOB1（当 CMODE = 1 时）的值来交换。此引脚属于异步输入类型的引脚。有关更多信息，请参阅 NCO 快速跳频 (FFH) 和 NCO 选择部分。不使用时将此引脚连接到 GND。
NCOB1 J7 I

用于 DDC B 的 NCO 选择控制的 MSB。如果不使用该引脚，则将其连接至 GND。
ORA0 C8 O 通道 A 的 OVR_T0 阈值快速超范围检测状态。当模拟输入超过 OVR_T0 中编程的阈值时，此状态指示器将变为高电平。最小脉冲持续时间由 OVR_N 设置。有关更多信息，请参阅 ADC 超范围检测部分。该引脚可以在不使用时保持断开。
ORA1 D8 O 通道 A 的 OVR_T1 阈值快速超范围检测状态。当模拟输入超过 OVR_T1 中编程的阈值时，此状态指示器将变为高电平。最小脉冲持续时间由 OVR_N 设置。有关更多信息，请参阅 ADC 超范围检测部分。该引脚可以在不使用时保持断开。
ORB0 K8 O 通道 B 的 OVR_T0 阈值快速超范围检测状态。当模拟输入超过 OVR_T0 中编程的阈值时，此状态指示器将变为高电平。最小脉冲持续时间由 OVR_N 设置。有关更多信息，请参阅 ADC 超范围检测部分。该引脚可以在不使用时保持断开。
ORB1 J8 O 通道 B 的 OVR_T1 阈值快速超范围检测状态。当模拟输入超过 OVR_T1 中编程的阈值时，此状态指示器将变为高电平。最小脉冲持续时间由 OVR_N 设置。有关更多信息，请参阅 ADC 超范围检测部分。该引脚可以在不使用时保持断开。
PD K6 I 当设置为高电平时，该引脚会禁用所有模拟电路和串行器输出，以进行温度二极管校准或在不使用器件时降低功耗。不使用时将此引脚连接到 GND。
SCLK F8 I 串行接口时钟。此引脚用作串行接口时钟输入，可为串行编程数据输入和输出提供时钟。使用串行接口部分更详细地介绍了串行接口。支持 1.1V 至 1.8V CMOS 电平。
SCS E8 I 串行接口芯片选择低电平有效输入。使用串行接口部分更详细地介绍了串行接口。支持 1.1V 至 1.8V CMOS 电平。该引脚到 VD11 有一个 82kΩ 上拉电阻器。
SDI G8 I 串口数据输入。使用串行接口部分更详细地介绍了串行接口。支持 1.1V 至 1.8V CMOS 电平。
SDO H8 O 串行接口数据输出。使用串行接口部分更详细地介绍了串行接口。该引脚在器件正常运行期间处于高阻抗状态。在串行接口读取操作期间，该引脚输出 1.9V CMOS 电平。该引脚可以在不使用时保持断开。
SYNCSE C2 I 单端 JESD204C SYNC 信号。此输入为低电平有效输入，当 SYNC_SEL 设置为 0 时，用于在 8B/10B 模式中初始化 JESD204C 串行链路。64B/66B 模式不使用 SYNC 信号进行初始化，但可用于 NCO 同步。当在 8B/10B 模式中切换为低电平时，此输入会启动代码组同步（请参阅代码组同步 (CGS) 部分）。代码组同步后，必须将此输入切换为高电平以启动初始通道对齐序列（请参阅初始通道对齐序列 (ILAS) 部分）。通过将 SYNC_SEL 设置为 1 并使用 TMSTP± 作为差分 SYNC 输入，可以改用差分 SYNC 信号。如果将差分 SYNC (TMSTP±) 用作 JESD204C SYNC 信号，则应将该引脚连接到 GND。
SYSREF+ K1 I SYSREF 正输入用于在 JESD204C 接口上实现同步和确定性延迟。该差分输入（SYSREF+ 至 SYSREF–）具有内部未修整的 100Ω 差分端接，当 SYSREF_LVPECL_EN 设置为 0 时，可以进行交流耦合。当 SYSREF_LVPECL_EN 设置为 0 时，该输入会自偏置。每个输入引脚（SYSREF+ 和 SYSREF–）上的终端改为 50Ω 接地，并且当 SYSREF_LVPECL_EN 设置为 1 时，可以进行直流耦合。当 SYSREF_LVPECL_EN 设置为 1 时，该输入不会自偏置，必须从外部偏置到建议运行条件 表中提供的输入共模电压范围。
SYSREF- L1 I SYSREF 负输入
TDIODE+ K2 I 温度二极管正（阳极）连接。可以将外部温度传感器连接到 TDIODE+ 和 TDIODE- 来监测器件的结温。该引脚可以在不使用时保持断开。
TDIODE– K3 I 温度二极管负（阴极）连接。该引脚可以在不使用时保持断开。
TMSTP+ B1 I 时间戳输入正连接或差分 JESD204C SYNC 正连接。当 TIMESTAMP_EN 设置为 1 时，该输入为时间戳输入，用于标记特定采样。当 SYNC_SEL 设置为 1 时，该差分输入用作 JESD204C SYNC 信号输入。此输入可同时用作时间戳和差分 SYNC 输入，从而允许使用时间戳机制来反馈 SYNC 信号。当用作 JESD204C SYNC 时，TMSTP±使用低电平有效的信号传输方式。有关更多使用信息，请参阅时间戳部分。必须将
TMSTP_RECV_EN 设置为 1 才能使用该输入。该差分输入（TMSTP+ 至 TMSTP–）具有内部未修整的 100Ω 差分终端，当 TMSTP_LVPECL_EN 设置为 0 时，可以进行交流耦合。每个输入引脚（TMSTP+ 和 TMSTP-）上的终端改为 50Ω 接地，并且当 TMSTP_LVPECL_EN 设置为 1 时，可以进行直流耦合。该引脚不会自偏置，因此对于交流和直流耦合配置，必须从外部偏置。当交流和直流耦合时，共模电压必须处于建议运行条件 表中提供的范围内。如果 SYNCSE 用于 JESD204C SYNC 且无需使用时间戳功能，则可以将此引脚保持断开并禁用 (TMSTP_RECV_EN = 0)。
TMSTP– C1 I 时间戳输入正连接或差分 JESD204C SYNC 负连接。如果 SYNCSE 用于 JESD204C SYNC 且无需使用时间戳功能，则可以将此引脚保持断开并禁用 (TMSTP_RECV_EN = 0)。
VA11 C5、D2、D3、D5、E5、F5、G5、H5、J2、J3、J5、K5 I 1.1V 模拟电源
VA19 C4、D4、E2、E3、E4、F4、G4、H2、H3、H4、J4、K4 I 1.9V 模拟电源
VD11 C9、C10、E9、E10、G7、H7、H9、H10、K9、K10 I 1.1V 数字电源