ZHCAB92A October   2020  – July 2021 AM2431 , AM2432 , AM2434 , AM6411 , AM6412 , AM6421 , AM6441 , AM6442

 

  1.   商标
  2. 1概述
    1. 1.1 支持的电路板设计
    2. 1.2 通用电路板布局指南
    3. 1.3 PCB 堆叠
    4. 1.4 旁路电容器
      1. 1.4.1 大容量旁路电容器
      2. 1.4.2 高速旁路电容器
      3. 1.4.3 返回电流旁路电容器
    5. 1.5 速度补偿
  3. 2DDR4 电路板设计和布局指南
    1. 2.1  DDR4 简介
    2. 2.2  支持的 DDR4 器件实现
    3. 2.3  DDR4 接口原理图
      1. 2.3.1 采用 16 位 SDRAM 器件的 DDR4 实现
      2. 2.3.2 采用 8 位 SDRAM 器件的 DDR4 实现
    4. 2.4  兼容的 JEDEC DDR4 器件
    5. 2.5  放置
    6. 2.6  DDR4 禁止区域
    7. 2.7  VPP
    8. 2.8  网类别
    9. 2.9  DDR4 信号终端
    10. 2.10 VREF 布线
    11. 2.11 VTT
    12. 2.12 POD 互连
    13. 2.13 CK 和 ADDR_CTRL 拓扑与布线指南
    14. 2.14 数据组拓扑与布线指南
    15. 2.15 CK 和 ADDR_CTRL 布线规格
      1. 2.15.1 CACLM - 时钟地址控制最大曼哈顿距离
      2. 2.15.2 CK 和 ADDR_CTRL 布线限值
    16. 2.16 数据组布线规格
      1. 2.16.1 DQLM - DQ 最大曼哈顿距离
      2. 2.16.2 数据组布线限值
    17. 2.17 位交换
      1. 2.17.1 数据位交换
      2. 2.17.2 地址和控制位交换
  4. 3LPDDR4 电路板设计和布局指南
    1. 3.1  LPDDR4 简介
    2. 3.2  支持的 LPDDR4 器件实现
    3. 3.3  LPDDR4 接口原理图
    4. 3.4  兼容的 JEDEC LPDDR4 器件
    5. 3.5  放置
    6. 3.6  LPDDR4 禁止区域
    7. 3.7  网类别
    8. 3.8  LPDDR4 信号终端
    9. 3.9  LPDDR4 VREF 布线
    10. 3.10 LPDDR4 VTT
    11. 3.11 CK 和 ADDR_CTRL 拓扑
    12. 3.12 数据组拓扑
    13. 3.13 CK 和 ADDR_CTRL 布线规格
    14. 3.14 数据组布线规格
    15. 3.15 通道、字节和位交换
  5. 4修订历史记录

3.11 CK 和 ADDR_CTRL 拓扑

CK 和 ADDR_CTRL 网类别的布线方式相似，通过处理器中的 DDR 控制器与 LPDDR4 SDRAM 进行长度匹配，以最大限度地减少信号之间的偏差并保证在 SDRAM 上对 ADDR_CTRL 信号进行正确采样。CK 网类别需更加注意，因为它以更高的转换速率运行并且采用差分形式。CK 和 ADDR_CTRL 拓扑为点对点拓扑。

图 3-4 显示了 CK 网类别的拓扑，而图 3-5 显示了相应 ADDR_CTRL 网类别的拓扑。表 3-6 详细介绍了布线段的长度匹配要求。

GUID-20200903-CA0I-4B9W-BPL1-LHJHWKJZGWT5-low.gif图 3-4 LPDDR4 CK 拓扑
GUID-20200903-CA0I-XKPV-GWXF-QHPRL3HTRZTC-low.gif图 3-5 LPDDR4 ADDR_CTRL 拓扑

在布线期间尽量减少层转换。如果必须进行某个层转换，则最好转换到使用相同参考平面的层。当参考平面为接地平面和 VDDS_DDR 时，如果无法做到这一点，请确保附近有拼接过孔，以使返回电流在这两个参考平面之间转换。另外，当其中一个参考平面为接地平面，而另一个参考平面为 VDDS_DDR 时，请确保附近放置了旁路电容器，以使返回电流在这两个参考平面之间转换。每个参考平面转换都必须满足这一条件。目标是最大限度地减小返回电流路径的大小，从而尽量减小该路径中的电感。如果缺少这些拼接过孔或电容器，则会导致信号路径中的阻抗不连续，从而增加串扰和信号失真。

在 CK 和 ADDR_CTRL 布线组拓扑的网上不允许存在残桩或终端。所有测试和探头接入点必须排成一条直线，不得有任何分支或残桩。