ZHCSJ70C December   2018  – January 2021 DS90UB941AS-Q1

PRODUCTION DATA  

  1. 1 特性
  2. 2 应用
  3. 3 说明
  4. 4 修订历史记录
  5. 5 说明（续）
  6. 6 引脚配置和功能
    1.     引脚功能
  7. 7 规格
    1. 7.1 绝对最大额定值
    2. 7.2 ESD 等级
    3. 7.3 建议工作条件
    4. 7.4 热性能信息
    5. 7.5 直流电气特征
    6. 7.6 交流电气特征
    7. 7.7 推荐外部时钟参考时序
    8. 7.8 推荐的串行控制总线时序
    9. 7.9 时序图
  8. 8 详细说明
    1. 8.1 概述
    2. 8.2 功能方框图
    3. 8.3 特性说明
      1. 8.3.1  DSI 接收器
        1. 8.3.1.1 DSI 工作模式
          1. 8.3.1.1.1 高速模式
          2. 8.3.1.1.2 25
          3. 8.3.1.1.3 全局操作时序参数
        2. 8.3.1.2 THS-SKIP 编程
        3. 8.3.1.3 DSI 错误和状态
          1. 8.3.1.3.1 DSI / DPHY 误差检测和报告
          2. 8.3.1.3.2 DSI 协议错误检测
          3. 8.3.1.3.3 DSI 错误报告
          4. 8.3.1.3.4 DSI 错误计数器
          5. 8.3.1.3.5 DSI 转 FPD-Link III 缓冲区错误
        4. 8.3.1.4 支持的 DSI 视频格式
      2. 8.3.2  高速正向通道数据传输
      3. 8.3.3  反向通道数据传输
      4. 8.3.4  FPD-Link III 端口寄存器访问
      5. 8.3.5  视频控制信号
      6. 8.3.6  关断引脚 (PDB)
      7. 8.3.7  串行链路故障检测
      8. 8.3.8  中断支持
        1. 8.3.8.1 中断引脚 (INTB)
        2. 8.3.8.2 远程中断引脚 (REM_INTB)
      9. 8.3.9  GPIO 支持
        1. 8.3.9.1 GPIO[3:0] 配置
        2. 8.3.9.2 反向通道配置
        3. 8.3.9.3 GPIO_REG[8:5] 配置
      10. 8.3.10 SPI 通信
        1. 8.3.10.1 SPI 模式配置
        2. 8.3.10.2 正向通道 SPI 操作
        3. 8.3.10.3 反向通道 SPI 操作
      11. 8.3.11 音频模式
        1. 8.3.11.1 I2S 音频接口
          1. 8.3.11.1.1 I2S 传输模式
          2. 8.3.11.1.2 I2S 中继器
          3. 8.3.11.1.3 分离器和复制模式期间的音频
        2. 8.3.11.2 TDM 音频接口
      12. 8.3.12 内置自检测试 (BIST)
        1. 8.3.12.1 BIST 配置和状态
        2. 8.3.12.2 正向通道和反向通道错误检查
      13. 8.3.13 内部模式生成
        1. 8.3.13.1 图形选项
        2. 8.3.13.2 颜色模式
        3. 8.3.13.3 视频时序模式
        4. 8.3.13.4 外部时序
        5. 8.3.13.5 图形反转
        6. 8.3.13.6 自动滚动
        7. 8.3.13.7 附加特性
      14. 8.3.14 EMI 降低特性
        1. 8.3.14.1 输入 SSC 容差
    4. 8.4 器件功能模式
      1. 8.4.1 模式选择配置设置 (MODE_SEL[1:0])
      2. 8.4.2 时钟模式
        1. 8.4.2.1 DSI 时钟模式
        2. 8.4.2.2 像素时钟模式
          1. 8.4.2.2.1 DSI 参考时钟模式
          2. 8.4.2.2.2 外部参考时钟模式
          3. 8.4.2.2.3 内部参考时钟
          4. 8.4.2.2.4 独立 2:2 模式的外部参考时钟
      3. 8.4.3 双 DSI 输入模式
        1. 8.4.3.1 DSI 双路运行要求
        2. 8.4.3.2 启用双 DSI 运行
        3. 8.4.3.3 双 DSI 控制和状态
      4. 8.4.4 3D 格式支持（单 DSI 输入）
        1. 8.4.4.1 左/右 3D 格式支持
        2. 8.4.4.2 交替线路 3D 格式支持
        3. 8.4.4.3 交替像素 3D 格式支持
      5. 8.4.5 独立 2:2 模式
        1. 8.4.5.1 独立 2:2 模式的配置
        2. 8.4.5.2 配置独立 2:2 模式的代码示例
        3. 8.4.5.3 91
      6. 8.4.6 FPD-Link III 运行模式
        1. 8.4.6.1 单链路模式
        2. 8.4.6.2 双链路模式
        3. 8.4.6.3 复制模式
        4. 8.4.6.4 分离器模式
          1. 8.4.6.4.1 DSI 对称分离
            1. 8.4.6.4.1.1 对称分离 - 左/右
            2. 8.4.6.4.1.2 对称分离 - 交替像素分离
            3. 8.4.6.4.1.3 对称分离 - 交替线路分离
            4. 8.4.6.4.1.4 101
          2. 8.4.6.4.2 DSI 非对称分离
            1. 8.4.6.4.2.1 非对称分离与裁剪
            2. 8.4.6.4.2.2 非对称分离与 DSI VC-ID
          3. 8.4.6.4.3 分离器运行的配置
    5. 8.5 编程
      1. 8.5.1 串行控制总线
      2. 8.5.2 多主仲裁支持
      3. 8.5.3 有关多主运行的 I2C 限制
      4. 8.5.4 对较新 FPD-Link III 器件的器件寄存器进行多主访问
      5. 8.5.5 对较旧 FPD-Link III 器件的器件寄存器进行多主访问
      6. 8.5.6 有关多主运行的控制通道方向的限制
    6. 8.6 寄存器映射
      1. 8.6.1 主寄存器
      2. 8.6.2 DSI 端口 0 和端口 1 间接寄存器
      3. 8.6.3 模拟间接寄存器
      4. 8.6.4 端口 0 和端口 1 图形发生器间接寄存器
  9. 9 应用和实现
    1. 9.1 应用信息
    2. 9.2 典型应用
      1. 9.2.1 设计要求
      2. 9.2.2 详细设计过程
        1. 9.2.2.1 高速互连指南
      3. 9.2.3 应用曲线
  10. 10电源相关建议
    1. 10.1 VDD 电源
    2. 10.2 上电和初始化
  11. 11布局
    1. 11.1 布局指南
      1. 11.1.1 接地
      2. 11.1.2 路由 FPD-Link III 信号布线
      3. 11.1.3 路由 DSI 信号布线
    2. 11.2 布局示例
  12. 12器件和文档支持
    1. 12.1 文档支持
      1. 12.1.1 相关文档
    2. 12.2 支持资源
    3. 12.3 商标
    4. 12.4 静电放电警告
    5. 12.5 术语表
  13. 13机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

8.6.3 模拟间接寄存器

模拟间接寄存器摘要列出了 DS90UB941AS-Q1 寄存器的存储器映射寄存器。所有未在模拟间接寄存器摘要中列出的寄存器偏移地址都应视为保留的存储单元，并且不应修改寄存器内容。

寄存器访问是通过间接访问寄存器（IND_ACC_CTL、IND_ACC_ADDR 和 IND_ACC_DATA）的间接访问机制提供的。这些寄存器位于主寄存器空间中的偏移地址 0x40-0x42 处。

间接地址机制涉及设置控制寄存器以选择所需的块，设置寄存器偏移地址，以及读取或写入数据寄存器。此外，控制寄存器中提供了自动递增功能，可以在每次读取或写入数据寄存器后自动递增偏移地址。

对于写入，其过程如下：

  1. 写入 IND_ACC_CTL 寄存器以选择所需的寄存器块
    • 如需选择 DSI/D-PHY 模拟间接寄存器，请设置 0x40 = 0x10
    • 如需选择 FPD-Link III 模拟间接寄存器，请设置 0x40 = 0x14
  2. 写入 IND_ACC_ADDR 寄存器以设置寄存器偏移
  3. 向 IND_ACC_DATA 寄存器写入数据值

如果在 IND_ACC_CTL 寄存器中设置了自动递增，重复步骤 3 将向随后的寄存器偏移位置写入额外的数据字节

对于读取，其过程如下：

  1. 写入 IND_ACC_CTL 寄存器以选择所需的寄存器块
    • 如需选择 DSI/D-PHY 模拟间接寄存器并从中读取，请设置 0x40 = 0x11
    • 如需选择 FPD-Link III 模拟间接寄存器并从中读取，请设置 0x40 = 0x15
  2. 写入 IND_ACC_ADDR 寄存器以设置寄存器偏移
  3. 从 IND_ACC_DATA 寄存器读取

如果在 IND_ACC_CTL 寄存器中设置了自动递增，重复步骤 3 会从后续寄存器偏移位置读取额外的数据字节。

表 8-159 模拟间接寄存器摘要
偏移量首字母缩写词寄存器名称段
0x86 DSI0_CLK_INVERSION
0x94 DSI1_CLK_INVERSION

寄存器访问类型代码显示了适用于此部分中访问类型的代码。

表 8-160 寄存器访问类型代码
访问类型代码说明
RR只读访问
R/WR/W读取/写入访问

8.6.3.1 DSI0_CLK_INVERSION 寄存器（偏移 = 0x86）[复位 = 8h]

在 DSI0_CLK_INVERSION 寄存器字段说明中描述了 DSI_PLL_STATE_MC_CTL。

返回到汇总表。

表 8-161 DSI0_CLK_INVERSION 寄存器字段说明
位 字段 类型 复位 描述
7-2 保留 R/W 2h

保留
1 DSI0_CLK_INVERSION R/W 0h

反相内部 DSI 采样时钟
0：同相采样时钟

1：反相采样时钟（正常工作）
注意：根据第 10.2 节中的上电和初始化序列，将该位设置为 1 ，用于所有应用。这与寄存器 0x2 中的时钟极性设置无关
0 RESERVED R/W 0h 保留

8.6.3.2 DSI1_CLK_INVERSION 寄存器（偏移 = 0x94）[复位 = 8h]

在 DSI0_CLK_INVERSION 寄存器字段说明中描述了 DSI_PLL_STATE_MC_CTL。

返回到汇总表。

表 8-162 DSI1_CLK_INVERSION 寄存器字段说明
位 字段 类型 复位 描述
7-2 保留 R/W 2h

保留
1 DSI1_CLK_INVERSION R/W 0h

反相内部 DSI 采样时钟
0：同相采样时钟

1：反相采样时钟（正常工作）
注意：根据第 10.2 节中的上电和初始化序列，将该位设置为 1，用于所有应用。这与寄存器 0x2 中的时钟极性设置无关
0 保留 R/W 0h 保留