ZHCUCH3A November   2024  – March 2025 F29H850TU , F29H859TU-Q1

 

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    1.     关于本手册
    2.     德州仪器 (TI) 相关文档
    3.     术语表
    4.     支持资源
    5.     商标
  3. 1架构概述
    1. 1.1 CPU 简介
    2. 1.2 数据类型
    3. 1.3 C29x CPU 系统架构
      1. 1.3.1 仿真逻辑
      2. 1.3.2 CPU 接口总线
    4. 1.4 存储器映射
  4. 2中央处理单元 (CPU)
    1. 2.1 C29x CPU 架构
      1. 2.1.1 特性
      2. 2.1.2 方框图
    2. 2.2 CPU 寄存器
      1. 2.2.1 寻址寄存器 (Ax/XAx)
      2. 2.2.2 定点寄存器 (Dx/XDx)
      3. 2.2.3 浮点寄存器 (Mx/XMx)
      4. 2.2.4 程序计数器 (PC)
      5. 2.2.5 返回程序计数器 (RPC)
      6. 2.2.6 状态寄存器
        1. 2.2.6.1 中断状态寄存器 (ISTS)
        2. 2.2.6.2 解码阶段状态寄存器 (DSTS)
        3. 2.2.6.3 执行阶段状态寄存器 (ESTS)
    3. 2.3 指令打包
      1. 2.3.1 独立指令和限制
      2. 2.3.2 指令超时
    4. 2.4 栈
      1. 2.4.1 软件栈
      2. 2.4.2 受保护的调用栈
      3. 2.4.3 实时中断/NMI 栈
  5. 3中断
    1. 3.1 CPU 中断架构方框图
    2. 3.2 RESET、NMI、RTINT 和 INT
      1. 3.2.1 RESET（CPU 复位）
        1. 3.2.1.1 所需指令 (RESET)
      2. 3.2.2 NMI（不可屏蔽中断）
        1. 3.2.2.1 阻止和屏蔽 (NMI)
        2. 3.2.2.2 信号传播 (NMI)
        3. 3.2.2.3 栈 (NMI)
        4. 3.2.2.4 所需指令(NMI)
      3. 3.2.3 RTINT（实时中断）
        1. 3.2.3.1 阻止和屏蔽 (RTINT)
        2. 3.2.3.2 信号传播 (RTINT)
        3. 3.2.3.3 栈 (RTINT)
        4. 3.2.3.4 所需指令 (RTINT)
      4. 3.2.4 INT（低优先级中断）
        1. 3.2.4.1 阻止和屏蔽 (INT)
        2. 3.2.4.2 信号传播 (INT)
        3. 3.2.4.3 堆栈 (INT)
    3. 3.3 阻止中断的条件
      1. 3.3.1 ATOMIC 计数器
    4. 3.4 CPU 中断控制寄存器
      1. 3.4.1 中断状态寄存器 (ISTS)
      2. 3.4.2 解码阶段状态寄存器 (DSTS)
      3. 3.4.3 与中断相关的栈寄存器
    5. 3.5 中断嵌套
      1. 3.5.1 中断嵌套示例图
    6. 3.6 安全性
      1. 3.6.1 概述
      2. 3.6.2 链接
      3. 3.6.3 栈
      4. 3.6.4 区域
  6. 4寻址模式
    1. 4.1 寻址模式概述
      1. 4.1.1 文档和实施
      2. 4.1.2 寻址模式类型列表
        1. 4.1.2.1 其他寻址类型
      3. 4.1.3 寻址模式汇总
    2. 4.2 寻址模式字段
      1. 4.2.1 ADDR1 字段
      2. 4.2.2 ADDR2 字段
      3. 4.2.3 ADDR3 字段
      4. 4.2.4 DIRM 字段
      5. 4.2.5 其他字段
    3. 4.3 对齐和流水线注意事项
      1. 4.3.1 对齐
      2. 4.3.2 流水线注意事项
    4. 4.4 寻址模式类型
      1. 4.4.1 直接寻址
      2. 4.4.2 指针寻址
        1. 4.4.2.1 具有 #Immediate 偏移的指针寻址
        2. 4.4.2.2 具有指针偏移的指针寻址
        3. 4.4.2.3 具有 #Immediate 递增/递减的指针寻址
        4. 4.4.2.4 具有指针递增/递减的指针寻址
      3. 4.4.3 栈寻址
        1. 4.4.3.1 分配和取消分配栈空间
      4. 4.4.4 循环寻址指令
      5. 4.4.5 位反向寻址指令
  7. 5功能安全和信息安全单元 (SSU)
    1. 5.1 SSU 概述
    2. 5.2 链接和任务隔离
    3. 5.3 在任务隔离边界之外共享数据
    4. 5.4 受保护的调用和返回
  8. 6仿真
    1. 6.1 仿真功能概述
    2. 6.2 调试术语
    3. 6.3 调试接口
    4. 6.4 执行控制模式
    5. 6.5 断点、观察点和计数器
      1. 6.5.1 软件断点
      2. 6.5.2 硬件调试资源
        1. 6.5.2.1 硬件断点
        2. 6.5.2.2 硬件观察点
        3. 6.5.2.3 基准计数器
      3. 6.5.3 PC 跟踪
  9. 7修订历史记录

3.4.2 解码阶段状态寄存器 (DSTS)

解码阶段状态寄存器 (DSTS) 包含有关 CPU的中断和链接状态的信息。下表突出显示了与中断操作相关的字段。软件使用此信息来构建可预测的优先级和安全行为。

- RLINK ISR_PRIORITY INTS INTE
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16
TA3 TA2 TA1 TA0 - CLINK DBGM - - A.ZV A.C A.N A.Z
15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

返回链接 (RLINK)：这表示执行受保护返回的源的链接。

ISR 优先级 (ISR_PRIORITY)：如果 CPU 正在处理中断并且 INT 是 INT 或 RTINT，则中断的优先级反映在此字段中。这是一个 8 位寄存器字段。

中断状态 (INTS)：该字段跟踪 CPU 执行的状态，指定执行是在主环路中、在 NMI ISR 中、在 RTINT ISR 中还是在 INT ISR 中。外部 PIPE 模块也使用此字段来跟踪 CPU 的当前阶段，以决定何时可以将下一个就绪的 RTINT 或 INT 中断转发到 CPU。有关 INTS 字段状态值的详细信息，请参阅表 3-3。

表 3-3 INTS - 中断状态值
INTS[1] INTS[0] CPU 状态 注释
0 0 主代码 不在任何任务、中断或异常中
0 1 INT 处理程序 在正常的中断服务例程中
1 0 RTINT 处理程序 在实时中断服务例程中
1 1 NMI 处理程序 在 NMI 处理程序例程中

INT 使能 (INTE)：INT 使能位反映 CPU 是否可以接受 INT 中断。该位需要为 1 才能在 CPU 中接受下一个更高优先级的 INT（这允许 INT 嵌套）。接受 INT 后，该位会自动设置为 0，因此 ISR 代码需要显式将该位设置回 1 以启用 INT 中断嵌套。

调用者链接 (CLINK)：CLINK 字段表示发起调用以执行该函数的源的链接。这包括来自 ISR 的执行调用。

为了增强安全性，可以在给定的 ISR（或函数）中检查 CLINK 字段，以确定 CLINK 字段是否与预定义的链接匹配。如果链接不匹配，ISR（或函数）随后会自动退出。