TIDA-01021

适用于 DSO、雷达和 5G 无线测试仪的多通道 JESD204B 15GHz 时钟参考设计

TIDA-01021

设计文件

概述

High speed multi-channel applications require precise clocking solutions capable of managing channel-to-channel skew in order to achieve optimal system SNR, SFDR, and ENOB. This reference design is capable of supporting two high speed channels on separate boards by utilizing TI’s LMX2594 wideband PLL with integrated VCOs to generate a 10 MHz to 15 GHz clock and SYSREF for JESD204B interfaces. The 10 KHz offset phase noise is < -104 dBc/Hz for a 15 GHz clock frequency.  By using TI’s ADC12DJ3200 high speed converter EVMs, a board-to-board clock skew of <10ps is achieved and a SNR of 49.6 dB with a 5.25 GHz input signal. All key design theories are described, guiding users through the part selection process and design optimization.  Finally, schematic, board layout, hardware testing, and results are also presented.

特性
  • Up to 15GHz sample clock generation
  • Multi-channel JESD204B compliant clock solution
  • Low phase noise clocking for RF sampling ADC/DAC
  • Configurable phase synchronization to achieve low skew in multi-channel system
  • Supports TI’s high-speed converter and capture cards (ADC12DJ3200EVM, TSW14J56 / TSW14J57)
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我们开发的全面组装电路板仅用于测试和性能验证,不可用于销售。

设计文件和产品

设计文件

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ZHCU256A.PDF (2369 K)

参考设计概述和经过验证的性能测试数据

TIDRR75A.PDF (1786 K)

设计布局和元件的详细原理图

TIDRR76A.PDF (696 K)

设计布局和元件的详细原理图

TIDRR77A.PDF (193 K)

设计元件、引用标识符和制造商/器件型号的完整列表

TIDRR78A.PDF (44 K)

设计元件、引用标识符和制造商/器件型号的完整列表

TIDRR79A.PDF (1084 K)

元件放置方式设计布局的详细原理图

TIDRR80A.PDF (644 K)

元件放置方式设计布局的详细原理图

TIDRR83A.ZIP (8944 K)

IC 元件的 3D 模型和 2D 图纸使用的文件

TIDRR84A.ZIP (7976 K)

IC 元件的 3D 模型和 2D 图纸使用的文件

TIDCDH9A.ZIP (6571 K)

包含设计 PCB 物理板层信息的设计文件

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TIDRR81A.PDF (7470 K)

用于生成 PCB 设计布局的 PCB 层图文件

TIDRR82A.PDF (4389 K)

用于生成 PCB 设计布局的 PCB 层图文件

产品

在设计中包括 TI 产品和可能的替代产品。

AC/DC 和 DC/DC 转换器(集成 FET)

TPS543182.95V 至 6V 输入、3A 同步降压 SWIFT™ 转换器

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LVDS、M-LVDS 和 PECL IC

DS90LV028AQ-Q1汽车类 LVDS 双通道差动线路接收器

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MOSFET

CSD15571Q2采用 2mm x 2mm SON 封装的单通道、19.2mΩ、20V、N 沟道 NexFET™ 功率 MOSFET

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与门

SN74LVC1G08单通道、2 输入、1.65V 至 5.5V 32mA 驱动强度与门

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同相缓冲器和驱动器

SN74LVC1G125具有三态输出的 1.65V 至 5.5V 单路缓冲器

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射频 PLL 与合成器

LMX2594具有相位同步功能且支持 JESD204B 的 15GHz 宽带 PLLatinum™ 射频合成器

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振荡器

LMK61E2156.250MHz、±50ppm、超低抖动、集成式 EEPROM、完全可编程振荡器

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时钟抖动清除器

LMK04828具有集成式 2370 至 2630MHz VCO0 且符合 JESD204B 标准的超低噪声时钟抖动消除器

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时钟缓冲器

LMK00304具有 4 个可配置输出的 3.1GHz 差动时钟缓冲器/电平转换器

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模拟开关和多路复用器

SN74CBTLV3257具有局部断电模式的 3.3V、2:1 (SPDT)、4 通道模拟开关

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模拟开关和多路复用器

TMUX1574具有断电保护功能和 1.8V 输入逻辑的 5V、2:1 (SPDT)、4 通道模拟开关

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电子保险丝和热插拔控制器

TPS259254.5V 至 5.5V、30mΩ、2A 至 5A 电子保险丝

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线性和低压降 (LDO) 稳压器

TLV702具有使能功能的 300mA、高 PSRR、低 IQ、低压降稳压器

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线性和低压降 (LDO) 稳压器

TPS7A47具有使能功能的 1A、36V、低噪声、高 PSRR、低压降稳压器

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线性和低压降 (LDO) 稳压器

TPS7A8300具有电源正常指示功能的 2A、低输入电压、低噪声、高精度超低压降稳压器

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高速 ADC (≥10MSPS)

ADC08DJ32008 位双通道 3.2GSPS 或单通道 6.4GSPS 射频采样模数转换器 (ADC)

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高速 ADC (≥10MSPS)

ADC12DJ270012 位双通道 2.7GSPS 或单通道 5.4GSPS 射频采样模数转换器 (ADC)

数据表: PDF | HTML
高速 ADC (≥10MSPS)

ADC12DJ320012 位双通道 3.2GSPS 或单通道 6.4GSPS 射频采样模数转换器 (ADC)

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类型 标题 下载最新的英文版本 日期
技术文章 Step-by-step considerations for designing wide-bandwidth multichannel systems PDF | HTML 2019年 6月 4日
设计指南 适用于DSO、雷达和5G 无线测试仪的多通道JESD204B 15GHz 时钟参考设计 (Rev. A) 英语版 (Rev.A) 2017年 10月 24日
技术文章 Preparing for 5G applications: sync your multichannel JESD204B data acquisition sy PDF | HTML 2017年 8月 28日

相关设计资源

硬件开发

评估板
ADC12DJ3200EVM ADC12DJ3200 12 位双通道 3.2GSPS 或单通道 6.4GSPS 射频采样 ADC 评估模块

参考设计

参考设计
TIDA-01022 适用于 DSO、雷达和 5G 无线测试系统的灵活 3.2GSPS 多通道 AFE 参考设计 TIDA-01023 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 时钟生成参考设计 TIDA-01024 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 菊链时钟参考设计

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