TPS7A8300
- Ultralow Dropout: 125 mV Maximum at 2 A
- Output Voltage Noise: 6 µVRMS
- Power-Supply Ripple Rejection:
- 40 dB at 1 MHz
- Input Voltage Range:
- Without BIAS: 1.4 V to 6.5 V
- With BIAS: 1.1 V to 6.5 V
- Two Output Voltage Modes:
- ANY-OUT™ Version (User-Programmable Output via PCB Layout):
- No External Resistor Required
- Output Voltage Range: 0.8 V to 3.95 V
- Adjustable Version:
- Output Voltage Range: 0.8 V to 5.0 V
- ANY-OUT™ Version (User-Programmable Output via PCB Layout):
- 1.0% Accuracy Over Line, Load, and Temperature
- Stable with a 22-µF Output Ceramic Capacitor
- Programmable Soft-Start Output
- Power-Good (PG) Output
- Available Packages:
- 5-mm × 5-mm VQFN-20
- 3.5-mm × 3.5-mm VQFN-20
The TPS7A8300 is a low-noise (6 µVRMS), low-dropout voltage regulator (LDO) capable of sourcing a 2-A load with only 125 mV of maximum dropout.
The TPS7A8300 output voltages are fully user-adjustable (up to 3.95 V) using a printed circuit board (PCB) layout without the need of external resistors, thus reducing overall component count. For higher output voltage applications, the device achieves output voltages up to 5 V with the use of external resistors. The device supports very low input voltages (down to 1.1 V) with the use of an additional BIAS rail.
With very high accuracy (1% over line, load, and temperature), remote sensing, and soft-start capabilities to reduce inrush current, the TPS7A8300 is ideal for powering high-current, low-voltage devices such as high-end microprocessors and field-programmable gate arrays (FPGAs).
The TPS7A8300 is designed to power-up noise-sensitive components in high-speed communication applications. The very low-noise, 6-µVRMS device output and high broad-bandwidth PSRR (40 dB at 1 MHz) minimizes phase noise and clock jitter in high-frequency signals. These features maximize performance of clocking devices, analog-to-digital converters (ADCs), and digital-to-analog converters (DACs).
For applications where positive and negative low-noise rails are required, consider TIs TPS7A33 family of negative high-voltage, ultralow-noise linear regulators.
技术文档
设计与开发
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PMLKLDOEVM — 使用 TPS7A4901 和 TPS7A8300 的 TI-PMLK LDO 实验板
我们的 TI-PMLK LDO 实验板属于 TI 电源管理实验室套件 (TI-PMLK) 系列。TI-PMLK 系列支持实践学习,有助于巩固电源知识。模块化设计使您能够获得个性化的 TI-PMLK 系列学习体验,最大程度加深对电源设计的系统理解。TI-PMLK LDO 实验板采用 TPS7A4901 和 TPS7A8300 低压降 (LDO) 电压稳压器。TI-PMLK LDO 实验板实验室手册 (PMLKLDOEVMB) 介绍了理论和实验,涵盖实际应用中稳态、瞬态和动态条件下的各种测试。
PARALLEL-LDO-CALC — Parallel low-dropout (LDO) calculator
并联低压降 (LDO) 计算器是一款基于 Microsoft® Excel® 的工具,它使用镇流电阻为并联 LDO 稳压器提供最坏情形分析。该工具可帮助用户确定所需的最低并联 LDO 稳压器数量,以及满足一组系统要求的合适镇流电阻。
计算器中预填充了并联应用中常用 LDO 稳压器的数据表信息。用户可以根据其系统要求来评估哪款 LDO 稳压器器件能够满足其系统需求。
许多 TI 参考设计都包括 TPS7A8300
通过我们的参考设计选择工具来审查并确定最适用于您应用和参数的设计。
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| VQFN (RGW) | 20 | Ultra Librarian |
| VQFN (RGR) | 20 | Ultra Librarian |
订购和质量
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