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LMK05028

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저지터 듀얼 채널 네트워크 싱크로나이저 클록

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제품 상세 정보

Function Clock network synchronizer Number of outputs 8 Output type CML, HCSL, LVCMOS, LVDS, LVPECL RMS jitter (fs) 150 Features I2C, Integrated EEPROM, Pin programmable, SPI Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 750 Input type LVCMOS, LVDS, LVPECL, XTAL Supply voltage (min) (V) 3.3 Supply voltage (max) (V) 3.6 Operating temperature range (°C) -40 to 85 Number of input channels 4
Function Clock network synchronizer Number of outputs 8 Output type CML, HCSL, LVCMOS, LVDS, LVPECL RMS jitter (fs) 150 Features I2C, Integrated EEPROM, Pin programmable, SPI Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 750 Input type LVCMOS, LVDS, LVPECL, XTAL Supply voltage (min) (V) 3.3 Supply voltage (max) (V) 3.6 Operating temperature range (°C) -40 to 85 Number of input channels 4
VQFN (RGC) 64 81 mm² 9 x 9
  • Two Independent PLL Channels Featuring:
    • Jitter: 150fs RMS for Outputs ≥ 100MHz
    • Phase Noise: –112dBc/Hz at 100Hz Offset for 122.88MHz
    • Hitless Switching: 50ps Phase Transient With Phase Cancellation
    • Programmable Loop Bandwidth With Fastlock
    • Standards-Compliant Synchronization and Holdover Using a Low-Cost TCXO/OCXO
    • Any Input to Any Output Frequency Translation
  • Four Reference Clock Inputs
    • Priority-Based Input Selection
    • Digital Holdover on Loss of Reference
  • Eight Clock Outputs With Programmable Drivers
    • Up to Six Different Output Frequencies
    • AC-LVDS, AC-CML, AC-LVPECL, HCSL, and 1.8V or 2.5V LVCMOS Output Formats
  • EEPROM/ROM for Custom Clocks on Power-Up
  • Flexible Configuration Options
    • Up to 750MHz on Input and Output
    • XO: 10MHz to 100MHz, TCXO: 10MHz to 54MHz
    • DCO Mode: < 1ppt/Step for Fine Frequency and Phase Steering (IEEE 1588 Slave)
    • Zero Delay for Deterministic Phase Offset
    • Robust Clock Monitoring and Status
    • I2C or SPI Interface
  • Excellent Power Supply Noise Rejection (PSNR)
  • 3.3V Supply With 1.8V, 2.5V, or 3.3V Outputs
  • Industrial Temperature Range: –40°C to +85°C
  • Two Independent PLL Channels Featuring:
    • Jitter: 150fs RMS for Outputs ≥ 100MHz
    • Phase Noise: –112dBc/Hz at 100Hz Offset for 122.88MHz
    • Hitless Switching: 50ps Phase Transient With Phase Cancellation
    • Programmable Loop Bandwidth With Fastlock
    • Standards-Compliant Synchronization and Holdover Using a Low-Cost TCXO/OCXO
    • Any Input to Any Output Frequency Translation
  • Four Reference Clock Inputs
    • Priority-Based Input Selection
    • Digital Holdover on Loss of Reference
  • Eight Clock Outputs With Programmable Drivers
    • Up to Six Different Output Frequencies
    • AC-LVDS, AC-CML, AC-LVPECL, HCSL, and 1.8V or 2.5V LVCMOS Output Formats
  • EEPROM/ROM for Custom Clocks on Power-Up
  • Flexible Configuration Options
    • Up to 750MHz on Input and Output
    • XO: 10MHz to 100MHz, TCXO: 10MHz to 54MHz
    • DCO Mode: < 1ppt/Step for Fine Frequency and Phase Steering (IEEE 1588 Slave)
    • Zero Delay for Deterministic Phase Offset
    • Robust Clock Monitoring and Status
    • I2C or SPI Interface
  • Excellent Power Supply Noise Rejection (PSNR)
  • 3.3V Supply With 1.8V, 2.5V, or 3.3V Outputs
  • Industrial Temperature Range: –40°C to +85°C

The LMK05028 is a high-performance network synchronizer clock device that provides jitter cleaning, clock generation, advanced clock monitoring, and good hitless switching performance to meet the stringent timing requirements of communications infrastructure and industrial applications. The low jitter and high PSNR of the device reduce bit error rates (BER) in high-speed serial links.

The device has two PLL channels and generates up to eight output clocks with 150-fs RMS jitter. Each PLL domain can select from any four reference inputs to synchronize the outputs.

The LMK05028 is a high-performance network synchronizer clock device that provides jitter cleaning, clock generation, advanced clock monitoring, and good hitless switching performance to meet the stringent timing requirements of communications infrastructure and industrial applications. The low jitter and high PSNR of the device reduce bit error rates (BER) in high-speed serial links.

The device has two PLL channels and generates up to eight output clocks with 150-fs RMS jitter. Each PLL domain can select from any four reference inputs to synchronize the outputs.
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기술 자료

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* Data sheet LMK05028 Low-Jitter Dual-Channel Network Synchronizer Clock With EEPROM datasheet (Rev. B) PDF | HTML 2025/02/14
Third party document Intel® Stratix® 10 SX SoC Development Kit User Guide 2019/04/12
Technical article How to achieve network synchronization clocks with TI digital PLLs PDF | HTML 2018/06/21
Application note TI Network Synchronizer Clock Value Adds in Communications and Industrial Applic 2018/04/12
Application note ITU-T G.8262 Compliance Test Results for the LMK05028 Digital PLL Network 2018/04/10
User guide LMK05028 Registers 2018/04/10

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

LMK05028EVM — LMK05028 네트워크 클록 제너레이터 및 싱크로나이저 평가 모듈

LMK05028EVM은 LMK05028 네트워크 클록 제너레이터 및 싱크로나이저를 위한 평가 모듈입니다. 이 EVM은 장치 평가, 규정 준수 테스트 및 시스템 프로토타이핑에 활용할 수 있습니다.
LMK05028은 입력 원더와 지터 감쇠를 위한 프로그래머블 대역폭과 두 개의 디지털 PLL(DPLL)을 통합합니다. EVM에는 50-Ω 테스트 장비와 장치를 상호 작용하기 위한 클록 입력, 오실레이터 입력 및 클록 출력을 위한 SMA 커넥터가 포함되어 있습니다. 온보드 XO 및 TCXO 옵션을 사용하면 LMK05028을 자유 실행, 잠금 (...)

사용 설명서: PDF
TI.com에서 구매할 수 없음
지원 소프트웨어

TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices

Texas Instruments clocks and synthesizers (TICS) pro software is used to program the evaluation modules (EVMs) for product numbers with these prefixes: CDC, LMK and LMX. These products include phase-locked loops and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.

지원되는 제품 및 하드웨어

지원되는 제품 및 하드웨어
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시뮬레이션 모델

LMK05028 IBIS Model

SNAM222.ZIP (213 KB) - IBIS Model
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설계 툴

CLOCK-TREE-ARCHITECT — 클록 트리 아키텍트 프로그래밍 소프트웨어

클록 트리 아키텍트는 시스템 요구 사항에 따라 클록 트리 솔루션을 생성하여 설계 프로세스를 간소화하는 클록 트리 합성 툴입니다. 이 툴은 광범위한 클로킹 제품 데이터베이스에서 데이터를 가져와 시스템 수준의 다중 칩 클로킹 솔루션을 생성합니다.
지금 설계하기
설계 툴

PLLATINUMSIM-SW — PLLatinum Sim Tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

지원되는 제품 및 하드웨어

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시뮬레이션 툴

PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®

TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.

TI 설계 및 시뮬레이션 환경용 PSpice는 기본 제공 라이브러리를 이용해 복잡한 혼합 신호 설계를 시뮬레이션할 수 있습니다. 레이아웃 및 제작에 착수하기 (...)
요청
패키지 핀 CAD 기호, 풋프린트 및 3D 모델
VQFN (RGC) 64 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

포럼 주제 모두 보기(영문)

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