ZHCABY4B March   2023  – September 2025 MSPM0L1105 , MSPM0L1106 , MSPM0L1303 , MSPM0L1304 , MSPM0L1304-Q1 , MSPM0L1305 , MSPM0L1305-Q1 , MSPM0L1306 , MSPM0L1306-Q1 , MSPM0L1343 , MSPM0L1344 , MSPM0L1345 , MSPM0L1346

 

  1.   1
  2.   摘要
  3.   商标
  4. 1 MSPM0L 硬件设计检查清单
  5. 2 MSPM0L 器件中的电源
    1. 2.1 数字电源
    2. 2.2 模拟电源
    3. 2.3 内置电源和电压基准
    4. 2.4 推荐的电源去耦电路
  6. 3 复位和电源监控器
    1. 3.1 数字电源
    2. 3.2 电源监控器
  7. 4 时钟系统
    1. 4.1 内部振荡器
    2. 4.2 外部时钟输出 (CLK_OUT)
    3. 4.3 频率时钟计数器 (FCC)
  8. 5 调试器
    1. 5.1 调试端口引脚和引脚排列
    2. 5.2 使用标准 JTAG 连接器的调试端口连接
  9. 6 主要模拟外设
    1. 6.1 ADC 设计注意事项
    2. 6.2 OPA 设计注意事项
    3. 6.3 DAC 设计注意事项
    4. 6.4 COMP 设计注意事项
    5. 6.5 GPAMP 设计注意事项
    6. 6.6 LCD 设计注意事项
  10. 7 主要数字外设
    1. 7.1 计时器资源和设计注意事项
    2. 7.2 UART 和 LIN 资源以及设计注意事项
    3. 7.3 I2C 和 SPI 设计注意事项
  11. 8 GPIO
    1. 8.1 GPIO 输出开关速度和负载电容
    2. 8.2 GPIO 灌电流和拉电流
    3. 8.3 高速 GPIO
    4. 8.4 开漏 GPIO 可在没有电平转换器的情况下支持 5V 通信
    5. 8.5 在没有电平转换器的情况下与 1.8V 器件通信
    6. 8.6 未使用引脚连接
  12. 9 布局指南
    1. 9.1 电源布局
    2. 9.2 接地布局注意事项
    3. 9.3 布线、过孔和其他 PCB 元件
    4. 9.4 如何选择电路板层和建议堆叠
  13. 10引导加载程序
    1. 10.1 引导加载程序简介
    2. 10.2 引导加载程序硬件设计注意事项
      1. 10.2.1 物理通信接口
      2. 10.2.2 硬件调用
  14. 11参考资料
  15. 12修订历史记录

2.1 数字电源

VCORE 稳压器

器件内部有一个低压降线性稳压器来生成一个 1.35V 电源轨，以便为器件内核供电。通常，内核稳压器输出 (VCORE) 为内核逻辑（包括 CPU、数字外设和器件存储器）供电。内核稳压器需要一个连接在器件 VCORE 引脚和 VSS（接地）之间的外部电容器 (CVCORE)（请参阅图 2-1）。有关 CVCORE 的正确值和容差，请参阅器件特定的数据表。CVCORE 应靠近 VCORE 引脚放置。

在除 SHUTDOWN 外的所有电源模式中，内核稳压器均处于运行状态。在所有其他功耗模式（RUN、SLEEP、STOP 和 STANDBY）中，稳压器的驱动强度会自动配置为支持每种模式的最大负载电流。这降低了使用低功耗模式时稳压器的静态电流，从而提高了低功耗性能。

VCORE 稳压器电路图 2-1 VCORE 稳压器电路