ZHDS072 January   2026 ADS1278QML-SP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 质量合格检验
    7. 5.7 时序要求：SPI 格式
    8. 5.8 时序要求：帧同步格式
    9. 5.9 典型特性
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1  采样孔径匹配
      2. 6.3.2  频率响应
        1. 6.3.2.1 高速、低功耗及低速模式
        2. 6.3.2.2 高分辨率模式
      3. 6.3.3  相位响应
      4. 6.3.4  趋稳时间
      5. 6.3.5  数据格式
      6. 6.3.6  模拟输入（AINP、AINN）
      7. 6.3.7  电压基准输入（VREFP、VREFN）
      8. 6.3.8  时钟输入 (CLK)
      9. 6.3.9  模式选择 (MODE)
      10. 6.3.10 同步 (SYNC)
      11. 6.3.11 断电 (PWDN)
      12. 6.3.12 Format[2:0]
      13. 6.3.13 串行接口协议
      14. 6.3.14 SPI 串行接口
        1. 6.3.14.1 SCLK
        2. 6.3.14.2 DRDY/FSYNC（SPI 格式）
        3. 6.3.14.3 DOUT
        4. 6.3.14.4 DIN
      15. 6.3.15 帧同步串行接口
        1. 6.3.15.1 SCLK
        2. 6.3.15.2 DRDY/FSYNC（帧同步格式）
        3. 6.3.15.3 DOUT
        4. 6.3.15.4 DIN
      16. 6.3.16 DOUT 模式
        1. 6.3.16.1 TDM 模式
        2. 6.3.16.2 TDM 模式，固定位置数据
        3. 6.3.16.3 TDM 模式，动态位置数据
        4. 6.3.16.4 离散数据输出模式
      17. 6.3.17 菊花链
      18. 6.3.18 调制器输出
      19. 6.3.19 使用 Test[1:0] 输入进行引脚测试
      20. 6.3.20 VCOM 输出
    4. 6.4 器件功能模式
  8. 7 应用和实施
    1. 7.1 应用信息
    2. 7.2 典型应用
      1. 7.2.1 设计要求
      2. 7.2.2 详细设计过程
      3. 7.2.3 应用曲线
    3. 7.3 电源相关建议
    4. 7.4 布局
      1. 7.4.1 布局指南
      2. 7.4.2 布局示例
  9. 8 器件和文档支持
    1. 8.1 接收文档更新通知
    2. 8.2 社区资源
    3. 8.3 商标
  10. 9 修订历史记录
  11. 10机械、封装和可订购信息

6.3.11 断电 (PWDN)

ADS1278QML-SP 的通道可以通过使用 PWDN 输入独立断电。要进入断电模式，请将相应的 PWDN 引脚保持为低电平至少两个 CLK 周期。要退出断电模式，请将相应的 PWDN 引脚恢复为高电平。请注意，当所有通道断电时， ADS1278QML-SP 将进入微瓦 (μW) 功率状态，其中所有内部偏置都被禁用。在此状态下，必须驱动 TEST[1:0] 输入引脚；所有其他输入引脚可以悬空。 ADS1278QML-SP 输出保持驱动状态。

如图 6-18 和表 6-10 所示，SPI 最多必须经历 130 个转换周期，帧同步必须经历 129 个转换周期，然后才能在退出断电模式后读取数据。来自已运行的通道的数据不受影响。用户软件可通过以下任一方式执行所需的延迟时间：

  1. 对于将 PWDN 引脚置为高电平后的数据转换次数进行计数。
  2. 将 PWDN 引脚置为高电平后延迟 129/fDATA 或 130/fDATA，然后读取数据。
  3. 检测上电通道中的非零数据。

上电一个或多个通道后，这些通道会相互同步。SYNC 引脚不一定用于同步通道。

当一个通道以 TDM 数据格式断电时，该通道的数据要么被强制为零（固定位置 TDM 数据模式）、要么通过将下一个通道的数据移动到转换的数据位置来替换（动态位置 TDM 数据模式）。

在离散数据格式中，数据始终被强制为零。在动态位置 TDM 数据格式模式下为某个通道上电时，通道数据会保持打包状态，直到数据准备就绪，此时数据帧会扩展以包含仅受电的通道数据。有关详细信息，请参阅数据格式 部分。

ADS1278QML-SP 断电时序图 6-18 断电时序
表 6-10 断电时序
符号 说明 最小值 典型值 最大值 单位
tPWDN 进入省电模式的 PWDN 脉冲宽度 2 CLK 周期
tNDR 新数据就绪时间 (SPI) 129 130 转换 (1/fDATA)
tNDR 新数据就绪时间（帧同步） 128 129 转换 (1/fDATA)