ZHCU481E october 2022 – july 2023
本节介绍了每个器件上使用的输入/输出和 CLB 逻辑块连接。
使用的 GPIO 引脚和 SPI 模块取决于特定于器件的 LaunchPad 和 BOOSTXL-POSMGR BoosterPack 引脚排列。CLB 的输入和输出连接取决于该器件的特性。使用的具体逻辑块实例取决于逻辑块覆盖 SPICLK 等其他信号的能力。表 2-11 总结了每个器件系列使用的输入/输出资源。每个器件的 I/O 图详细说明了使用了哪些 GPIO 和 CLB 逻辑块。
器件 | I/O 图 | CLB RX CRC 逻辑块 (3) | SPI 模块 | CLB 至 SPICLK | 其他 I/O |
---|---|---|---|---|---|
F2837xD | 图 2-6 | 否 | SPI-B | 外部连接 | EPWM4B 的逻辑块 4 覆盖。(1) 器件 INPUTXBAR 和 OUTPUTXBAR |
F28004x | 图 2-7 | 是 | SPI-B | 直接由 CLB 驱动 | 器件 INPUTXBAR 和 OUTPUTXBAR |
F28003x F28002x |
图 2-8 | 是 | SPI-B | 直接由 CLB 驱动 | CLB_INPUTXBAR 和 CLB_OUTPUTXBAR |
F2838x | 图 2-9 (2) | 是 | SPI-B | 直接由 CLB 驱动 | CLB_INPUTXBAR 和 CLB_OUTPUTXBAR |
F28P65x | 图 2-10 | 是 | SPI-D | 直接由 CLB 驱动 | CLB_INPUTXBAR 和 CLB_OUTPUTXBAR |