ZHCSZ17 October   2025 F28377D-SEP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
    1. 3.1 功能方框图
  5. 4 器件比较
    1. 4.1 相关产品
  6. 5 引脚配置和功能
    1. 5.1 引脚图
    2. 5.2 信号描述
      1. 5.2.1 信号说明
    3. 5.3 带有内部上拉和下拉的引脚
    4. 5.4 引脚复用
      1. 5.4.1 GPIO 多路复用引脚
      2. 5.4.2 输入 X-BAR
      3. 5.4.3 输出 X-BAR 和 ePWM X-BAR
      4. 5.4.4 USB 引脚多路复用
      5. 5.4.5 高速 SPI 引脚多路复用
    5. 5.5 未使用引脚的连接
  7. 6 规格
    1. 6.1  绝对最大额定值
    2. 6.2  ESD 等级
    3. 6.3  建议运行条件
    4. 6.4  功耗摘要
      1. 6.4.1 200MHz SYSCLK 下的器件电流消耗
      2. 6.4.2 电流消耗图
      3. 6.4.3 减少电流消耗
    5. 6.5  电气特性
    6. 6.6  热阻特征
      1. 6.6.1 PTP 封装
    7. 6.7  散热设计注意事项
    8. 6.8  系统
      1. 6.8.1  电源时序
        1. 6.8.1.1 信号引脚要求
        2. 6.8.1.2 VDDIO、VDDA、VDD3VFL 和 VDDOSC 要求
        3. 6.8.1.3 VDD 要求
        4. 6.8.1.4 电源斜升速率
          1. 6.8.1.4.1 电源斜升速率
        5. 6.8.1.5 电源监控
      2. 6.8.2  复位时序
        1. 6.8.2.1 复位源
        2. 6.8.2.2 复位电气数据和时序
          1. 6.8.2.2.1 复位 (XRS) 时序要求
          2. 6.8.2.2.2 复位 (XRS) 开关特征
      3. 6.8.3  时钟规范
        1. 6.8.3.1 时钟源
        2. 6.8.3.2 时钟频率、要求和特征
          1. 6.8.3.2.1 输入时钟频率和时序要求，PLL 锁定时间
            1. 6.8.3.2.1.1 输入时钟频率
            2. 6.8.3.2.1.2 使用外部时钟源（非晶体）时的 X1 输入电平特征
            3. 6.8.3.2.1.3 XTAL 振荡器特性
            4. 6.8.3.2.1.4 X1 时序要求
            5. 6.8.3.2.1.5 AUXCLKIN 时序要求
            6. 6.8.3.2.1.6 PLL 锁定时间
          2. 6.8.3.2.2 内部时钟频率
            1. 6.8.3.2.2.1 内部时钟频率
          3. 6.8.3.2.3 输出时钟频率和开关特征
            1. 6.8.3.2.3.1 输出时钟频率
            2. 6.8.3.2.3.2 XCLKOUT 开关特征（旁路或启用 PLL）
        3. 6.8.3.3 输入时钟和 PLL
        4. 6.8.3.4 XTAL 振荡器
          1. 6.8.3.4.1 引言
          2. 6.8.3.4.2 概述
            1. 6.8.3.4.2.1 电子振荡器
              1. 6.8.3.4.2.1.1 运行模式
                1. 6.8.3.4.2.1.1.1 晶体的工作模式
                2. 6.8.3.4.2.1.1.2 单端工作模式
              2. 6.8.3.4.2.1.2 XCLKOUT 上的 XTAL 输出
            2. 6.8.3.4.2.2 石英晶体
          3. 6.8.3.4.3 正常运行
            1. 6.8.3.4.3.1 ESR – 有效串联电阻
            2. 6.8.3.4.3.2 Rneg - 负电阻
            3. 6.8.3.4.3.3 启动时间
            4. 6.8.3.4.3.4 DL – 驱动电平
          4. 6.8.3.4.4 如何选择晶体
          5. 6.8.3.4.5 测试
          6. 6.8.3.4.6 常见问题和调试提示
          7. 6.8.3.4.7 晶体振荡器规格
            1. 6.8.3.4.7.1 晶体振荡器电气特性
            2. 6.8.3.4.7.2 晶振等效串联电阻 (ESR) 要求
        5. 6.8.3.5 内部振荡器
          1. 6.8.3.5.1 内部振荡器电气特征
      4. 6.8.4  闪存参数
        1. 6.8.4.1 闪存参数
      5. 6.8.5  RAM 规格
      6. 6.8.6  ROM 规格
      7. 6.8.7  仿真/JTAG
        1. 6.8.7.1 JTAG 电气数据和时序
          1. 6.8.7.1.1 JTAG 时序要求
          2. 6.8.7.1.2 JTAG 开关特征
      8. 6.8.8  GPIO 电气数据和时序
        1. 6.8.8.1 GPIO - 输出时序
          1. 6.8.8.1.1 通用输出开关特征
        2. 6.8.8.2 GPIO - 输入时序
          1. 6.8.8.2.1 通用输入时序要求
        3. 6.8.8.3 输入信号的采样窗口宽度
      9. 6.8.9  中断
        1. 6.8.9.1 外部中断 (XINT) 电气数据和时序
          1. 6.8.9.1.1 外部中断时序要求
          2. 6.8.9.1.2 外部中断开关特征
      10. 6.8.10 低功耗模式
        1. 6.8.10.1 时钟门控低功耗模式
        2. 6.8.10.2 电源门控低功耗模式
        3. 6.8.10.3 低功耗模式唤醒时序
          1. 6.8.10.3.1 空闲模式时序要求
          2. 6.8.10.3.2 空闲模式开关特性
          3. 6.8.10.3.3 待机模式时序要求
          4. 6.8.10.3.4 待机模式开关特征
          5. 6.8.10.3.5 停机模式时序要求
          6. 6.8.10.3.6 停机模式开关特征
          7. 6.8.10.3.7 休眠模式时序要求
          8. 6.8.10.3.8 休眠模式开关特征
      11. 6.8.11 外部存储器接口 (EMIF)
        1. 6.8.11.1 异步内存支持
        2. 6.8.11.2 同步 DRAM 支持
        3. 6.8.11.3 EMIF 电气数据和时序
          1. 6.8.11.3.1 异步 RAM
            1. 6.8.11.3.1.1 EMIF 异步内存时序要求
            2. 6.8.11.3.1.2 EMIF 异步存储器开关特性
          2. 6.8.11.3.2 同步 RAM
            1. 6.8.11.3.2.1 EMIF 同步存储器时序要求
            2. 6.8.11.3.2.2 EMIF 同步存储器开关特征
    9. 6.9  模拟外设
      1. 6.9.1 模数转换器 (ADC)
        1. 6.9.1.1 ADC 可配置性
          1. 6.9.1.1.1 信号模式
        2. 6.9.1.2 ADC 电气数据和时序
          1. 6.9.1.2.1 ADC 工作条件（16 位差分模式）
          2. 6.9.1.2.2 ADC 特征（16 位差分模式）
          3. 6.9.1.2.3 ADC 工作条件（12 位单端模式）
          4. 6.9.1.2.4 ADC 特征（12 位单端模式）
          5. 6.9.1.2.5 ADCEXTSOC 时序要求
          6. 6.9.1.2.6 ADC 输入模型
            1. 6.9.1.2.6.1 差分输入模型参数
            2. 6.9.1.2.6.2 单端输入模型参数
          7. 6.9.1.2.7 ADC 时序图
            1. 6.9.1.2.7.1 12 位模式下的 ADC 时序（SYSCLK 周期）
            2. 6.9.1.2.7.2 16 位模式下的 ADC 时序
        3. 6.9.1.3 温度传感器电气数据和时序
          1. 6.9.1.3.1 温度传感器电气特征
      2. 6.9.2 比较器子系统 (CMPSS)
        1. 6.9.2.1 CMPSS 电气数据和时序
          1. 6.9.2.1.1 比较器电气特性
          2. 6.9.2.1.2 CMPSS DAC 静态电气特性
      3. 6.9.3 缓冲数模转换器 (DAC)
        1. 6.9.3.1 缓冲 DAC 电气数据和时序
          1. 6.9.3.1.1 缓冲 DAC 电气特性
        2. 6.9.3.2 CMPSS DAC 动态误差
    10. 6.10 控制外设
      1. 6.10.1 增强型采集 (eCAP)
        1. 6.10.1.1 eCAP 电气数据和时序
          1. 6.10.1.1.1 eCAP 时序要求
          2. 6.10.1.1.2 eCAP 开关特征
      2. 6.10.2 增强型脉宽调制器 (ePWM)
        1. 6.10.2.1 控制外设同步
        2. 6.10.2.2 ePWM 电气数据和时序
          1. 6.10.2.2.1 ePWM 时序要求
          2. 6.10.2.2.2 ePWM 开关特征
          3. 6.10.2.2.3 跳变区输入时序
            1. 6.10.2.2.3.1 跳变区输入时序要求
        3. 6.10.2.3 外部 ADC 转换启动电气数据和时序
          1. 6.10.2.3.1 外部 ADC 转换启动开关特征
      3. 6.10.3 增强型正交编码器脉冲 (eQEP)
        1. 6.10.3.1 eQEP 电气数据和时序
          1. 6.10.3.1.1 eQEP 时序要求
          2. 6.10.3.1.2 eQEP 开关特征
      4. 6.10.4 高分辨率脉宽调制器 (HRPWM)
        1. 6.10.4.1 HRPWM 电气数据和时序
          1. 6.10.4.1.1 高分辨率 PWM 时序要求
          2. 6.10.4.1.2 高分辨率 PWM 特征
      5. 6.10.5 Σ-Δ 滤波器模块 (SDFM)
        1. 6.10.5.1 SDFM 电气数据和时序（使用 ASYNC）
          1. 6.10.5.1.1 使用异步 GPIO (ASYNC) 选项时的 SDFM 时序要求
        2. 6.10.5.2 SDFM 电气数据和时序（使用 3 样片 GPIO 输入限定）：
          1. 6.10.5.2.1 使用 GPIO 输入限定（3 样本窗口）选项时的 SDFM 时序要求
    11. 6.11 通信外设
      1. 6.11.1 控制器局域网络 (CAN)
      2. 6.11.2 内部集成电路 (I2C)
        1. 6.11.2.1 I2C 电气数据和时序
          1. 6.11.2.1.1 I2C 时序要求
          2. 6.11.2.1.2 I2C 开关特征
          3. 6.11.2.1.3 I2C 时序图
      3. 6.11.3 多通道缓冲串行端口 (McBSP)
        1. 6.11.3.1 McBSP 电气数据和时序
          1. 6.11.3.1.1 McBSP 传输和接收时序
            1. 6.11.3.1.1.1 McBSP 时序要求
            2. 6.11.3.1.1.2 McBSP 开关特征
          2. 6.11.3.1.2 McBSP 作为 SPI 主器件或从器件时序
            1. 6.11.3.1.2.1 McBSP 作为 SPI 主器件的时序要求
            2. 6.11.3.1.2.2 McBSP 作为 SPI 主器件开关特征
            3. 6.11.3.1.2.3 McBSP 作为 SPI 从器件的时序要求
            4. 6.11.3.1.2.4 McBSP 作为 SPI 从器件开关特性
      4. 6.11.4 串行通信接口 (SCI)
      5. 6.11.5 串行外设接口 (SPI)
        1. 6.11.5.1 SPI 电气数据和时序
          1. 6.11.5.1.1 SPI 主模式时序
            1. 6.11.5.1.1.1 SPI 主模式时序要求
            2. 6.11.5.1.1.2 SPI 主模式开关特征（时钟相位 = 0）
            3. 6.11.5.1.1.3 SPI 主模式开关特征（时钟相位 = 1）
          2. 6.11.5.1.2 SPI 从模式时序
            1. 6.11.5.1.2.1 SPI 从模式时序要求
            2. 6.11.5.1.2.2 SPI 从模式开关特征
      6. 6.11.6 通用串行总线(USB)控制器
        1. 6.11.6.1 USB 电气数据和时序
          1. 6.11.6.1.1 USB 输入端口 DP 和 DM 时序要求
          2. 6.11.6.1.2 USB 输出端口 DP 和 DM 开关特征
      7. 6.11.7 通用并行端口 (uPP) 接口
        1. 6.11.7.1 uPP 电气数据和时序
          1. 6.11.7.1.1 uPP 时序要求
          2. 6.11.7.1.2 uPP 开关特征
  8. 7 详细说明
    1. 7.1  概述
    2. 7.2  功能方框图
    3. 7.3  存储器
      1. 7.3.1 C28x 存储器映射
      2. 7.3.2 闪存映射
      3. 7.3.3 EMIF 芯片选择存储器映射
      4. 7.3.4 外设寄存器内存映射
      5. 7.3.5 存储器类型
        1. 7.3.5.1 专用 RAM（Mx 和 Dx RAM）
        2. 7.3.5.2 本地共享 RAM (LSx RAM)
        3. 7.3.5.3 全局共享 RAM (GSx RAM)
        4. 7.3.5.4 CPU 消息 RAM (CPU MSGRAM)
        5. 7.3.5.5 CLA 消息 RAM (CLA MSGRAM)
    4. 7.4  标识
    5. 7.5  总线架构 - 外设连接
    6. 7.6  C28x 处理器
      1. 7.6.1 浮点单元
      2. 7.6.2 三角函数加速器
      3. 7.6.3 Viterbi、复杂数学和 CRC 单元 II (VCU-II)
    7. 7.7  控制律加速器
    8. 7.8  直接存储器存取
    9. 7.9  处理器间通信模块
    10. 7.10 引导 ROM 和外设引导
      1. 7.10.1 EMU 引导或仿真引导
      2. 7.10.2 等待引导模式
      3. 7.10.3 获取模式
      4. 7.10.4 引导加载器使用的外设引脚
    11. 7.11 双代码安全模块
    12. 7.12 计时器
    13. 7.13 带有看门狗计时器的非可屏蔽中断 (NMIWD)
    14. 7.14 看门狗
  9. 8 应用、实现和布局
    1. 8.1 应用和实施
    2. 8.2 器件主要特性
    3. 8.3 应用信息
      1. 8.3.1 典型应用
        1. 8.3.1.1 微型光伏逆变器
          1. 8.3.1.1.1 系统方框图
          2. 8.3.1.1.2 微型光伏逆变器资源
        2. 8.3.1.2 车载充电器 (OBC)
          1. 8.3.1.2.1 系统方框图
          2. 8.3.1.2.2 OBC 资源
        3. 8.3.1.3 电动汽车充电站电源模块
          1. 8.3.1.3.1 系统方框图
          2. 8.3.1.3.2 电动汽车充电站电源模块资源
  10. 9 器件和文档支持
    1. 9.1 器件和开发支持工具命名规则
    2. 9.2 标识
    3. 9.3 工具与软件
    4. 9.4 文档支持
    5. 9.5 支持资源
    6. 9.6 商标
    7. 9.7 静电放电警告
    8. 9.8 出口管制提示
    9. 9.9 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息
    1. 11.1 封装信息

7.3.4 外设寄存器内存映射

外设寄存器内存映射可参阅表 7-4 。外设寄存器可以分配给 CPU1 或 CPU2 子系统，除非表 7-4 中另有说明。外设帧中的寄存器与同一外设帧中的所有其他寄存器共享一个二级主控（CLA 或 DMA）选项。有关 CPU 子系统和二级主控选项的详细信息，请参阅 TMS320F2837xD 双核实时微控制器技术参考手册。

注： 器件外设都不具备程序总线访问权限。
表 7-4 外设寄存器内存映射
寄存器 结构名称 起始
地址		 结束
地址		 受保护(1) CLA
存取		 DMA
存取
AdcaResultRegs ADC_RESULT_REGS 0x0000 0B00 0x0000 0B1F 是 是
AdcbResultRegs ADC_RESULT_REGS 0x0000 0B20 0x0000 0B3F 是 是
AdccResultRegs ADC_RESULT_REGS 0x0000 0B40 0x0000 0B5F 是 是
AdcdResultRegs ADC_RESULT_REGS 0x0000 0B60 0x0000 0B7F 是 是
CpuTimer0Regs(2) CPUTIMER_REGS 0x0000 0C00 0x0000 0C07
CpuTimer1Regs(2) CPUTIMER_REGS 0x0000 0C08 0x0000 0C0F
CpuTimer2Regs(2) CPUTIMER_REGS 0x0000 0C10 0x0000 0C17
PieCtrlRegs(2)(5) PIE_CTRL_REGS 0x0000 0CE0 0x0000 0CFF
Cla1SoftIntRegs(5) CLA_SOFTINT_REGS 0x0000 0CE0 0x0000 0CFF 是 - 仅限 CLA，对 CPU 无访问权限
DmaRegs(2) DMA_REGS 0x0000 1000 0x0000 11FF
Cla1Regs(2) CLA_REGS 0x0000 1400 0x0000 147F
外设帧 1
EPwm1Regs EPWM_REGS 0x0000 4000 0x0000 40FF 是 是 是
EPwm2Regs EPWM_REGS 0x0000 4100 0x0000 41FF 是 是 是
EPwm3Regs EPWM_REGS 0x0000 4200 0x0000 42FF 是 是 是
EPwm4Regs EPWM_REGS 0x0000 4300 0x0000 43FF 是 是 是
EPwm5Regs EPWM_REGS 0x0000 4400 0x0000 44FF 是 是 是
EPwm6Regs EPWM_REGS 0x0000 4500 0x0000 45FF 是 是 是
EPwm7Regs EPWM_REGS 0x0000 4600 0x0000 46FF 是 是 是
EPwm8Regs EPWM_REGS 0x0000 4700 0x0000 47FF 是 是 是
EPwm9Regs EPWM_REGS 0x0000 4800 0x0000 48FF 是 是 是
EPwm10Regs EPWM_REGS 0x0000 4900 0x0000 49FF 是 是 是
EPwm11Regs EPWM_REGS 0x0000 4A00 0x0000 4AFF 是 是 是
EPwm12Regs EPWM_REGS 0x0000 4B00 0x0000 4BFF 是 是 是
ECap1Regs ECAP_REGS 0x0000 5000 0x0000 501F 是 是 是
ECap2Regs ECAP_REGS 0x0000 5020 0x0000 503F 是 是 是
ECap3Regs ECAP_REGS 0x0000 5040 0x0000 505F 是 是 是
ECap4Regs ECAP_REGS 0x0000 5060 0x0000 507F 是 是 是
ECap5Regs ECAP_REGS 0x0000 5080 0x0000 509F 是 是 是
ECap6Regs ECAP_REGS 0x0000 50A0 0x0000 50BF 是 是 是
EQep1Regs EQEP_REGS 0x0000 5100 0x0000 513F 是 是 是
EQep2Regs EQEP_REGS 0x0000 5140 0x0000 517F 是 是 是
EQep3Regs EQEP_REGS 0x0000 5180 0x0000 51BF 是 是 是
DacaRegs DAC_REGS 0x0000 5C00 0x0000 5C0F 是 是 是
DacbRegs DAC_REGS 0x0000 5C10 0x0000 5C1F 是 是 是
DaccRegs DAC_REGS 0x0000 5C20 0x0000 5C2F 是 是 是
Cmpss1Regs CMPSS_REGS 0x0000 5C80 0x0000 5C9F 是 是 是
Cmpss2Regs CMPSS_REGS 0x0000 5CA0 0x0000 5CBF 是 是 是
Cmpss3Regs CMPSS_REGS 0x0000 5CC0 0x0000 5CDF 是 是 是
Cmpss4Regs CMPSS_REGS 0x0000 5CE0 0x0000 5CFF 是 是 是
Cmpss5Regs CMPSS_REGS 0x0000 5D00 0x0000 5D1F 是 是 是
Cmpss6Regs CMPSS_REGS 0x0000 5D20 0x0000 5D3F 是 是 是
Cmpss7Regs CMPSS_REGS 0x0000 5D40 0x0000 5D5F 是 是 是
Cmpss8Regs CMPSS_REGS 0x0000 5D60 0x0000 5D7F 是 是 是
Sdfm1Regs SDFM_REGS 0x0000 5E00 0x0000 5E7F 是 是 是
Sdfm2Regs SDFM_REGS 0x0000 5E80 0x0000 5EFF 是 是 是
外设帧 2
McbspaRegs MCBSP_REGS 0x0000 6000 0x0000 603F 是 是 是
McbspbRegs MCBSP_REGS 0x0000 6040 0x0000 607F 是 是 是
SpiaRegs SPI_REGS 0x0000 6100 0x0000 610F 是 是 是
SpibRegs SPI_REGS 0x0000 6110 0x0000 611F 是 是 是
SpicRegs SPI_REGS 0x0000 6120 0x0000 612F 是 是 是
UppRegs(3) UPP_REGS 0x0000 6200 0x0000 62FF 是 是 是
 
WdRegs(2) WD_REGS 0x0000 7000 0x0000 703F 是
NmiIntruptRegs(2) NMI_INTRUPT_REGS 0x0000 7060 0x0000 706F 是
XintRegs(2) XINT_REGS 0x0000 7070 0x0000 707F 是
SciaRegs SCI_REGS 0x0000 7200 0x0000 720F 是
ScibRegs SCI_REGS 0x0000 7210 0x0000 721F 是
ScicRegs SCI_REGS 0x0000 7220 0x0000 722F 是
ScidRegs SCI_REGS 0x0000 7230 0x0000 723F 是
I2caRegs I2C_REGS 0x0000 7300 0x0000 733F 是
I2cbRegs I2C_REGS 0x0000 7340 0x0000 737F 是
AdcaRegs ADC_REGS 0x0000 7400 0x0000 747F 是 是
AdcbRegs ADC_REGS 0x0000 7480 0x0000 74FF 是 是
AdccRegs ADC_REGS 0x0000 7500 0x0000 757F 是 是
AdcdRegs ADC_REGS 0x0000 7580 0x0000 75FF 是 是
InputXbarRegs(3) INPUT_XBAR_REGS 0x0000 7900 0x0000 791F 是
XbarRegs(3) XBAR_REGS 0x0000 7920 0x0000 793F 是
TrigRegs(3) TRIG_REGS 0x0000 7940 0x0000 794F 是
DmaClaSrcSelRegs(2) DMA_CLA_SRC_SEL_REGS 0x0000 7980 0x0000 798F 是
EPwmXbarRegs(3) EPWM_XBAR_REGS 0x0000 7A00 0x0000 7A3F 是
OutputXbarRegs(3) OUTPUT_XBAR_REGS 0x0000 7A80 0x0000 7ABF 是
GpioCtrlRegs(3) GPIO_CTRL_REGS 0x0000 7C00 0x0000 7D7F 是
GpioDataRegs(2) GPIO_DATA_REGS 0x0000 7F00 0x0000 7F2F 是 是
UsbaRegs(3) USB_REGS 0x0004 0000 0x0004 0FFF 是
Emif1Regs EMIF_REGS 0x0004 7000 0x0004 77FF 是
Emif2Regs(3) EMIF_REGS 0x0004 7800 0x0004 7FFF 是
CanaRegs CAN_REGS 0x0004 8000 0x0004 87FF 是
CanbRegs CAN_REGS 0x0004 A000 0x0004 A7FF 是
IpcRegs(2) IPC_REGS_CPU1
IPC_REGS_CPU2		 0x0005 0000 0x0005 0023 是
FlashPumpSemaphoreRegs(2) FLASH_PUMP_SEMAPHORE_REGS 0x0005 0024 0x0005 0025 是
DevCfgRegs(3) DEV_CFG_REGS 0x0005 D000 0x0005 D17F 是
AnalogSubsysRegs(3) ANALOG_SUBSYS_REGS 0x0005 D180 0x0005 D1FF 是
ClkCfgRegs(4) CLK_CFG_REGS 0x0005 D200 0x0005 D2FF 是
CpuSysRegs(2) CPU_SYS_REGS 0x0005 D300 0x0005 D3FF 是
RomPrefetchRegs(3) ROM_PREFETCH_REGS 0x0005 E608 0x0005 E60B 是
DcsmZ1Regs(2) DCSM_Z1_REGS 0x0005 F000 0x0005 F02F 是
DcsmZ2Regs(2) DCSM_Z2_REGS 0x0005 F040 0x0005 F05F 是
DcsmCommonRegs(2) DCSM_COMMON_REGS 0x0005 F070 0x0005 F07F 是
MemCfgRegs(2) MEM_CFG_REGS 0x0005 F400 0x0005 F47F 是
Emif1ConfigRegs(2) EMIF1_CONFIG_REGS 0x0005 F480 0x0005 F49F 是
Emif2ConfigRegs(3) EMIF2_CONFIG_REGS 0x0005 F4A0 0x0005 F4BF 是
AccessProtectionRegs(2) ACCESS_PROTECTION_REGS 0x0005 F4C0 0x0005 F4FF 是
MemoryErrorRegs(2) MEMORY_ERROR_REGS 0x0005 F500 0x0005 F53F 是
RomWaitStateRegs(3) ROM_WAIT_STATE_REGS 0x0005 F540 0x0005 F541 是
Flash0CtrlRegs(2) FLASH_CTRL_REGS 0x0005 F800 0x0005 FAFF 是
Flash0EccRegs(2) FLASH_ECC_REGS 0x0005 FB00 0x0005 FB3F 是
(1) CPU（不适用于 CLA 或 DMA）包含先写后读保护模式，以确保在受保护地址范围内，通过延迟读取操作直至启动写入操作，以按写入式执行写入操作之后的任何读取操作。
(2) 这些寄存器的唯一副本存在于每个 CPU 子系统上。
(3) 这些寄存器仅在 CPU1 子系统上可用。
(4) 这些寄存器根据信标映射到 CPU1 或 CPU2。
(5) PieCtrlRegs 和 Cla1SoftIntRegs 的地址重叠是正确的。每个 CPU、C28x 和 CLA 只能访问其中一个寄存器组。