ZHCST23 December   2024 ADC168M102R-SEP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 时序要求
    7. 5.7 开关特性
    8. 5.8 时序图
    9. 5.9 典型特性
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 模拟
        1. 6.3.1.1 模拟输入
        2. 6.3.1.2 模数转换器（ADC）
        3. 6.3.1.3 CONVST
        4. 6.3.1.4 时钟
        5. 6.3.1.5 复位
        6. 6.3.1.6 REFIOx
      2. 6.3.2 数字
        1. 6.3.2.1 M0 和 M1 的模式选择引脚
        2. 6.3.2.2 半时钟模式（上电与复位后的默认模式）
        3. 6.3.2.3 全时钟模式（双路输出模式下，能够在 1µs 内进行转换与数据读取）
        4. 6.3.2.4 2 位计数器
    4. 6.4 器件功能模式
      1. 6.4.1 断电模式和复位
        1. 6.4.1.1 断电模式
        2. 6.4.1.2 睡眠模式
        3. 6.4.1.3 自动休眠模式
        4. 6.4.1.4 复位
    5. 6.5 编程
      1. 6.5.1 读取数据输入 (RD)
      2. 6.5.2 串行数据输出 (SDOx)
        1. 6.5.2.1 模式 I
        2. 6.5.2.2 模式 II（仅限半时钟模式）
        3. 6.5.2.3 特殊读取模式 II（仅限半时钟模式）
        4. 6.5.2.4 模式 III
        5. 6.5.2.5 全差分模式 IV（仅限半时钟模式）
        6. 6.5.2.6 特殊模式 IV（仅限半时钟模式）
      3. 6.5.3 对基准 DAC 进行编程
  8. 7 寄存器映射
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
      3. 8.2.3 应用曲线
    3. 8.3 电源相关建议
    4. 8.4 布局
      1. 8.4.1 布局指南
        1. 8.4.1.1 接地
        2. 8.4.1.2 数字接口
      2. 8.4.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 静电放电警告
    3. 9.3 术语表
    4. 9.4 商标
    5. 9.5 接收文档更新通知
    6. 9.6 支持资源
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

6.5.2.2 模式 II（仅限半时钟模式）

当 M0 = 0 且 M1 = 1 时，ADC168M102R-SEP 也会在手动通道控制模式下运行。在该模式下，仅当 SDOB 设置为高阻抗时，该器件才在 SDOA 引脚上输出数据。所有其它引脚的工作方式与模式 I 中的工作方式一样。

在半时钟模式下，该器件执行完整的读取周期需要 2μs。之所以有此要求，是因为需要 40 个时钟周期才能输出两个 ADC 的结果（而不是 M1 = 0 时所需的 20 个周期）。如 图 6-6 所示,如果像模式 I 一样，每 1.0μs（RD 信号需要）发出一次 CONVST 信号，则每隔一个脉冲忽略一次。确保 CONVST 和 RD 信号不超过一个时钟周期，以提供正常功能并避免输出数据损坏。

该运行模式不支持全时钟模式。

输出数据由 0、ADC 指示符和 16 位转换结果组成，后接尾零。对于 CHAx，ADC 指示符为 0；对于 CHBx，ADC 指示符为 1。

该模式用于全差分或伪差分输入。仅当 CID 为 0 时，通道信息在全差分模式下有效。当通道位在伪差分模式下无效时，CID 包含正确的 ADC 信息。在该模式下，FIFO 不可用。

对 FE、SR、PDE 和 CID 寄存器位的更改从下一次转换开始激活，并延迟一次读取访问。

每隔一个 RD 脉冲更新一次寄存器设置。如 图 6-6 所示，将这些脉冲与启动转换的脉冲或读取通道 B 的转换结果的脉冲对齐。

ADC168M102R-SEP 模式 II 时序（M0 = 0，M1 = 1，PDE = 0，CID = 0，伪差分示例）图 6-6 模式 II 时序（M0 = 0，M1 = 1，PDE = 0，CID = 0，伪差分示例）