ZHCSW60B
April 2024 – August 2025
IWRL6432AOP
PRODUCTION DATA
1
1
特性
2
应用
3
说明
4
功能方框图
5
器件比较
5.1
相关产品
6
终端配置和功能
6.1
引脚图
10
6.2
信号说明
12
13
14
15
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18
19
20
21
22
23
24
25
26
27
7
规格
7.1
绝对最大额定值
7.2
ESD 等级
7.3
上电小时数 (POH)
7.4
建议运行条件
7.5
一次性可编程 (OTP) 电子保险丝的 VPP 规格
7.5.1
OTP 电子保险丝编程的建议运行条件
7.5.2
硬件要求
7.5.3
对硬件保修的影响
7.6
电源规格
7.6.1
低功耗 3.3V I/O 拓扑
7.6.2
低功耗 1.8V I/O 拓扑
7.6.3
BOM 优化的 3.3V I/O 拓扑
7.6.4
BOM 优化的 1.8V I/O 拓扑
7.6.5
系统拓扑
7.6.5.1
电源拓扑
7.6.5.1.1
BOM 优化模式
7.6.5.1.2
低功耗模式
7.6.6
BOM 优化型拓扑的内部 LDO 输出去耦电容器和布局条件
7.6.6.1
单电容器轨
7.6.6.1.1
1.2V 数字 LDO
7.6.6.2
双电容器轨
7.6.6.2.1
1.2V 射频 LDO
7.6.6.2.2
1.2V SRAM LDO
7.6.6.2.3
1.0V 射频 LDO
7.6.7
噪声和纹波规格
7.7
节电模式
7.7.1
功耗典型数值
7.8
每个电压轨的峰值电流要求
7.9
支持的 DFE 特性
7.10
射频规格
7.11
CPU 规格
7.12
热阻特性
7.13
天线辐射方向图
7.13.1
接收器的天线辐射方向图
7.13.2
发送器的天线辐射方向图
7.14
天线位置
7.15
时序和开关特性
7.15.1
电源时序和复位时序
7.15.2
同步帧触发
7.15.3
输入时钟和振荡器
7.15.3.1
时钟规格
7.15.4
多通道缓冲/标准串行外设接口 (McSPI)
7.15.4.1
McSPI 特性
7.15.4.2
SPI 时序条件
7.15.4.3
SPI - 控制器模式
7.15.4.3.1
SPI 的时序和开关要求 - 控制器模式
7.15.4.3.2
SPI 输出时序的时序和开关特性 - 控制器模式
7.15.4.4
SPI - 外设模式
7.15.4.4.1
SPI 的时序和开关要求 — 外设模式
7.15.4.4.2
SPI 输出时序的时序和开关特性 - 次级模式
7.15.5
RDIF 接口配置
7.15.5.1
RDIF 接口时序
7.15.5.2
RDIF 数据格式
7.15.6
通用输入/输出
7.15.6.1
输出时序的开关特性与负载电容 (CL) 间的关系
7.15.7
控制器局域网 - 灵活数据速率 (CAN-FD)
7.15.7.1
CANx TX 和 RX 引脚的动态特性
7.15.8
串行通信接口 (SCI)
7.15.8.1
SCI 时序要求
7.15.9
内部集成电路接口 (I2C)
7.15.9.1
I2C 时序要求
7.15.10
四线串行外设接口 (QSPI)
7.15.10.1
QSPI 时序条件
7.15.10.2
QSPI 输入(读取)时序的时序要求
7.15.10.3
QSPI 开关特性
7.15.11
JTAG 接口
7.15.11.1
JTAG 时序条件
7.15.11.2
IEEE 1149.1 JTAG 的时序要求
7.15.11.3
IEEE 1149.1 JTAG 在推荐工作条件下的开关特性
8
详细说明
8.1
概述
8.2
功能方框图
8.3
子系统
8.3.1
射频 (RF) 和模拟子系统
8.3.2
时钟子系统
8.3.3
发送子系统
8.3.4
接收子系统
8.3.5
处理器子系统
8.3.6
主机接口
8.3.7
应用子系统 Cortex-M4F
8.3.8
硬件加速器 (HWA1.2) 特性
8.3.8.1
HWA1.1 和 HWA1.2 之间的硬件加速器特性差异
8.4
其他子系统
8.4.1
用于用户应用的 GPADC 通道(服务)
8.4.2
GPADC 参数
8.5
存储器分区示例
8.6
引导模式
9
应用、实施和布局
9.1
应用信息
9.2
参考原理图
10
器件和文档支持
10.1
器件命名规则
10.2
工具与软件
10.3
文档支持
10.4
支持资源
10.5
商标
10.6
静电放电警告
10.7
术语表
11
修订历史记录
12
机械、封装和可订购信息
封装选项
机械数据 (封装 | 引脚)
AMY|101
散热焊盘机械数据 (封装 | 引脚)
订购信息
zhcsw60b_oa
1
特性
FMCW 收发器
集成 PLL、发送器、接收器、基带和 ADC
57GHz 至 63.5GHz 的覆盖范围,具有 6.5GHz 的连续带宽
距离通常可达 20m
FMCW 运行
5MHz IF 带宽,仅实部 Rx 通道
基于分数 N PLL 的超精确线性调频脉冲引擎
集成 3 个接收通道和 2 个发送通道的封装天线 (AOP)
处理元件
具有单精度 FPU (160MHz) 的
Arm®
M4F®
内核
用于 FFT、对数幅度和 CFAR 运算 (80MHz) 的 TI 雷达硬件加速器 (HWA 1.2)
支持多个低功耗模式
空闲模式和深度睡眠模式
电源管理
1.8V 和 3.3V IO 支持
内置 LDO 网络,可增强 PSRR
BOM 优化模式和低功耗模式
一个或两个电源轨适用于 1.8V IO 模式,两个或三个电源轨适用于 3.3V IO 模式
内置校准
内置的固件 (ROM)
片上自包含校准系统
主机接口
UART
CAN-FD
SPI
用于原始 ADC 样本采集的 RDIF(雷达数据接口)
为用户应用提供的其他接口
QSPI
I2C
JTAG
GPIO
PWM 接口
内部存储器
1MB 片上 RAM
用于雷达立方体的可配置 L3 共享存储器
(512/640/768KB) 的数据和代码 RAM
轻松的硬件设计
0.5mm 间距、101-BGA、10.9mm × 6.7mm AMY 封装,可实现轻松组装和低成本 PCB 设计
小尺寸
时钟源
用于主时钟的 40.0MHz 晶体
支持外部驱动、频率为 40.0MHz 的时钟(方波/正弦波)
用于低功耗运行的 32kHz 内部振荡器
支持工作温度范围
工作结温范围:-40°C 至 105°C