ZHCAG06 November   2025 AM620-Q1 , AM623 , AM625 , AM625-Q1 , AM62A1-Q1 , AM62A3 , AM62A3-Q1 , AM62A7 , AM62A7-Q1 , AM62D-Q1

 

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  2.   摘要
  3.   如何使用本文档
  4.   商标
  5. 1数字音频格式
    1. 1.1 I2S
    2. 1.2 TDM
  6. 2McASP 概览
  7. 3AM62x 器件的 McASP 连接
    1. 3.1 McASP 常见配置
      1. 3.1.1 McASP 作为时钟控制器
        1. 3.1.1.1 使用 AUDIO_EXT_REFCLK AHCLK 源生成的时钟
      2. 3.1.2 McASP 作为时钟外设
  8. 4McASP 布局注意事项
    1. 4.1 与引导模式逻辑共享的 McASP 信号
    2. 4.2 单时钟域中多个器件的 McASP 拓扑
  9. 5McASP 实际示例
    1. 5.1 对两个时钟域使用 AUDIO_EXT_REFCLK 的音频播放
    2. 5.2 使用外部时钟源及 McASP 同步模式进行音频播放
  10. 6音频系统设计要点
  11. 7参考资料

3.1.1.1 使用 AUDIO_EXT_REFCLK AHCLK 源生成的时钟

以下部分详细介绍了 McASP 的示例设置，其中位时钟和帧同步配置为输出，并使用外部源通过 AUDIO_EXT_REFCLK 作为直接连接到 AHCLK 的时钟基准生成。

说明 AHCLK 位时钟 帧同步
具备外部 AHCLK 输入基准的 McASP 时钟控制器 外部生成 内部生成 内部生成

在本例中，McASP 配置为具有 32 位字的 48kHz 帧同步和 TDM8 帧格式，从而使位时钟频率为 12.288MHz。当 AHCLK 配置为外部生成时，不考虑 AUXCLK。每个 AHCLK 都有一个唯一多路复用器来选择不同外部源。AHCLK 多路复用器配置为指向来自外部驱动器的 AUDIO_EXT_REFCLK0 源，即 24.576MHz。SDK 驱动程序会根据时隙数、帧同步频率以及帧同步与 AHCLK 之间的比率来设置 ACLK 分频器。

当从外部生成 AHCLK 时，无法在 AUDIO_EXT_REFCLK 上输出 AHCLK。

具备 AUDIO_EXT_REFCLK0 AHCLK 基准的 McASP 时钟控制器图 3-4 具备 AUDIO_EXT_REFCLK0 AHCLK 基准的 McASP 时钟控制器