ZHCSV46J July 2007 – June 2025 CDCE925 , CDCEL925
PRODUCTION DATA
CDCE925 和 CDCEL925 器件是基于 PLL 的低成本、高性能、模块化可编程时钟合成器、倍频器和分频器。它们最多可从单个输入频率中生成五个输出时钟。借助两个集成的可配置 PLL 之一，可在系统内针对任何时钟频率（高达 230MHz）对每个输出进行编程。
CDCx925 具有单独的输出电源引脚 (VDDOUT)，对于 CDCEL925，此引脚上的电压为 1.8V，而对于 CDCE925，此引脚上的电压为 2.5V 至 3.3V。
该输入接受一个外部晶体或 LVCMOS 时钟信号。如果使用了外部晶振，对于大多数应用来说，一个片载负载电容器就足够用了。负载电容器的值可在 0pF 至 20pF 的范围内进行编程。此外，还可以选择片上 VCXO，从而使输出频率与外部控制信号（即 PWM 信号）同步。
深 M/N 分频比允许从基准输入频率（例如 27MHz）生成 0ppm 音频和视频、网络（WLAN、BlueTooth、以太网、GPS）或接口（USB、IEEE1394、Memory Stick）时钟。
所有 PLL 均支持展频时钟 (SSC)。SSC 可以是中心展频或向下展频时钟。这是一种降低电磁干扰 (EMI) 的常用技术。
根据 PLL 频率和分频器设置，自动调整内部环路滤波器元件以实现高稳定性，并优化每个 PLL 的抖动传输特性。
为了在应用中轻松实现器件自定义，该器件支持使用非易失性 EEPROM 进行编程。它预设为出厂默认配置（请参阅 默认器件配置）。该器件可以在 PCB 组装之前重新编程为不同的应用配置，或者通过系统内编程进行重新编程。所有器件设置均可通过 SDA 和 SCL 总线（一种两线制串行接口）进行编程。
三个可自由编程控制输入 S0、S1 和 S2 可用于控制操作的各个方面，包括频率选择、更改 SSC 参数以降低 EMI、PLL 旁路、断电，或其他控制特征，如输出禁用为低、输出处于高阻抗状态等。
CDCx925 在 1.8V 电压下工作，工作温度范围为 –40°C 至 85°C。