ZHCSUP0A March   2024  – September 2024 DLPC964

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 时序要求
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 输入高速串行 (HSS) 接口
      2. 6.3.2 块接口
      3. 6.3.3 控制接口
        1. 6.3.3.1 看门狗
        2. 6.3.3.2 LOAD2
          1. 6.3.3.2.1 LOAD2 行寻址
          2. 6.3.3.2.2 LOAD2 块清除
        3. 6.3.3.3 接收器低功耗模式启用
        4. 6.3.3.4 DMD 高速串行接口 (HSSI) 复位
        5. 6.3.3.5 DMD 电源使能
      4. 6.3.4 用户 K-Data 接口
      5. 6.3.5 状态接口
        1. 6.3.5.1 INIT_DONE
        2. 6.3.5.2 MCP_ACTIVE
        3. 6.3.5.3 BLKLOADZ
        4. 6.3.5.4 高速串行接口 (HSSI) 总线错误
        5. 6.3.5.5 IRQZ
      6. 6.3.6 复位、系统时钟和电源正常
        1. 6.3.6.1 控制器复位
        2. 6.3.6.2 主振荡器时钟
        3. 6.3.6.3 DMD HSSI 总线振荡器时钟
        4. 6.3.6.4 POWERGOOD 和 DMDPOWERGOOD
      7. 6.3.7 I2C 接口
        1. 6.3.7.1 配置引脚
        2. 6.3.7.2 通信接口
          1. 6.3.7.2.1 命令格式
      8. 6.3.8 DMD (HSSI) 接口
        1. 6.3.8.1 Park 控制
        2. 6.3.8.2 可配置 HSSI 设置
      9. 6.3.9 闪存 PROM 接口
        1. 6.3.9.1 JTAG 接口
    4. 6.4 器件功能模式
      1. 6.4.1 DLPC964 Aurora 64B/66B 输入数据和命令写入周期
        1. 6.4.1.1 块模式运行（块以块控制字开始）
          1. 6.4.1.1.1 块清除和块置位
          2. 6.4.1.1.2 图像方向 - 块加载递增/递减
          3. 6.4.1.1.3 单通道模式
        2. 6.4.1.2 DMD 位平面数据输入（四路输入模式）
        3. 6.4.1.3 DMD 位平面数据输入（单路输入模式）
        4. 6.4.1.4 块完成（DMDLOAD_REQ 和 BLKLOADZ）
      2. 6.4.2 DMD 行操作
      3. 6.4.3 块载入地址选择
      4. 6.4.4 块模式选择
      5. 6.4.5 微镜时钟脉冲 (MCP)
    5. 6.5 寄存器映射
      1. 6.5.1 寄存器表概述
        1. 6.5.1.1  FPGA_INTERRUPT_STATUS 寄存器
        2. 6.5.1.2  FPGA_INTERRUPT_ENABLE_CONTROL 寄存器
        3. 6.5.1.3  FPGA_MAIN_STATUS 寄存器
        4. 6.5.1.4  FPGA_VERSION 寄存器
        5. 6.5.1.5  FPGA_MAIN_CTRL 寄存器
        6. 6.5.1.6  SELF_TEST_REG 寄存器
        7. 6.5.1.7  DMDIF_ERROR_STATUS_CLR 寄存器
        8. 6.5.1.8  DMDIF_ERROR_STATUS 寄存器
        9. 6.5.1.9  PRBS7_MACRO0_TEST_RESULT 寄存器
        10. 6.5.1.10 PRBS7_MACRO1_TEST_RESULT 寄存器
        11. 6.5.1.11 PRBS7_MACRO2_TEST_RESULT 寄存器
        12. 6.5.1.12 PRBS7_MACRO3_TEST_RESULT 寄存器
        13. 6.5.1.13 PRBS7_TEST_CONTROL 寄存器
        14. 6.5.1.14 PRBS7_TEST_RUNSTATUS 寄存器
        15. 6.5.1.15 LS_BUS_TEST_RESULT 寄存器
        16. 6.5.1.16 DMD_TYPE 寄存器
        17. 6.5.1.17 HSS_RESET 寄存器
        18. 6.5.1.18 HSS_CHANNEL_STATUS 寄存器
        19. 6.5.1.19 HSS_LANE_STATUS 寄存器
        20. 6.5.1.20 HSS_CH0_SOFTERROR_COUNT 寄存器
        21. 6.5.1.21 HSS_CH1_SOFTERROR_COUNT 寄存器
        22. 6.5.1.22 HSS_CH2_SOFTERROR_COUNT 寄存器
        23. 6.5.1.23 HSS_CH3_SOFTERROR_COUNT 寄存器
        24. 6.5.1.24 HSS_SOFTERROR_COUNT_RESET 寄存器
        25. 6.5.1.25 HSSI_Channel_0_DMD_Data_GT_Cell_Control 寄存器
        26. 6.5.1.26 HSSI_Channel_0_DMD_Clock_GT_Cell_Control 寄存器
        27. 6.5.1.27 HSSI_Channel_1_DMD_Data_GT_Cell_Control 寄存器
        28. 6.5.1.28 HSSI_Channel_1_DMD_Clock_GT_Cell_Control 寄存器
        29. 6.5.1.29 HSSI_Channel_2_DMD_Data_GT_Cell_Control 寄存器
        30. 6.5.1.30 HSSI_Channel_2_DMD_Clock_GT_Cell_Control 寄存器
        31. 6.5.1.31 HSSI_Channel_3_DMD_Data_GT_Cell_Control 寄存器
        32. 6.5.1.32 HSSI_Channel_3_DMD_Clock_GT_Cell_Control 寄存器
        33. 6.5.1.33 HSSI_DMD_Vcm_Value 寄存器
        34. 6.5.1.34 TEST_DMD_ID 寄存器
        35. 6.5.1.35 TEST_DMD_FUSE1 寄存器
        36. 6.5.1.36 TEST_DMD_FUSE2 寄存器
        37. 6.5.1.37 TEST_DMD_FUSE3 寄存器
        38. 6.5.1.38 TEST_DMD_FUSE4 寄存器
  8. 7 应用和实施
    1. 7.1 应用信息
    2. 7.2 典型应用
      1. 7.2.1 高速直接成像应用
      2. 7.2.2 设计要求
      3. 7.2.3 详细设计过程
      4. 7.2.4 DMD 微镜切换性能图
    3. 7.3 连接到 DLPC964 控制器高速串行 (HSS) Aurora 64B/66B 输入
      1. 7.3.1 工作原理
        1. 7.3.1.1 块以块控制字开始
        2. 7.3.1.2 块以 DMDLOAD_REQ 完成
        3. 7.3.1.3 DMDLOAD_REQ 建立时间要求
        4. 7.3.1.4 单通道传输模式
        5. 7.3.1.5 DMD 块阵列数据映射
    4. 7.4 电源相关建议
      1. 7.4.1 电源分配和要求
      2. 7.4.2 断电要求
    5. 7.5 布局
      1. 7.5.1 布局指南
        1. 7.5.1.1 PCB 设计标准
        2. 7.5.1.2 信号层
        3. 7.5.1.3 常规 PCB 布线
          1. 7.5.1.3.1 布线最小间距
          2. 7.5.1.3.2 布线长度匹配
            1. 7.5.1.3.2.1 HSSI 输出总线偏移
            2. 7.5.1.3.2.2 Aurora 64B/66B 输入总线偏移
              1. 7.5.1.3.2.2.1 其他时序关键型信号
          3. 7.5.1.3.3 布线阻抗和布线优先级
      2. 7.5.2 电源和接地平面
      3. 7.5.3 电源过孔
      4. 7.5.4 去耦
    6. 7.6 布局示例
  9. 8 器件和文档支持
    1. 8.1 文档支持
      1. 8.1.1 相关文档
    2. 8.2 接收文档更新通知
    3. 8.3 支持资源
    4. 8.4 商标
    5. 8.5 静电放电警告
    6. 8.6 术语表
  10. 9 修订历史记录
  11. 10机械、封装和可订购信息

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • ZUM|1156
散热焊盘机械数据 (封装 | 引脚)
订购信息

6.4.5 微镜时钟脉冲 (MCP)

微镜时钟脉冲 (MCP) 序列首先设置 BLKMODE_[1:0] 和 BLKADDR_[3:0] 以进行单块、双块、四块或全局块操作。被置为有效后，MCP_Start 在块上引发 MCP，然后存储在块中的数据对 DMD 的微镜生效。发出 MCP 后不久，MCPn_ACTIVE 变为高电平，指示正在进行 MCP 操作。在此期间，不能发出任何额外的 MCP，直到 MCPn_ACTIVE 返回至低电平。图 6-5 显示了典型的单块加载分阶段序列，其中加载了连续的 DMD 块。对于单块、双块、四块或全局块操作，MCP 时间是相同的。

在块上完成 MCP 所花费的时间可能比加载块所花费的时间更长。表 6-8 概述了 DLP991U DMD 的单块加载时间。

表 6-8 DMD 概述
DMD 阵列 微镜稳定时间 (μs) 单行加载时间 (ns) 单块加载时间 (μs) 全局复位模式全阵列（图形/秒） 四块复位模式全阵列（图形/秒）
DLP991U 4096 × 2176 4 37.09 5.04 11,273 12,390

有关涉及发送 MCP、块清除或块置位而不进行数据加载的任何情况的输入数据时序说明和要求，请参阅节 7.3.1.3。

DLPC964 单块加载分阶段序列图 6-5 单块加载分阶段序列

要充分利用 DMD 带宽，请加载四个块，然后通过将 BLKMODE_[1:0] 设置为 10 并将 BLKADDR_[3:0] 设置为要复位的四个块的正确地址来同时向四个块发出 MCP。图 6-7 说明了这一点。

DLPC964 双块加载分阶段序列图 6-6 双块加载分阶段序列
DLPC964 四块加载分阶段序列图 6-7 四块加载分阶段序列

在块先前发出的 MCP 正在稳定时，可以加载其他块。图 6-6 和图 6-7 中展示了在微镜稳定时间内重新加载块。当之前加载的块具有未处理的 MCPn_ACTIVE 时，也可以加载其他块。图 6-7 展示了在针对块 12-15 将 MCPn_ACTIVE 置为有效期间，加载块 0。

DLPC964 控制器处理与微镜时钟脉冲相关的所有时序活动，包括每个块复位的设置和保持时序、复位波形生成时序以及有关加载、清除、快速清除或复位相邻或非相邻块的任何限制。当 MCP 在进行时，DLPC964 控制器会拒绝接受特定块的加载或清除命令。