ZHCSY43 April   2025 ADC3664-EP , ADC3664-SEP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性 - 功耗
    6. 5.6 电气特性 - 直流规格
    7. 5.7 电气特性 - 交流规格
    8. 5.8 时序要求
    9. 5.9 典型特性
  7. 6 参数测量信息
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 模拟输入
        1. 7.3.1.1 模拟输入带宽
        2. 7.3.1.2 模拟前端设计
          1. 7.3.1.2.1 采样干扰滤波器设计
          2. 7.3.1.2.2 模拟输入终端和直流偏置
            1. 7.3.1.2.2.1 交流耦合
            2. 7.3.1.2.2.2 直流耦合
      2. 7.3.2 时钟输入
        1. 7.3.2.1 单端与差分时钟输入
      3. 7.3.3 电压基准
        1. 7.3.3.1 内部电压基准
        2. 7.3.3.2 外部电压基准 (VREF)
        3. 7.3.3.3 外部电压基准，带内部缓冲器 (REFBUF/CTRL)
      4. 7.3.4 数字下变频器
        1. 7.3.4.1 DDC 多路复用器
        2. 7.3.4.2 数字滤波器用途
        3. 7.3.4.3 FS/4 与实时输出混合
        4. 7.3.4.4 数控振荡器 (NCO) 和数字混频器
        5. 7.3.4.5 抽取滤波器
        6. 7.3.4.6 SYNC
        7. 7.3.4.7 带抽取因子的输出格式
      5. 7.3.5 数字接口
        1. 7.3.5.1 输出格式器
        2. 7.3.5.2 输出位映射器
          1. 7.3.5.2.1 2 线模式
          2. 7.3.5.2.2 1 线模式
          3. 7.3.5.2.3 ½ 线模式
        3. 7.3.5.3 输出接口和模式配置
          1. 7.3.5.3.1 配置示例
        4. 7.3.5.4 输出数据格式
      6. 7.3.6 测试图形
    4. 7.4 器件功能模式
      1. 7.4.1 正常运行
      2. 7.4.2 断电选项
    5. 7.5 编程
      1. 7.5.1 仅使用 PIN 引脚的配置
      2. 7.5.2 使用 SPI 接口的配置
        1. 7.5.2.1 寄存器写入
        2. 7.5.2.2 寄存器读取
  9. 8 应用信息免责声明
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
        1. 8.2.2.1 输入信号路径
        2. 8.2.2.2 采样时钟
        3. 8.2.2.3 电压基准
      3. 8.2.3 应用曲线
    3. 8.3 初始化设置
      1. 8.3.1 运行期间寄存器初始化
    4. 8.4 电源相关建议
    5. 8.5 布局
      1. 8.5.1 布局指南
      2. 8.5.2 布局示例
  10. 9 寄存器映射
    1. 9.1 寄存器详细说明
  11. 10器件和文档支持
    1. 10.1 接收文档更新通知
    2. 10.2 支持资源
    3. 10.3 商标
    4. 10.4 静电放电警告
    5. 10.5 术语表
  12. 11修订历史记录
  13. 12机械、封装和可订购信息
    1. 12.1 机械数据

7.3.4.7 带抽取因子的输出格式

使用抽取时，输出数据的格式如 图 7-32 和 图 7-33 所示。显示的示例为 2 线（8 倍串行化）、1 线（16 倍串行化）和 1/2 线（32 倍串行化）的 16 位输出。

ADC3664-SEP ADC3664-EP 复数抽取中的输出数据格式图 7-32 复数抽取中的输出数据格式

表 7-3 展示了基于输出分辨率 (R)、SLVDS 线路数量 (L) 和复数抽取设置 (N) 的输出接口数据速率以及相应的 DCLK/DCLKIN 和 FCLK 频率。

该表显示了 2 线、1 线和 1/2 线接口、16 位输出分辨率以及 4 倍复数抽取的实际线路速率示例。

表 7-3 具有实际抽取和 16 位输出分辨率的串行 LVDS 通道速率示例
抽取设置ADC 采样速率输出分辨率电线数量FCLKDCLKIN、DCLKDA/B0,1
NFSRLFS / N[DA/B0,1] / 2FS x 2 x R / L / N
4125MSPS16231.25MHz250MHz500MHz
1500MHz1000MHz
55MSPS1/215.625MHz50MHz1000MHz
ADC3664-SEP ADC3664-EP 实数抽取中的输出数据格式图 7-33 实数抽取中的输出数据格式

表 7-4 展示了基于输出分辨率 (R)、SLVDS 线路数 (L) 和实数抽取设置 (M) 的输出接口数据速率以及相应的 DCLK/DCLKIN 和 FCLK 频率。

该表显示了 2 线、1 线和 1/2 线接口、16 位输出分辨率以及实际抽取 4 的实际线路速率示例。

表 7-4 具有实时抽取和 16 位输出分辨率的串行 LVDS 通道速率示例
抽取设置ADC 采样速率输出分辨率电线数量FCLKDCLKIN、DCLKDA/B0,1
MFSRLFS / M / 2 (L = 2)
FS / M (L = 1, 1/2)		[DA/B0,1] / 2FS x R / L / M
4125MSPS16215.625MHz125MHz250MHz
131.25MHz250MHz500MHz
1/2500MHz1000MHz