ZHCABE5A May   2021  – April 2022 PCM3120-Q1 , PCM5120-Q1 , PCM6120-Q1 , TLV320ADC3120 , TLV320ADC5120 , TLV320ADC6120

 

  1.   摘要
  2.   商标
  3.   注释
  4. 1引言
  5. 2控制器模式
    1. 2.1 控制器模式配置选项
      1. 2.1.1 启用 PLL 时的自动时钟配置
        1. 2.1.1.1 支持的采样率
        2. 2.1.1.2 12MHz MCLK 示例
      2. 2.1.2 禁用 PLL 时的自动时钟检测
        1. 2.1.2.1 支持的采样率
        2. 2.1.2.2 示例
  6. 3控制器模式下 I2S 和 LJF 的边沿同步
    1. 3.1 I2S 和 LJF 标准总线格式
    2. 3.2 对非标准 I2S 和 LJF 总线格式的支持
  7. 4相关文档
  8.   A 修订历史记录

2.1.2.2 示例

对于 24.576MHz 或 22.579MHz MCLK，以下 I2C 脚本将 TLV320ADCx120 和 PCMx120-Q1 配置为控制器模式，GPIO1 作为 MCLK 输入，以分别实现 48kHz 或 44.1kHz 采样率：

w 9C 13 a0 # enable controller mode, disable PLL for auto-clock config w 9C 14 48 # FS = 44.1/48k BCLK/fsync ratio = 256 w 9C 16 d8 # MCLK is audio root, use MCLK_ratio_sel, MCLK/Fsync ratio = 512 w 9C 21 a0 # configure GPIO1 as MCLK input