ZHCSPR9 December   2023 AFE782H1 , AFE882H1

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  电气特性
    6. 5.6  时序要求
    7. 5.7  时序图
    8. 5.8  典型特性：VOUT DAC
    9. 5.9  典型特性：ADC
    10. 5.10 典型特性：参考文献
    11. 5.11 典型特性：HART 调制解调器
    12. 5.12 典型特性：电源
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1  数模转换器 (DAC) 概述
        1. 6.3.1.1 DAC 电阻串
        2. 6.3.1.2 DAC 缓冲器放大器
        3. 6.3.1.3 DAC 传递函数
        4. 6.3.1.4 DAC 增益和偏移校准
        5. 6.3.1.5 可编程压摆率
        6. 6.3.1.6 DAC 寄存器结构和清除状态
      2. 6.3.2  模数转换器 (ADC) 概述
        1. 6.3.2.1 ADC 操作
        2. 6.3.2.2 ADC 自定义通道序列发生器
        3. 6.3.2.3 ADC 同步
        4. 6.3.2.4 ADC 偏移校准
        5. 6.3.2.5 外部监控输入
        6. 6.3.2.6 温度传感器
        7. 6.3.2.7 自诊断多路复用器
        8. 6.3.2.8 ADC 旁路
      3. 6.3.3  可编程超限警报
        1. 6.3.3.1 基于警报的中断
        2. 6.3.3.2 警报操作配置寄存器
        3. 6.3.3.3 警报电压发生器
        4. 6.3.3.4 温度传感器警报功能
        5. 6.3.3.5 内部基准警报功能
        6. 6.3.3.6 ADC 警报功能
        7. 6.3.3.7 故障检测
      4. 6.3.4  IRQ
      5. 6.3.5  HART 接口
        1. 6.3.5.1  FIFO 缓冲器
          1. 6.3.5.1.1 FIFO 缓冲器访问
          2. 6.3.5.1.2 FIFO 缓冲器标志
        2. 6.3.5.2  HART 调制器
        3. 6.3.5.3  HART 解调器
        4. 6.3.5.4  HART 调制解调器模式
          1. 6.3.5.4.1 半双工模式
          2. 6.3.5.4.2 全双工模式
        5. 6.3.5.5  HART 调制和解调仲裁
          1. 6.3.5.5.1 HART 接收模式
          2. 6.3.5.5.2 HART 发送模式
        6. 6.3.5.6  HART 调制器时序和前导码要求
        7. 6.3.5.7  HART 解调器时序和前导码要求
        8. 6.3.5.8  HART 通信的 IRQ 配置
        9. 6.3.5.9  使用 SPI 进行 HART 通信
        10. 6.3.5.10 使用 UART 进行 HART 通信
        11. 6.3.5.11 存储器内置自检 (MBIST)
      6. 6.3.6  内部基准
      7. 6.3.7  集成精密振荡器
      8. 6.3.8  精密振荡器诊断
      9. 6.3.9  一次性可编程 (OTP) 存储器
      10. 6.3.10 GPIO
      11. 6.3.11 计时器
      12. 6.3.12 唯一芯片标识符 (ID)
      13. 6.3.13 暂存区寄存器
    4. 6.4 器件功能模式
      1. 6.4.1 DAC 断电模式
      2. 6.4.2 寄存器内置自检 (RBIST)
      3. 6.4.3 复位
    5. 6.5 编程
      1. 6.5.1 通信设置
        1. 6.5.1.1 SPI 模式
        2. 6.5.1.2 UART 模式
        3. 6.5.1.3 SPI + UART 模式
        4. 6.5.1.4 HART 功能设置选项
      2. 6.5.2 GPIO 编程
      3. 6.5.3 串行外设接口 (SPI)
        1. 6.5.3.1 SPI 帧定义
        2. 6.5.3.2 SPI 读取和写入
        3. 6.5.3.3 帧错误校验
        4. 6.5.3.4 同步
      4. 6.5.4 UART 接口
        1. 6.5.4.1 UART 中断模式 (UBM)
          1. 6.5.4.1.1 连接 FIFO 缓冲器和寄存器映射
      5. 6.5.5 状态位
      6. 6.5.6 看门狗计时器
  8. 7 寄存器映射
    1. 7.1 AFEx82H1 寄存器
  9. 8 应用和实施
    1. 8.1 应用信息
      1. 8.1.1 多通道配置
    2. 8.2 典型应用
      1. 8.2.1 4mA 至 20mA 电流变送器
        1. 8.2.1.1 设计要求
        2. 8.2.1.2 详细设计过程
          1. 8.2.1.2.1 电流环路控制
          2. 8.2.1.2.2 HART 连接
          3. 8.2.1.2.3 输入保护和整流
          4. 8.2.1.2.4 系统电流预算
        3. 8.2.1.3 应用曲线
    3. 8.3 初始化设置
    4. 8.4 电源相关建议
    5. 8.5 布局
      1. 8.5.1 布局指南
      2. 8.5.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 接收文档更新通知
    3. 9.3 支持资源
    4. 9.4 商标
    5. 9.5 静电放电警告
    6. 9.6 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

6.4.3 复位

该器件中有三种复位机制：上电复位 (POR)、RESET 引脚和可通过 SPI 或由 UBM 发送的 SW_RST 命令。

首次为该器件加电时，POR 电路会使该器件保持复位状态，直到所有电源达到指定的工作电压。如果发生欠压事件（电源电压降至最低工作电压以下），上电复位机制会使该器件恢复为已知的工作状态。POR 在复位过程中电源稳定时启动所有数字电路，然后并释放这些电路以确保该器件在默认条件下启动并加载 OTP 存储器。加载 OTP 存储器后将释放 ALARM 引脚。此时，与该器件的通信是安全的。这个 tPOR 时间短于 100µs。

这些器件还具有一个 RESET 引脚可用于器件的硬件复位。将 RESET 引脚置于低电平至少 100ns (tRESET) 可以复位该器件。由于器件锁存和释放复位，在发送第一条串行接口命令之前需要 10μs 的延迟时间 (tRESETWAIT)。内部复位状态的释放与内部时钟同步。RESET 引脚可以复位 SPI 和 UART 接口、HART FIFO 缓冲器、看门狗计时器、内部振荡器和器件寄存器。RESET 不会重新加载 OTP 存储器。

RESET.SW_RST = 0xAD 命令作为软件复位方式使该器件复位。该命令由 SPI 命令在 CS 的上升沿解码，或在 UBM 帧最后一个字符的停止位期间进行解码。将该器件复位到 UBM 时，再次设置 UBM.REG_MODE 可以将该器件恢复到 UBM 中。发送 RESET 命令后，由于器件锁存和释放复位，在发送第一条串行接口命令之前不需要延迟时间。复位与内部时钟的下降沿同步，并在下一个上升沿之前完全释放。ALARM 引脚在内部复位宽度内发出低电平脉冲。该脉冲持续时间小于 20ns。该命令可以复位 SPI 和 UART 接口、HART FIFO 以及看门狗计时器，但不会复位内部振荡器。如果在 SPECIAL_CFG 寄存器中进行了正确配置，软件复位还会重新加载内部出厂修整寄存器。SPECIAL_CFG 寄存器只会在 POR 后复位。

POR 和硬件复位会将内部振荡器置于复位状态，从而将时钟保持在低电平。当这两个信号被释放时，在时钟的第一个上升沿之前会有几微秒的延迟。硬件复位 RESET 脉冲宽度必须至少为 100ns 以便让振荡器正确复位。SW_RST 命令为短脉冲。该脉冲的长度不足以充分复位振荡器。SW_RST 通过时钟的下降沿置为有效。由于振荡器周期较长，设计架构将使所有器件在下一个上升沿之前退出复位。

图 6-25 展示了复位树。

GUID-20210713-CA0I-LKBC-PQZ2-CZVX9WW3MDDM-low.svg 图 6-25 复位条件