ZHCSYZ0 September   2025 TMF0064

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 时序要求
    7. 5.7 功能测试
    8. 5.8 典型特性
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 64768 位 FRAM
      2. 6.3.2 FRAM 状态存储器
      3. 6.3.3 地址寄存器和传输状态
      4. 6.3.4 将数据写入 FRAM
      5. 6.3.5 TMF0064 器件 ID
      6. 6.3.6 总线端接
    4. 6.4 器件功能模式
      1. 6.4.1 功能测试的测试程序
        1. 6.4.1.1 多目标配置
    5. 6.5 编程
      1. 6.5.1 串行通信
      2. 6.5.2 初始化
      3. 6.5.3 ROM 命令
        1. 6.5.3.1 读取 ROM 命令 [33h]
        2. 6.5.3.2 匹配 ROM 命令 [55h]
        3. 6.5.3.3 跳过 ROM 命令 [CCh]
        4. 6.5.3.4 搜索 ROM 命令 [F0h]
        5. 6.5.3.5 恢复命令 [A5h]
        6. 6.5.3.6 超速跳过 ROM 命令 [3Ch]
        7. 6.5.3.7 超速匹配 ROM 命令 [69h]
      4. 6.5.4 存储器功能命令
        1. 6.5.4.1 写入暂存区命令 [0Fh]
        2. 6.5.4.2 读取暂存区命令 [AAh]
        3. 6.5.4.3 复制暂存区 [55h]
        4. 6.5.4.4 读取存储器 [F0h]
        5. 6.5.4.5 扩展读取存储器 [A5h]
        6. 6.5.4.6 存储器命令流程图
      5. 6.5.5 SDQ 信令
        1. 6.5.5.1 复位和存在脉冲
        2. 6.5.5.2 写入读取时隙
      6. 6.5.6 空闲
      7. 6.5.7 CRC 生成
  8. 7 应用和实施
    1. 7.1 应用信息
    2. 7.2 典型应用
      1. 7.2.1 设计要求
      2. 7.2.2 详细设计过程
      3. 7.2.3 应用曲线
    3. 7.3 电源相关建议
    4. 7.4 布局
      1. 7.4.1 布局指南
      2. 7.4.2 布局示例
  9. 8 器件和文档支持
    1. 8.1 接收文档更新通知
    2. 8.2 支持资源
    3. 8.3 商标
    4. 8.4 静电放电警告
    5. 8.5 术语表
  10. 9 修订历史记录
  11. 10机械、封装和可订购信息
    1. 10.1 封装信息
    2. 10.2 卷带包装信息

6.5.5.2 写入读取时隙

单线接口通信没有参考时钟。因此，所有通信都是异步进行的，使用固定时隙 (tSLOT) 和变化的脉宽表示逻辑 0 和 1。在空闲状态下，外部上拉电阻使线路保持高电平。所有位通信（无论是写入还是读取）都由主机发起，方法是将数据线驱动为低电平，并将位值解码为数据线保持低电平的时间。

尽管通信是按位进行，但主机和器件之间交换的数据仍然按字节进行。每个字节先发送最低有效位。发送不完整的字节时，器件行为不予验证。

写入“1”时序图 中的写入“1”时序图显示主机通过在 tF + tW1L - t ε 时间内将 SDQ 总线拉至低电平，然后释放 SDQ 总线来启动写 1 传输。同样，写入“0”时序图 中的写入“0”时序图显示主机通过在 tF + tW0L - tε 时间内将 SDQ 总线拉至低电平，然后释放 SDQ 总线来启动写 0 传输。当 SDQ 总线上的电压降至阈值 VTL 以下，器件启动内部时序生成器，该发生器确定在写入时隙内何时对 SDQ 线采样，以确定该位是 1 还是 0。该器件在最长 tW1L 和最短 tW0L 之间的时间段内对 SDQ 线进行采样。

读取数据时序图 中的读取数据时序图显示主机通过在 tF + tRL 时间内将 SDQ 总线拉至低电平来启动位的传输。然后，该器件进行响应：将 SDQ 总线驱动为低电平来发送读取 0，或释放 SDQ 总线来发送读取 1。主机必须将上拉电阻和总线电容引起的上升时间考虑在内，以便确定对器件发送的位电平进行采样或驱动下一个读取位时隙的采样窗口。

TMF0064 写入“1”时序图图 6-18 写入“1”时序图
TMF0064 写入“0”时序图图 6-19 写入“0”时序图
TMF0064 读取数据时序图图 6-20 读取数据时序图