ZHCSTF8A November   2023  – July 2025 DAC530A2W , DAC532A3W

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  电气特性：电压输出
    6. 5.6  电气特性：电流输出
    7. 5.7  电气特性：比较器模式
    8. 5.8  电气特性：通用
    9. 5.9  时序要求：I2C 标准模式
    10. 5.10 时序要求：I2C 快速模式
    11. 5.11 时序要求：I2C 超快速模式
    12. 5.12 时序要求：SPI 写入操作
    13. 5.13 时序要求：SPI 读取和菊花链操作 (FSDO = 0)
    14. 5.14 时序要求：SPI 读取和菊花链操作 (FSDO = 1)
    15. 5.15 时序要求：GPIO
    16. 5.16 时序图
    17. 5.17 典型特性：电压输出
    18. 5.18 典型特性：电流输出
    19. 5.19 典型特性：比较器
    20. 5.20 典型特性：通用
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 智能数模转换器 (DAC) 架构
      2. 6.3.2 数字输入/输出
      3. 6.3.3 非易失性存储器 (NVM)
    4. 6.4 器件功能模式
      1. 6.4.1 电压输出模式
        1. 6.4.1.1 电压基准和 DAC 传递函数
          1. 6.4.1.1.1 内部基准
          2. 6.4.1.1.2 电源作为基准
      2. 6.4.2 电流输出模式
      3. 6.4.3 比较器模式
        1. 6.4.3.1 可编程迟滞比较器
        2. 6.4.3.2 可编程窗口比较器
      4. 6.4.4 故障转储模式
      5. 6.4.5 应用特定模式
        1. 6.4.5.1 电压裕量和调节
          1. 6.4.5.1.1 高阻抗输出和 PROTECT 输入
          2. 6.4.5.1.2 可编程压摆率控制
        2. 6.4.5.2 函数生成
          1. 6.4.5.2.1 三角波形生成
          2. 6.4.5.2.2 锯齿波形生成
          3. 6.4.5.2.3 正弦波形生成
      6. 6.4.6 器件复位和故障管理
        1. 6.4.6.1 上电复位 (POR)
        2. 6.4.6.2 外部复位
        3. 6.4.6.3 寄存器映射锁定
        4. 6.4.6.4 NVM 循环冗余校验 (CRC)
          1. 6.4.6.4.1 NVM-CRC-FAIL-USER 位
          2. 6.4.6.4.2 NVM-CRC-FAIL-INT 位
      7. 6.4.7 通用输入/输出 (GPIO) 模式
    5. 6.5 编程
      1. 6.5.1 SPI 编程模式
      2. 6.5.2 I2C 编程模式
        1. 6.5.2.1 F/S 模式协议
        2. 6.5.2.2 I2C 更新序列
          1. 6.5.2.2.1 地址字节
          2. 6.5.2.2.2 命令字节
        3. 6.5.2.3 I2C 读取序列
  8. 7 寄存器映射
    1. 7.1  NOP 寄存器（地址 = 00h）[复位 = 0000h]
    2. 7.2  DAC-0-MARGIN-HIGH 寄存器（地址 = 0Dh）[复位 = 0000h]
    3. 7.3  DAC-1-MARGIN-HIGH 寄存器（地址 = 13h）[复位 = 0000h]
    4. 7.4  DAC-2-MARGIN-HIGH 寄存器（地址 = 01h）[复位 = 0000h]
    5. 7.5  DAC-0-MARGIN-LOW 寄存器（地址 = 0Eh）[复位 = 0000h]
    6. 7.6  DAC-1-MARGIN-LOW 寄存器（地址 = 14h）[复位 = 0000h]
    7. 7.7  DAC-2-MARGIN-LOW 寄存器（地址 = 02h）[复位 = 0000h]
    8. 7.8  DAC-0-GAIN-CONFIG 寄存器（地址 = 0Fh）[复位 = 0000h]
    9. 7.9  DAC-1-GAIN-CMP-CONFIG 寄存器（地址 = 15h）[复位 = 0000h]
    10. 7.10 DAC-2-GAIN-CONFIG 寄存器（地址 = 03h）[复位 = 0000h]
    11. 7.11 DAC-1-CMP-MODE-CONFIG 寄存器（地址 = 17h）[复位 = 0000h]
    12. 7.12 DAC-0-FUNC-CONFIG 寄存器（地址 = 12h）[复位 = 0000h]
    13. 7.13 DAC-1-FUNC-CONFIG 寄存器（地址 = 18h）[复位 = 0000h]
    14. 7.14 DAC-2-FUNC-CONFIG 寄存器（地址 = 06h）[复位 = 0000h]
    15. 7.15 DAC-0-DATA 寄存器（地址 = 1Bh）[复位 = 0000h]
    16. 7.16 DAC-1-DATA 寄存器（地址 = 1Ch）[复位 = 0000h]
    17. 7.17 DAC-2-DATA 寄存器（地址 = 19h）[复位 = 0000h]
    18. 7.18 COMMON-CONFIG 寄存器（地址 = 1Fh）[复位 = 0FFFh]
    19. 7.19 COMMON-TRIGGER 寄存器（地址 = 20h）[复位 = 0000h]
    20. 7.20 COMMON-DAC-TRIG 寄存器（地址 = 21h）[复位 = 0000h]
    21. 7.21 GENERAL-STATUS 寄存器（地址 = 22h）[复位 = 20h、DEVICE-ID、VERSION-ID]
    22. 7.22 CMP-STATUS 寄存器（地址 = 23h）[复位 = 000Ch]
    23. 7.23 GPIO-CONFIG 寄存器（地址 = 24h）[复位 = 0000h]
    24. 7.24 DEVICE-MODE-CONFIG 寄存器（地址 = 25h）[复位 = 0000h]
    25. 7.25 INTERFACE-CONFIG 寄存器（地址 = 26h）[复位 = 0000h]
    26. 7.26 SRAM-CONFIG 寄存器（地址 = 2Bh）[复位 = 0000h]
    27. 7.27 SRAM-DATA 寄存器（地址 = 2Ch）[复位 = 0000h]
    28. 7.28 BRDCAST-DATA 寄存器（地址 = 50h）[复位 = 0000h]
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
      3. 8.2.3 应用曲线
    3. 8.3 电源相关建议
    4. 8.4 布局
      1. 8.4.1 布局指南
      2. 8.4.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 接收文档更新通知
    3. 9.3 支持资源
    4. 9.4 商标
    5. 9.5 静电放电警告
    6. 9.6 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • YBH|16
散热焊盘机械数据 (封装 | 引脚)
订购信息

5.5 电气特性：电压输出

所有最小和最大规格的条件为 –40°C ≤ TA ≤ +125°C，所有典型规格的条件为 TA = 25°C，
3V ≤ VDD ≤ 5.5V，以 VDD 为基准，增益 = 1 ×，电压输出 DAC 引脚 (VOUTx) 具有阻性负载（RL = 5kΩ 至 AGND）和容性负载（CL = 200pF 至 AGND），且数字输入处于 VDD 或 AGND（除非另有说明）
参数 测试条件 最小值 典型值 最大值 单位
静态性能
分辨率 10 位
INL 积分非线性(1) -1.25 1.25 LSB
DNL 微分非线性(1) -1 1 LSB
零代码误差(2) 将 0d 编码至 DAC，VDD = 5.5V 6 12 mV
将 0d 编码到 DAC 中，内部 VREF，增益 = 4 ×，
VDD = 5.5V		 6 15
零代码误差温度系数(2) ±10 µV/°C
偏移误差(2) 3V ≤ VDD ≤ 5.5V，VFB 引脚短接至 VOUT，DAC 代码：10 位分辨率为 8d -0.5 0.25 0.5 %FSR
偏移误差温度系数(2) VFB 引脚短接至 VOUT，DAC 代码：10 位分辨率为 8d ±0.0003 %FSR/°C
增益误差(2) 端点代码之间：10 位分辨率为 8d 至 1016d -0.5 0.25 0.5 %FSR
增益误差温度系数(2) 端点代码之间：10 位分辨率为 8d 至 1016d ±0.0008 %FSR/°C
满量程误差(2) 3V ≤ VDD ≤ 5.5V，DAC（满量程） -0.5 0.5 %FSR
满量程误差温度系数(2) DAC 处于满量程 ±0.0008 %FSR/°C
输出
输出电压 0 VDD V
CL 容性负载(3) RL = 无限，相位裕度 = 30° 200 pF
相位裕度 = 30° 1000
短路电流 VDD = 3V，满量程输出短接至 AGND 或
零标度输出短接至 VDD		 50 mA
VDD = 5.5V，满量程输出短接至 AGND 或
零标度输出短接至 VDD		 60
输出电压余量(3) 至 VDD，DAC 输出空载，内部基准 = 1.21V，VDD ≥ 1.21V × 增益 + 0.2V 0.2 V
至 VDD 和至 AGND，DAC 输出空载 0.8 %FSR
至 VDD 和至 AGND，ILOAD = 10mA（VDD = 5.5V 时），ILOAD = 3mA（VDD = 3V 时） 10
ZO VFB 直流输出阻抗(4) DAC 输出启用，内部基准（增益 = 1.5 × 或 2 ×）或以 VDD 为基准（增益 = 1 ×） 400 500 600 kΩ
DAC 输出已启用，内部 VREF，增益 = 3 × 或 4 × 325 400 485
电源抑制比（直流） 内部 VREF，增益 = 2 ×，DAC 处于中标度，
VDD = 5V ±10%		 0.25 mV/V
动态性能
tsett 输出电压建立时间 1/4 至 3/4 标度和 3/4 至 1/4 标度趋稳至 10%FSR，VDD = 5.5V 20 µs
1/4 至 3/4 标度和 3/4 至 1/4 标度趋稳至 10%FSR，VDD = 5.5V，内部 VREF，增益 = 4 × 25
压摆率 VDD = 5.5V 0.3 V/µs
上电干扰幅度 启动时，DAC 输出被禁用 75 mV
启动时，DAC 输出被禁用，RL = 100kΩ 200
输出使能干扰幅度 DAC 输出从禁用至启用，DAC 寄存器处于零标度，RL = 100kΩ 250 mV
Vn 输出噪声电压
（峰峰值）		 f = 0.1Hz 至 10Hz，DAC 位于中标度，VDD = 5.5V 50 µVPP
内部 VREF，增益 = 4 ×，f = 0.1Hz 至 10Hz，
DAC 处于中标度，VDD = 5.5V		 90
输出噪声密度 f = 1kHz，DAC 位于中标度，VDD = 5.5V 0.35 µV/√Hz
内部 VREF，增益 = 4 ×，f = 1kHz，DAC 处于中标度，VDD = 5.5V 0.9
电源抑制比（交流）(4) 内部 VREF，增益 = 4 ×，200mV 50Hz 或 60Hz 正弦波叠加在电源电压上，DAC 处于中标度 -68 dB
代码变化干扰脉冲 围绕中标度的 ±1LSB 变化（包括馈通） 10 nV-s
代码变化干扰脉冲幅度 围绕中标度的 ±1LSB 变化（包括馈通） 15 mV
POWER
IDD 流入 VDD 的电流(2) (5) DAC532A3W：正常工作，DAC 满量程，数字引脚静态 150 µA/ch
DAC530A2W：正常工作，DAC 满量程，数字引脚静态 65 85
(1) 在 DAC 输出空载的情况下测量。对于内部基准 VDD ≥ 1.21 × 增益 + 0.2V，介于终点代码之间：10 位分辨率为 8d 至 1016d。
(2) 在 DAC 输出空载的情况下测量。
(3) 根据设计和特征确定；未经生产测试。
(4) 当使用内部基准时，相对于基准值以 200mV 余量指定。
(5) 总功耗的计算方式为 IDD × (上电通道总数) + (睡眠模式电流)。