ZHCSZ83 November   2025 ADC32RF72

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性 - 功耗
    6. 5.6 电气特性 - 直流规格
    7. 5.7 电气特性 - 交流规格
    8. 5.8 时序要求
    9. 5.9 典型特性
  7. 6 参数测量信息
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 模拟输入
        1. 7.3.1.1 输入带宽
        2. 7.3.1.2 后台校准
      2. 7.3.2 ADC 通道选择和断电模式
      3. 7.3.3 采样时钟输入
      4. 7.3.4 SYSREF
        1. 7.3.4.1 SYSREF 监测器
      5. 7.3.5 数字信号处理器 (DSP) 特性
        1. 7.3.5.1 DSP 输入多路复用器
        2. 7.3.5.2 小数延迟
        3. 7.3.5.3 可实现均衡的可编程 FIR 滤波器
        4. 7.3.5.4 DSP 输出多路复用器
        5. 7.3.5.5 数字下变频器 (DDC)
          1. 7.3.5.5.1 抽取滤波器输入
          2. 7.3.5.5.2 抽取模式
          3. 7.3.5.5.3 抽取滤波器响应
          4. 7.3.5.5.4 数控振荡器 (NCO)
            1. 7.3.5.5.4.1 NCO 更新
            2. 7.3.5.5.4.2 NCO 复位
      6. 7.3.6 数字输出接口
        1. 7.3.6.1 JESD204B/C 接口
          1. 7.3.6.1.1 JESD204B 初始通道对齐 (ILA)
          2. 7.3.6.1.2 SYNC 信号
          3. 7.3.6.1.3 JESD204B/C 帧元件
          4. 7.3.6.1.4 旁路模式下的 JESD204B/C 帧组件
          5. 7.3.6.1.5 具有实数抽取功能的 JESD204B/C 帧组件
          6. 7.3.6.1.6 具有复数抽取功能的 JESD204B,C 帧组件
        2. 7.3.6.2 JESD 输出基准时钟
    4. 7.4 器件功能模式
      1. 7.4.1 器件运行模式比较
    5. 7.5 编程
      1. 7.5.1 GPIO 控制
      2. 7.5.2 SPI 寄存器写入
      3. 7.5.3 SPI 寄存器读取
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用：频谱分析仪
      1. 8.2.1 设计要求
        1. 8.2.1.1 输入信号路径：宽带接收器
        2. 8.2.1.2 时钟
      2. 8.2.2 详细设计过程
        1. 8.2.2.1 采样时钟要求
      3. 8.2.3 应用性能曲线图
    3. 8.3 典型应用：时间域数字转换器
      1. 8.3.1 设计要求
        1. 8.3.1.1 输入信号路径：时间域数字转换器
      2. 8.3.2 应用性能曲线图
    4. 8.4 初始化设置
    5. 8.5 电源相关建议
    6. 8.6 布局
      1. 8.6.1 布局指南
      2. 8.6.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
      2. 9.1.2 第三方产品免责声明
    2. 9.2 接收文档更新通知
    3. 9.3 支持资源
    4. 9.4 商标
    5. 9.5 静电放电警告
    6. 9.6 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

7.3.5.2 小数延迟

该器件在 DSP 输入多路复用器之后包含一个可选的可编程 12 位小数数字延迟（请参阅图 7-13）。有两个独立的数字小数延迟块：FDF0 和 FDF1。每个 FDF 块连接到两个输入流（dsp_in[1:0] 或 dsp_in[3:2]），其中每个输入流都有一个可编程小数延迟值，即 dsp_in[1:0] 为 td00 和 td01，dsp_in[3:2] 为 td10 和 td11。FDF 块总共输出四个数据流 (fdf_out[3:0])，其中每个输出流对应一个不同的小数延迟输入流。

小数延迟是一种真正的延时时间 实现，并在频率范围内保持线性相位。小数延迟的计算公式为：

小数延迟 [采样时钟周期] = 延迟/4096x TS（采样周期）。

ADC32RF72 小数延迟功能图 7-13 小数延迟功能

例如，设置为 2048 等于 ½ 时钟周期延迟，如图 7-14 所示。幅度误差小于 −80dB（与所需延迟间的关系）。

ADC32RF72 小数延迟 = ½ 时钟周期（延迟设置 = 2048）图 7-14 小数延迟 = ½ 时钟周期
（延迟设置 = 2048）
ADC32RF72 误差幅度（所需波形与实际波形间的关系）图 7-15 误差幅度
（所需波形与实际波形间的关系）

小数延迟通过 SPI 寄存器写入进行配置，编程的延迟在内部转换为滤波器系数。滤波器响应如图 7-16 和图 7-17 中所示。通带约为奈奎斯特区域的 85%。重新编程小数延迟可能需要长达 2µs 的时间来更新滤波器系数。

ADC32RF72 小数延迟 FIR 的滤波器响应图 7-16 小数延迟 FIR 的滤波器响应
ADC32RF72 小数延迟 FIR 的滤波器响应（放大图）图 7-17 小数延迟 FIR 的滤波器响应（放大图）

可以使用以下参数对小数延迟进行编程：

表 7-9 小数延迟配置编程

系统参数名称

尺寸默认值访问说明
FDF0_DELAY_VAL_0_LSB80R/W小数延迟值的位 [7:0] 对应到 FDF0 的第 0 个输入数据流。
FDF0_DELAY_VAL_0_MSB40R/W小数延迟值的位 [11:8] 对应到 FDF0 的第 0 个输入数据流。
FDF0_DELAY_VAL_1_LSB80R/W小数延迟值的位 [7:0] 对应到 FDF0 的第 1 个输入数据流。
FDF0_DELAY_VAL_1_MSB40R/W小数延迟值的位 [11:8] 对应到 FDF0 的第 1 个输入数据流。
FDF1_DELAY_VAL_0_LSB80R/W小数延迟值的位 [7:0] 对应到 FDF1 的第 0 个输入数据流。
FDF1_DELAY_VAL_0_MSB40R/W小数延迟值的位 [11:8] 对应到 FDF1 的第 0 个输入数据流。
FDF1_DELAY_VAL_1_LSB80R/W小数延迟值的位 [7:0] 对应到 FDF1 的第 1 个输入数据流。
FDF1_DELAY_VAL_1_MSB40R/W小数延迟值的位 [11:8] 对应到 FDF1 的第 1 个输入数据流。