TIDA-00432

将 Xilinx 平台应用于相位阵列雷达系统以实现 JESD204B 千兆次采样 ADC 的同步

TIDA-00432

设计文件

概述

此系统级设计展示了如何使用 Xilinx VC707 平台一起同步两个 ADC12J4000 评估模块 (EVM)。此设计文档介绍了必要的硬件修改和器件配置,包括时钟方案。此设计显示了每个 EVM 的示例配置文件。此设计介绍了 FPGA 固件,并显示相关的 Xilinx IP 块配置参数。此外还显示并分析了在实际硬件上采集的数据,测试结果显示出 50ps 内的同步,未使用特性化电缆,也未校准传播延迟。

特性
  • 通过展示 JESD204B 千兆采样 ADC 的同步来演示典型的相控阵列雷达子系统
  • 详细介绍了所用的 LMK04828 时钟解决方案
  • 测试结果显示出 50ps 内的同步,未使用任何特性化电缆,也未校准传播延迟
  • 讨论了 Xilinx 固件开发,从而明确要求
  • 此子系统经过测试,并包含示例配置文件
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我们开发的全面组装电路板仅用于测试和性能验证,不可用于销售。

设计文件和产品

设计文件

下载现成的系统文件,加快您的设计过程。

TIDU752.PDF (2321 K)

参考设计概述和经过验证的性能测试数据

TIDRDI4.PDF (555 K)

设计布局和元件的详细原理图

TIDRDI5.PDF (140 K)

设计元件、引用标识符和制造商/器件型号的完整列表

TIDC978.ZIP (712 K)

包含设计 PCB 物理板层信息的设计文件

产品

在设计中包括 TI 产品和可能的替代产品。

高速 ADC (≥10MSPS)

ADC12J160012 位、1.6GSPS、射频采样模数转换器 (ADC)

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高速 ADC (≥10MSPS)

ADC12J270012 位、2.7GSPS、射频采样模数转换器 (ADC)

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高速 ADC (≥10MSPS)

ADC12J400012 位、4.0GSPS、射频采样模数转换器 (ADC)

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时钟抖动清除器和同步器

LMK04828具有集成式 2370 至 2630MHz VCO0 且符合 JESD204B 标准的超低噪声时钟抖动消除器

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线性和低压降 (LDO) 稳压器

LP38513-ADJ具有低噪声和使能功能的 3A、可调节超低压降稳压器

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线性和低压降 (LDO) 稳压器

LP3878-ADJ具有使能功能的 800mA、16V、可调节低压降稳压器

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线性和低压降 (LDO) 稳压器

TLV702具有使能功能的 300mA、高 PSRR、低 IQ、低压降稳压器

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线性和低压降 (LDO) 稳压器

TPS74901具有电源正常指示和使能功能的 3A、低 VIN (0.8V)、可调节超低压降稳压器

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降压转换器(集成开关)

LM26400Y双路 2A、500kHz 宽输入范围降压稳压器

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降压转换器(集成开关)

TPS543274.5V 至 18V 输入,3A 同步降压转换器

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开始开发

软件

技术文档

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类型 标题 下载最新的英文版本 日期
设计指南 Synchronization of JESD204B Giga-Sample ADCs 2015年 1月 20日

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