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功能与比较器件相似。
TPS54318
- 两个可在 3A 负载下获得高效率的 30mΩ（典型值）MOSFET
- 开关频率：200kHz 至 2MHz
- 整个温度范围内的电压基准：0.8V ± 1%
- 同步至外部时钟
- 可调软启动/定序
- 欠压 (UV) 和过压 (OV) 电源正常输出
- 低运行和关断静态电流
- 安全启动至预偏置输出电压
- 逐周期电流限制、过热和频率折返保护
- 工作结温范围：-40°C 至 150°C
- 耐热增强型 3mm x 3mm 16 引脚超薄型四方扁平无引线 (WQFN) 封装
- 使用 TPS54318 并借助 WEBENCH® 电源设计器创建定制设计方案
TPS54318 器件一款全功能 6V、3A 同步降压电流模式转换器，具有两个集成的 MOSFET。
TPS54318 器件集成了 MOSFET、通过实施电流模式控制来减少外部组件数量、通过启用高达 2MHz的开关频率来减小电感尺寸，并借助小型 3mm x 3mm 热增强型 QFN 封装尽量减小器件封装尺寸，从而实现小型设计。
TPS54318 器件可在整个温度范围内为多种负载提供电压基准 (VREF) 精度达 ±1% 的精确调节。
通过集成型 30mΩ MOSFET 和典型值为 350µA 的电源电流可使效率得到最大限度提升。通过使用 EN 引脚进入关断模式，关断电源电流可减少至 2µA。
欠压闭锁在内部设定为 2.6V，但可通过使能引脚上的电阻网络设定阈值将之提高。输出电压启动斜坡由软启动引脚控制。一个开漏电源正常信号表示输出处于其标称电压值的 93% 至 107% 之内。频率折返和热关断功能在过流情况下保护器件不受损坏。
要获得更多 SWIFT ™文档，请参见 TI 网站 www.ti.com.cn/swift。
技术文档
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| 顶层文档 | 类型 | 标题 | 格式选项 | 下载最新的英语版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 数据表 | TPS54318 2.95V 至 6V 输入、3A 输出、2MHz、同步降压 SWIFT™ 转换器 数据表 (Rev. C) | PDF | HTML | 英语版 (Rev.C) | PDF | HTML | 2018-5-18 |
| 应用手册 | 半导体和 IC 封装热指标 (Rev. D) | PDF | HTML | 英语版 (Rev.D) | PDF | HTML | 2024-4-24 | |
| 选择指南 | Buck Converter Quick Reference Guide (Rev. B) | 2021-4-8 | ||||
| 应用手册 | Calculating Efficiency (Rev. A) | 2020-3-6 | ||||
| 选择指南 | SWIFT DC/DC Converters Selector Guide (Rev. G) | 2019-2-6 | ||||
| 选择指南 | 电源管理指南 2018 | 2018-7-31 | ||||
| 应用手册 | Understanding Thermal Dissipation and Design of a Heatsink | 2011-5-4 | ||||
| 应用手册 | Designing Type III Compensation for Current Mode Step-Down Converters (Rev. A) | 2010-9-15 | ||||
| 用户指南 | TPS54318EVM-512 3-A, SWIFT Regulator Evaluation Module | 2009-9-23 |
设计与开发
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计算工具
TPS54620DESIGN-CALC — TPS54620 and TPS54XXX Current-Mode Step-Down Converter Design Calculator
设计计算器与应用手册 (SLVA352A) 计算器工具可以计算 TPS54620/TPS54622/TPS54521/TPS54320/TPS54618/TPS54418/TPS54318/TPS54218/TPS54319 的临界外部组件值。此计算器包括功率级设计、功能设计以及类型 II 和类型 III 补偿设计，并且使用数据表方程和应用手册 (SLVA352A) 方程。此计算器利用常规功率级和补偿设计代数，可对大多数电流模式降压 DC/DC 转换器进行修改
参考设计
TIDA-010131 — 适用于雷达和无线 5G 测试仪的多通道射频收发器时钟参考设计
相控阵雷达、无线通信测试仪和电子战等高速终端设备的模拟前端需要同步的多收发器信号链。每个收发器信号链都包括高速模数转换器 (ADC)、数模转换器 (DAC) 和时钟子系统。时钟子系统提供具有精确延迟调整的低噪声采样时钟，以实现极低的通道间偏移和出色的系统性能，如信噪比 (SNR)、无杂散动态范围 (SFDR)、IMD3 和有效位数 (ENOB) 等。此参考设计通过 AFE7444 EVM 展示了多通道 JESD204B 时钟生成和系统性能。通过高达 2.6GHz 射频的 6GSPS/3GSPS DAC/ADC 时钟实现的优于 10ps 的通道间偏移，并且 SNR 和 SFDR 等系统性能与 (...)
参考设计
TIDA-01021 — 适用于 DSO、雷达和 5G 无线测试器的多通道 JESD204B 15GHz 时钟参考设计
高速多通道应用需要精确的时钟解决方案来管理通道间偏移，以实现最佳系统 SNR、SFDR 和 ENOB。本参考设计通过 TI 的 LMX2594 宽带 PLL 及集成式 VCO，可为 JESD204B 接口生成 10MHz 至 15GHz 的时钟信号和 SYSREF，从而支持两块独立板卡上的两个高速通道。时钟频率为 15GHz 时，10KHz 偏移相位噪声小于 -104dBc/Hz。 通过使用 TI 的 ADC12DJ3200 高速转换器 EVM，可实现小于 10ps 的板对板时钟偏斜以及 49.6dB 的 SNR（输入信号为 (...)
参考设计
TIDA-01023 — 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 时钟生成参考设计
高速多通道应用需要低噪声、可扩展且可进行精确通道间偏移调节的时钟解决方案，以实现最佳系统 SNR、SFDR 和 ENOB。该参考设计使用一个主时钟器件和多个从时钟器件，支持高通道数 JESD204B 同步时钟。该设计采用 TI 的 LMK04828 时钟抖动清除器和带有集成式 VCO 的 LMX2594 宽带 PLL，可提供多通道 JESD204B 时钟，能够实现低于 10ps 的时钟间偏移。此设计在 3GSPS 环境中经过 TI ADC12DJ3200 EVM 的检测，具有更好的 SNR 性能，通道间偏移低于 (...)
参考设计
TIDA-01024 — 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 菊花链时钟参考设计
高速多通道应用需要低噪声、可扩展且可进行精确通道间偏移调节的时钟解决方案，以实现最佳系统 SNR、SFDR 和 ENOB。该参考设计支持在菊花链配置中增加 JESD204B 同步时钟。该设计采用 TI 的 LMK04828 时钟抖动清除器和带有集成式 VCO 的 LMX2594 宽带 PLL，可提供多通道 JESD204B 时钟，能够实现低于 10ps 的时钟间偏移。此设计在 3GSPS 环境中经过 TI ADC12DJ3200 EVM 的检测，具有更好的 SNR 性能，通道间偏移低于 (...)
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| WQFN (RTE) | 16 | Ultra Librarian |
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