产品详情

Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 12 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 3000 Architecture Folding Interpolating SNR (dB) 57.6 ENOB (Bits) 9 SFDR (dB) 75 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 12 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 3000 Architecture Folding Interpolating SNR (dB) 57.6 ENOB (Bits) 9 SFDR (dB) 75 Operating temperature range (°C) -40 to 85 Input buffer Yes
FCCSP (ZEG) 144 100 mm² (10 mm × 10 mm) FCCSP (AAV) 144 100 mm² (10 mm × 10 mm)
  • ADC 内核:
    • 12 位分辨率
    • 单通道模式下采样率高达 6.4GSPS
    • 双通道模式下采样率高达 3.2GSPS
  • 性能规格:
    • 本底噪声(无信号,VFS = 1.0VPP-DIFF):
      • 双通道模式:–151.8dBFS/Hz
      • 单通道模式:–154.6dBFS/Hz
    • HD2、HD3:–65dBc,高达 3GHz
  • VCMI 为 0V 时的缓冲模拟输入:
    • 模拟输入带宽 (-3dB):8.0GHz
    • 可用输入频率范围:>10GHz
    • 满量程输入电压(VFS,默认值):0.8VPP
    • 模拟输入共模电压 (VICM):0V
  • 无噪声孔径延迟 (TAD) 调节:
    • 采样精度控制:19fs 步长
    • 简化同步和交错
    • 温度和电压不变延迟
  • 简便易用的同步 特性:
    • 自动 SYSREF 计时校准
    • 样片标记时间戳
  • JESD204B 串行数据接口:
    • 支持子类 0 和 1
    • 最大通道速率:12.8Gbps
    • 多达 16 个通道可降低通道速率
  • 双通道模式下的数字下变频器:
    • 实际输出:DDC 旁路或双倍抽取
    • 复杂输出:4 倍、8 倍或 16 倍抽取
    • 每个 DDC 均具有四个独立的 32 位 NCO
  • 功耗:3W
  • 电源电压:1.1V、1.9V
  • ADC 内核:
    • 12 位分辨率
    • 单通道模式下采样率高达 6.4GSPS
    • 双通道模式下采样率高达 3.2GSPS
  • 性能规格:
    • 本底噪声(无信号,VFS = 1.0VPP-DIFF):
      • 双通道模式:–151.8dBFS/Hz
      • 单通道模式:–154.6dBFS/Hz
    • HD2、HD3:–65dBc,高达 3GHz
  • VCMI 为 0V 时的缓冲模拟输入:
    • 模拟输入带宽 (-3dB):8.0GHz
    • 可用输入频率范围:>10GHz
    • 满量程输入电压(VFS,默认值):0.8VPP
    • 模拟输入共模电压 (VICM):0V
  • 无噪声孔径延迟 (TAD) 调节:
    • 采样精度控制:19fs 步长
    • 简化同步和交错
    • 温度和电压不变延迟
  • 简便易用的同步 特性:
    • 自动 SYSREF 计时校准
    • 样片标记时间戳
  • JESD204B 串行数据接口:
    • 支持子类 0 和 1
    • 最大通道速率:12.8Gbps
    • 多达 16 个通道可降低通道速率
  • 双通道模式下的数字下变频器:
    • 实际输出:DDC 旁路或双倍抽取
    • 复杂输出:4 倍、8 倍或 16 倍抽取
    • 每个 DDC 均具有四个独立的 32 位 NCO
  • 功耗:3W
  • 电源电压:1.1V、1.9V

ADC12DJ3200 器件是一款射频采样千兆采样模数转换器 (ADC),可对从直流到 10GHz 以上的输入频率进行直接采样。在双通道下,ADC12DJ3200 的最大采样率为 3200MSPS,单通道模式下的最大采样率为 6400MSPS。通道数(双通道模式)和奎斯特带宽(单通道模式)的可编程交换功能可用于开发灵活的硬件,以满足高通道数或宽瞬时信号带宽 应用的需求。8.0GHz 的全功率输入带宽 (-3dB),可用频率在双通道和单通道模式下均超过 -3dB,可对频率捷变系统的 L、S、C 和 X 频带进行直接射频采样。

ADC12DJ3200 采用具有多达 16 个串行通道和子类 1 兼容性的高速 JESD204B 输出接口,可实现确定性延迟和多器件同步。串行输出通道支持高达 12.8Gbps 的速率,并可配置交换位速率和通道数。 创新同步 具有无噪声孔径延迟 (TAD) 调节和 SYSREF 窗口等创新的同步特性,简化了相控阵雷达和 MIMO 通信的系统设计。 采用双通道模式的可选数字下变频器 (DDC) 可以降低接口速率(实际和复杂抽取模式),支持数字化信号混合(仅复杂抽取模式)。

ADC12DJ3200 器件是一款射频采样千兆采样模数转换器 (ADC),可对从直流到 10GHz 以上的输入频率进行直接采样。在双通道下,ADC12DJ3200 的最大采样率为 3200MSPS,单通道模式下的最大采样率为 6400MSPS。通道数(双通道模式)和奎斯特带宽(单通道模式)的可编程交换功能可用于开发灵活的硬件,以满足高通道数或宽瞬时信号带宽 应用的需求。8.0GHz 的全功率输入带宽 (-3dB),可用频率在双通道和单通道模式下均超过 -3dB,可对频率捷变系统的 L、S、C 和 X 频带进行直接射频采样。

ADC12DJ3200 采用具有多达 16 个串行通道和子类 1 兼容性的高速 JESD204B 输出接口,可实现确定性延迟和多器件同步。串行输出通道支持高达 12.8Gbps 的速率,并可配置交换位速率和通道数。 创新同步 具有无噪声孔径延迟 (TAD) 调节和 SYSREF 窗口等创新的同步特性,简化了相控阵雷达和 MIMO 通信的系统设计。 采用双通道模式的可选数字下变频器 (DDC) 可以降低接口速率(实际和复杂抽取模式),支持数字化信号混合(仅复杂抽取模式)。

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ADC08DJ5200RF 正在供货 具有双通道 5.2GSPS 或单通道 10.4GSPS 的射频采样 8 位 ADC ADC08DJ5200RF offers higher speed, lower resolution, and no DDC.

设计与开发

如需其他信息或资源,请点击以下任一标题进入详情页面查看(如有)。

评估板

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ADC12DJ3200 评估模块 (EVM) 用于评估 ADC12DJ3200 系列高速模数转换器 (ADC)。该 EVM 装配了 ADC12DJ3200,后者是一款具有 JESD204B 接口的 12 位双通道 3.2GSPS 或单通道 6.4GSPS ADC,可评估该系列中的所有分辨率和采样率器件。
用户指南: PDF
支持的产品和硬件
有库存
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无货
评估板

ABACO-3P-FMC134 — Abaco Systems® 直接射频转换 4 通道 3.2GSPS 或 2 通道 6.4GSPS ADC FPGA 夹层卡

Abaco FMC134 提供四个 12 位 3.2GSPS 或两个 12 位 6.4GSPS 模数转换器 (ADC)。该模块的亮点是子卡中的德州仪器 (TI) ADC12DJ3200 双通道、12 位、3.2GSPS ADC(两个),其使用 JEDEC JESD204B 数据转换器数字接口且具有 FPGA 夹层卡 (FMC) 连接器。

FMC134 在机械和电气方面符合 FMC+ 标准 (ANSI/VITA 57.4)。该卡通过标准高引脚数 (HPC) 连接器连接到 FPGA 承载卡。

来源:Abaco Systems
支持的产品和硬件
评估板

ANNAP-3P-WWDM60 — Annapolis Microsystems 4 通道 ADC,2 通道 DAC FPGA 夹层卡,高达 10GSPS

This high performance WILD FMC+ DM60 ADC & DAC has two input bandwidth options, internal sample clock options and internal 10MHz reference clock options. The WWDM60 has a choice of speed grades that utilize the ADC12DJ2700, ADC12DJ3200 and ADC12DJ5200RF up to 10GSPS. It allows for ADC and DAC (...)
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PENTEK-3P-71141-XMC — Pentek Model 71141 单通道 6.4GHz 或 2 通道 3.2GHz ADC、2 通道 6.4GHz DAC Kintex UltraScale - XMC

您可以考虑将采用 ADC12DJ3200 的现成完整电路板用于加速项目进程。Pentek Jade® Model 71141 是一款采用德州仪器 (TI) ADC12DJ3200 ADC 的理想雷达和软件无线电接口解决方案。除 6.4GSPS DAC 外,Pentek 解决方案还可提供单通道 6.4GSPS 12 位 ADC 或双通道 3.2GSPS 12 位 ADC,从而支持与采用 VITA 42.0 XMC 形式、具有 5GB DDR4 SDRAM 和 PCI Express 接口的 Xilinx Kintex Ultrascale FPGA 搭配使用。Pentek 还提供支持 (...)

来源:Pentek Inc.
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固件

SLAC748 — Arria10 + ADC12DJ3200 JMODE0 Design Firmware

支持的产品和硬件
固件

SLVC698 — Xilinx KCU105 + ADC12DJ3200 JMODE0/JMODE2 Design Firmware

支持的产品和硬件
固件

TI204C-IP — Request for JESD204 rapid design IP

JESD204 快速设计 IP 旨在为 FPGA 工程师提供一条快速通往运行中的 JESD204 系统的路径。该 IP 经过特别设计,可将下游数字处理和其他应用逻辑与 JESD204 协议的大多数性能和时序关键型限制因素隔离开。该 IP 将帮助设计人员节省固件开发时间并简化 FPGA 集成。

当您使用 TI 的高速数据转换器时,可免专利费使用 JESD204 快速设计 IP。TI 将协助用户配置初始链路,对其进行定制,以便在特定 FPGA 平台和 TI 数据转换器 JMODE 之间使用。在对该 IP 进行测试并确定其可以用于部署工作之后,TI 将会通过安全的下载链接提供该 IP。

JESD204 (...)

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评估模块 (EVM) 用 GUI

DATACONVERTERPRO-SW — 高速数据转换器专业 GUI 安装程序,v5.31

该高速数据转换器专业版 GUI 是一款 PC(与 Windows® XP/7/10 兼容)程序,旨在帮助评估大多数 TI 高速数据转换器 [模数转换器 (ADC) 和数模转换器 (DAC)] 和模拟前端 (AFE) 平台。DATACONVERTERPRO-SW 支持整个 TSW14xxx 系列的数据采集和图形生成卡,为分析时域和频域中的数据转换器提供了快速强大的解决方案以及单音、多音和调制信号支持。此 GUI 还兼容用于快速合成单音、多音和调制信号的 TI 图形生成 GUI。

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仿真模型

ADC12DJ3200 and ADC12DJ3200QML-SP IBIS and IBIS-AMI Model

SLVMDV3.ZIP (47828 KB) - IBIS-AMI 模型
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仿真模型

ADC12DJ3200 S-Parameter Model

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支持的产品和硬件
计算工具

ADC12DJ5200RF-HSACCURACY-CALC — Accuracy calculation for ADC12DJ5200RF with amplifier input

DC accuracy calculator which accounts for ADC and amplifier noise and imperfections.
支持的产品和硬件
计算工具

FREQ-DDC-FILTER-CALC — RF-Sampling Frequency Planner, Analog Filter, and DDC Excel Calculator

此 Excel 计算器为系统设计人员提供了一种方法,用于简化直接射频采样接收器的设计和调试过程。它提供三种功能:频率规划、模拟滤波和抽取滤波器杂散位置。

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外部射频滤波器响应很大程度上取决于系统 SFDR 目标和 ADC 本身的 SFDR 性能;模拟滤波器工具可在设计阶段提供相关帮助。

在系统启动期间,如果快速傅里叶变换 (FFT) (...)

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参考设计

TIDA-010122 — 同步多通道射频系统数据转换器 DDC 和 NCO 特性的参考设计

由于 5G 的兴起,大规模多输入多输出 (mMIMO)、相控阵雷达和通信有效载荷等应用需要进行相应的调整,由此带来了同步设计挑战,该参考设计可解决这些挑战。典型射频前端包括模拟域中的天线、低噪声放大器 (LNA)、混频器、本机振荡器 (LO),以及数字域中的模数转换器、数字控制振荡器 (NCO) 和数字下变频器 (DDC)。要实现总体系统同步,这些数字块需要与系统时钟进行同步。该参考设计使用 ADC12DJ3200 数据转换器,通过将片上 NCO 与 SYNC~ 进行同步获得确定性延迟,以此在多个接收器上实现小于 5ps 的通道间偏移,并使用无噪声孔径延迟调节(tAD (...)

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参考设计

TIDA-01021 — 适用于 DSO、雷达和 5G 无线测试器的多通道 JESD204B 15GHz 时钟参考设计

高速多通道应用需要精确的时钟解决方案来管理通道间偏移,以实现最佳系统 SNR、SFDR 和 ENOB。本参考设计通过 TI 的 LMX2594 宽带 PLL 及集成式 VCO,可为 JESD204B 接口生成 10MHz 至 15GHz 的时钟信号和 SYSREF,从而支持两块独立板卡上的两个高速通道。时钟频率为 15GHz 时,10KHz 偏移相位噪声小于 -104dBc/Hz。  通过使用 TI 的 ADC12DJ3200 高速转换器 EVM,可实现小于 10ps 的板对板时钟偏斜以及 49.6dB 的 SNR(输入信号为 (...)
支持的产品和硬件
参考设计

TIDA-01022 — 适用于 DSO、雷达和 5G 无线测试系统的灵活 3.2GSPS 多通道 AFE 参考设计

此高速多通道数据采集参考设计可实现最佳系统性能。系统设计人员需要考虑关键的设计参数,如高速多通道时钟生成功能的时钟抖动和偏斜,这会影响整个系统的 SNR、SFDR、通道间偏斜和确定性延迟。此参考设计演示了多通道 AFE 和时钟解决方案,采用具有 JESD204B 的高速数据转换器、高速放大器、高性能时钟和低噪声电源解决方案,可实现最佳系统性能
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TIDA-01023 — 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 时钟生成参考设计

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参考设计

TIDA-01024 — 适用于雷达和 5G 无线测试仪的高通道数 JESD204B 菊花链时钟参考设计

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支持的产品和硬件
参考设计

TIDA-01027 — 可最大限度提升 12.8GSPS 数据采集系统性能的低噪声电源参考设计

此参考设计展示了用于能超过 12.8GSPS 的超高速数据采集 (DAQ) 系统的高效率、低噪声五轨电源设计。该电源直流/直流转换器进行了频率同步和相移,从而最大限度降低输入电流纹波并控制频率内容。使用高性能的 HotRod­™ 封装技术可将任何潜在的辐射电磁干扰 (EMI) 降至最低。
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TIDA-01028 — 适用于高速示波器和宽带数字转换器的 12.8GSPS 模拟前端参考设计

此参考设计提供了一个可实现 12.8GSPS 采样率的交错射频采样模数转换器 (ADC) 的实用示例。这一方案可通过时序交错两个射频采样 ADC 来完成。交错处理需要在 ADC 之间进行相移,此参考设计通过 ADC12DJ3200 的无噪声孔径延迟调节(tAD 调节)功能来实现这一点。此功能还可用于最大限度地减少交错 ADC 常见的失配问题,从而尽可能提升 SNR、ENOB 和 SFDR 性能。此参考设计还采用了一套支持 JESD204B 的低相位噪声时钟树。其采用 LMX2594 宽带 PLL 和 LMK04828 合成器以及抖动清除器。
支持的产品和硬件
参考设计

TIDA-01442 — 使用 ADC12DJ3200 的 L、S、C 和 X 带的直接射频采样雷达接收器参考设计

此参考设计利用 ADC12DJ3200 评估模块 (EVM) 演示直接射频采样接收器,适用于在 HF、VHF、UHF、L、S、C 和部分 X 带上运行的雷达。模数转换器 (ADC) 的宽模拟输入带宽和高采样率 (6.4GSPS) 可为单通道或双通道 ADC 提供多频带覆盖。该 ADC 具有直接射频采样功能,取消了对多个降压转换级的需求,减少了组件数量,因此降低了系统整体的复杂性。

支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
FCCSP (ZEG) 144 Ultra Librarian
FCCSP (AAV) 144 Ultra Librarian

订购和质量

推荐产品可能包含与 TI 此产品相关的参数、评估模块或参考设计。

支持和培训

可获得 TI 工程师技术支持的 TI E2E™ 论坛

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