ZHCZ029D July   2023  – April 2025 TMS320F28P650DH , TMS320F28P650DK , TMS320F28P650SH , TMS320F28P650SK , TMS320F28P659DH-Q1 , TMS320F28P659DK-Q1 , TMS320F28P659SH-Q1

 

  1.   1
  2.   TMS320F28P65x MCU 器件勘误表器件修订版本 A、0
  3. 1使用说明和公告模型
    1. 1.1 使用说明汇总表
    2. 1.2 公告汇总表
  4. 2命名规则、封装编号法和修订版本标识
    1. 2.1 器件和开发支持工具命名规则
    2. 2.2 支持的器件
    3. 2.3 封装编号法和修订版本标识
  5. 3器件修订版本 A 使用说明和公告
    1. 3.1 器修订版本 A 使用说明
      1. 3.1.1 PIE：背对背 PIEACK 写入和手动 CPU 中断屏蔽清除之后的伪波嵌套中断
      2. 3.1.2 将嵌套中断与重复块一起使用时的注意事项
      3. 3.1.3 GPIO：GPIO 数据寄存器仅通过 CPU1 复位进行复位
      4. 3.1.4 安全性：主要的防御层是构建芯片安全边界，从启用 JTAGLOCK 和零引脚引导至闪存功能开始
    2. 3.2 器件修订版本 A 公告
      1.      公告
      2.      公告
      3.      公告
      4. 3.2.1 公告
      5.      公告
      6. 3.2.2 公告
      7. 3.2.3 公告
      8. 3.2.4 公告
      9.      公告
      10.      公告
      11.      公告
      12.      公告
      13.      公告
      14. 3.2.5 公告
      15.      公告
      16.      公告
      17.      公告
      18.      公告
  6. 4器件修订版本 0 使用说明和公告
    1. 4.1 器件修订版本 0 使用说明
    2. 4.2 器件修订版本 0 公告
      1. 4.2.1 公告
  7. 5文档支持
  8. 6商标
  9. 7修订历史记录

公告

MCD：启用 PLL (PLLCLKEN = 1) 后，应该禁用时钟丢失检测

受影响版本

0、A

详细信息

PLL 具有跛行模式功能，可提供慢速 PLLRAWCLK 输出（即使缺少其输入 OSCCLK）。另外，当检测到缺少 OSCCLK 输入时，时钟丢失检测 (MCD) 电路会强制将系统时钟源切换到 INTOSC1。当两个时钟源（PLLRAWCLK 和 INTOSC1）都仍然有效时，无法确保在这些系统时钟源之间切换的 MCD 多路复用器无干扰。在极少数情况下，这可能会导致在时钟丢失故障事件期间出现不可预测的器件行为。

应变方法

当系统使用 PLL (PLLCLKEN = 1) 时，可通过写入 MCDCR.MCLKOFF = 1 来禁用 MCD。

可对双时钟比较器 (DCC) 电路进行配置，以快速检测 SYSCLK 频率是否由于时钟丢失事件而降至低于所需频率，导致进入跛行模式。

当系统以 PLL 旁路模式 (PLLCLKEN = 0) 运行时，仍可使用 MCD 电路来检测时钟丢失事件并将时钟源切换到 INTOSC1。