ZHCSXM5A December   2024  – April 2025 ADC3664-SP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性 - 功耗
    6. 5.6 电气特性 - 直流规格
    7. 5.7 电气特性 - 交流规格
    8. 5.8 时序要求
    9. 5.9 典型特性
  7. 6 参数测量信息
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 模拟输入
        1. 7.3.1.1 模拟输入带宽
        2. 7.3.1.2 模拟前端设计
          1. 7.3.1.2.1 采样干扰滤波器
          2. 7.3.1.2.2 交流耦合
          3. 7.3.1.2.3 直流耦合
      2. 7.3.2 时钟输入
        1. 7.3.2.1 差分与单端时钟输入
        2. 7.3.2.2 信号采集时间调整
      3. 7.3.3 电压基准
        1. 7.3.3.1 内部电压基准
        2. 7.3.3.2 外部电压基准
      4. 7.3.4 数字数据路径和接口
        1. 7.3.4.1 数据路径概述
        2. 7.3.4.2 数字接口
        3. 7.3.4.3 DCLKIN
        4. 7.3.4.4 输出扰频器
        5. 7.3.4.5 输出位映射器
          1. 7.3.4.5.1 2 线模式
          2. 7.3.4.5.2 1 线模式
          3. 7.3.4.5.3 1/2 线模式
        6. 7.3.4.6 输出数据格式
        7. 7.3.4.7 测试图形
      5. 7.3.5 数字下变频器
        1. 7.3.5.1 抽取操作
        2. 7.3.5.2 数控振荡器 (NCO)
        3. 7.3.5.3 抽取滤波器
        4. 7.3.5.4 SYNC
        5. 7.3.5.5 带抽取因子的输出数据格式
    4. 7.4 器件功能模式
      1. 7.4.1 低延迟模式
      2. 7.4.2 取平均数模式
    5. 7.5 编程
      1. 7.5.1 引脚控制
      2. 7.5.2 串行外设接口 (SPI)
        1. 7.5.2.1 寄存器写入
        2. 7.5.2.2 寄存器读取
      3. 7.5.3 器件配置步骤
      4. 7.5.4 寄存器映射
        1. 7.5.4.1 寄存器详细说明
  9. 8 应用信息免责声明
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
    3. 8.3 初始化设置
    4. 8.4 电源相关建议
    5. 8.5 布局
      1. 8.5.1 布局指南
      2. 8.5.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 接收文档更新通知
    2. 9.2 支持资源
    3. 9.3 商标
    4. 9.4 静电放电警告
    5. 9.5 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息
    1. 11.1 机械数据

7.1 概述

ADC3664-SP 是一款低延迟、低噪声、超低功耗 14 位高速双通道 ADC，最大采样率为 125MSPS，适用于任务剖面为电离辐射总剂量 (TID) 小于 300krad (Si) 且单粒子闩锁 (SEL) 小于 75MeV-cm2/mg 的航天应用。ADC 有一个内部基准选项，并支持使用外部、高精度、1.6V 基准（请参阅节 7.3.3）。（可选）集成式可编程数字下变频器 (DDC) 可降低输出数据速率并实现通道化（请参阅节 7.3.5）。如果在复数抽取模式下运行，DDC 将为复杂混合提供 32 位可编程 NCO。DDC 还支持无混合的实数抽取模式。

ADC3664-SP 使用串行 LVDS (SLVDS) 接口输出数据，可更大限度减少数字互连的次数（请参阅节 7.3.4.2）。SLVDS 接口可配置为以下模式之一：每个通道两条 LVDS 信道（2 线），每个通道一条 LVDS 信道（1 线）或单信道模式（1/2 线）（其中两个通道在同一个 LVDS 信道上多路复用）。该器件支持从 14 位到 20 位的可配置输出分辨率。由于固有的低延迟 ADC 架构，只需经过一两个时钟周期即可获得数字输出结果，具体取决于输出接口模式。

ADC3664-SP 旨在通过配置寄存器（节 7.5）而通过串行外设接口 (SPI) 进行控制；然而，CTRL 引脚也可用于配置上电时的电压基准源和采样时钟输入类型。