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ZHCSZF6 December 2025 DLP3940S-Q1

ADVANCE INFORMATION

5.8 时序要求

在自然通风条件下的工作温度范围内测得（除非另有说明）

			最小值	标称值	最大值	单位
LVCMOS
LPSDR
t_r	上升压摆率⁽²⁾	（20% 至 80%）× VDD⁽⁶⁾	0.25			V/ns
t_f	下降压摆率⁽²⁾	（80% 至 20%）× VDD⁽⁶⁾	0.25			V/ns
t_r	上升压摆率⁽¹⁾	（30% 至 80%）× VDD⁽⁶⁾	1		3	V/ns
t_f	下降压摆率⁽¹⁾	（70% 至 20%）× VDD⁽⁶⁾	1		3	V/ns
t_W(H)	脉冲持续时间 LS_CLK 高电平	50% 至 50% 基准点⁽⁵⁾	4.2			ns
t_W(L)	脉冲持续时间 LS_CLK low	50% 至 50% 基准点⁽⁵⁾	4.2			ns
t_su	建立时间	在 LS_CLK 之前 LS_WDATA 有效⁽⁵⁾			1.5	ns
t_h	保持时间	在 LS_CLK 之后 LS_WDATA 有效⁽⁵⁾			1.5	ns
SubLVDS
t_r	上升压摆率	20% 至 80% 基准点⁽⁷⁾	0.7	1		V/ns
t_f	下降压摆率	80% 至 20% 基准点⁽⁷⁾	0.7	1		V/ns
t_W(H)	脉冲持续时间 DCLK 高电平	50% 至 50% 基准点⁽⁸⁾	0.7			ns
t_W(L)	脉冲持续时间 DCLK 低电平	50% 至 50% 基准点⁽⁸⁾	0.7			ns
t_WINDOW	窗口时间 ⁽¹⁾⁽³⁾	建立时间 + 保持时间⁽⁵⁾	0.25			ns
t_su	建立时间	HS_DATA 在 HS_CLK 之前有效 ⁽⁸⁾			0.17	ns
t_h	保持时间	HS_DATA 在 HS_CLK 之后有效 ⁽⁸⁾			0.17	ns
t_POWER	接收器上电⁽⁴⁾				200	ns

(1) 此规格适用于 DMD_DEN_ARSTZ 引脚。请参阅图 5-3 中的 LPSDR 输入上升和下降压摆率。

(2) 此规格适用于 LS_CLK 和 LS_WDATA 引脚。请参阅图 5-3 中的 LPSDR 输入上升和下降转换率。

(3) 窗口时间降额示例：0.5V/ns 压摆率会将窗口时间增加 0.7ns，从 3ns 增加到 3.7ns。请参阅图 5-5。

(4) 该规格仅适用于 SubLVDS 接收器时间，不考虑命令和命令后的延迟。

(5) 请参阅图 5-2。

(6) 请参阅图 5-3。

(7) 请参阅图 5-4。

(8) 请参阅图 5-6。