ZHCSPN8 January   2024 TAA5412-Q1

ADVANCE INFORMATION  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  热性能信息
    6. 5.6  电气特性
    7. 5.7  时序要求：I2C 接口
    8. 5.8  开关特性：I2C 接口
    9. 5.9  时序要求：TDM、I2S 或 LJ 接口
    10. 5.10 开关特性：TDM、I2S 或 LJ 接口
    11. 5.11 时序要求：PDM 数字麦克风接口
    12. 5.12 开关特性：PDM 数字麦克风接口
    13. 5.13 时序图
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 串行接口
        1. 6.3.1.1 控制串行接口
        2. 6.3.1.2 音频串行接口
          1. 6.3.1.2.1 时分多路复用 (TDM) 音频接口
          2. 6.3.1.2.2 IC 间音频 (I2S) 接口
          3. 6.3.1.2.3 左对齐 (LJ) 接口
      2. 6.3.2 通过共享总线使用多个器件
      3. 6.3.3 锁相环 (PLL) 和时钟生成
      4. 6.3.4 输入通道配置
      5. 6.3.5 基准电压
      6. 6.3.6 麦克风偏置
      7. 6.3.7 输入直流故障诊断
        1. 6.3.7.1 故障条件
          1. 6.3.7.1.1 输入引脚接地短路
          2. 6.3.7.1.2 输入引脚短接至 MICBIAS
          3. 6.3.7.1.3 开路输入
          4. 6.3.7.1.4 INxP 和 INxM 之间的短接
          5. 6.3.7.1.5 输入引脚过压
          6. 6.3.7.1.6 输入引脚短接至 VBAT_IN
        2. 6.3.7.2 故障报告
          1. 6.3.7.2.1 过流和过热保护
      8. 6.3.8 信号链处理
        1. 6.3.8.1 ADC 信号链
          1. 6.3.8.1.1 可编程通道增益和数字音量控制
          2. 6.3.8.1.2 可编程通道增益校准
          3. 6.3.8.1.3 可编程通道相位校准
          4. 6.3.8.1.4 可编程数字高通滤波器
          5. 6.3.8.1.5 可编程数字双二阶滤波器
          6. 6.3.8.1.6 可编程通道加法器和数字混频器
          7. 6.3.8.1.7 可配置数字抽取滤波器
            1. 6.3.8.1.7.1 线性相位滤波器
              1. 6.3.8.1.7.1.1 采样速率：16kHz 或 14.7kHz
              2. 6.3.8.1.7.1.2 采样速率：24kHz 或 22.05kHz
              3. 6.3.8.1.7.1.3 采样速率：32kHz 或 29.4kHz
              4. 6.3.8.1.7.1.4 采样速率：48kHz 或 44.1kHz
              5. 6.3.8.1.7.1.5 采样速率：96kHz 或 88.2kHz
              6. 6.3.8.1.7.1.6 采样速率：384kHz 或 352.8kHz
      9. 6.3.9 中断、状态和数字 I/O 引脚多路复用
    4. 6.4 器件功能模式
  8. 7 寄存器映射
    1. 7.1 TAA5412-Q1 寄存器
    2. 7.2 TAA5412-Q1 寄存器
    3. 7.3 TAA5412-Q1 寄存器
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 应用
      2. 8.2.2 设计要求
      3. 8.2.3 详细设计过程
  10. 9 电源相关建议
  11. 10器件和文档支持
    1. 10.1 文档支持
      1. 10.1.1 相关文档
    2. 10.2 接收文档更新通知
    3. 10.3 支持资源
    4. 10.4 商标
    5. 10.5 静电放电警告
    6. 10.6 术语表
  12. 11修订历史记录
  13. 12机械、封装和可订购信息
    1. 12.1 卷带包装信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息
6.3.1.2.1 时分多路复用 (TDM) 音频接口

在 TDM 模式（也称为 DSP 模式）下，FSYNC 的上升沿会首先从时隙 0 数据开始数据传输。紧接着时隙 0 数据传输，会按顺序传输剩余的时隙数据。FSYNC 和每个数据位（TX_OFFSET 等于 0 时，时隙 0 的 MSB 除外）会在 BCLK 的上升沿传输。图 6-1 至图 6-4 展示了各种配置下 TDM 运行的协议时序。

GUID-8E17DFB9-8743-4E2E-AB2F-D14C93FDCFF1-low.gif图 6-1 TDM 模式标准协议时序 (PASI_TX_OFFSET = 0)
GUID-20C86F12-3750-4DA3-A3FA-1174AA8BFEEA-low.gif图 6-2 TDM 模式协议时序 (PASI_TX_OFFSET = 2)
GUID-F55627ED-7EB8-4204-A59A-DFFE5F29FB5D-low.gif图 6-3 TDM 模式协议时序（无空闲 BCLK 周期，PASI_TX_OFFSET = 2）
GUID-342961AB-C302-472C-8B74-34667D180907-low.gif图 6-4 TDM 模式协议时序（PASI_TX_OFFSET = 0 且 PASI_BCLK_POL = 1）

为了使音频总线在 TDM 模式下正常运行，每帧的位时钟数必须大于或等于活动输出通道数乘以输出通道数据的编程字长。该器件支持 FSYNC 作为具有 1 周期宽位时钟的脉冲，同时也支持倍数。对于更高 BCLK 频率的运行，建议使用 PASI_TX_OFFSET 值大于 0 的 TDM 模式。