具有适用于 DDR2、DDR3、DDR3L 和 DDR4 的 VTTREF 缓冲基准的 3A 灌/拉 DDR 终端稳压器

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产品详细信息

参数

DDR memory type DDR, DDR2, DDR3, DDR3L, DDR4, LPDDR2, LPDDR3 Control mode D-CAP, S3, S4/S5 Iout VTT (Max) (A) 3 Iq (Typ) (mA) 0.5 Output VREF, VTT Vin (Min) (V) 1.1 Vin (Max) (V) 3.5 Features S3/S5 Support Rating Catalog Operating temperature range (C) -40 to 85 open-in-new 查找其它 DDR 存储器电源 IC

封装|引脚|尺寸

VSON (DRC) 10 9 mm² 3 x 3 VSON (DRC) 10 9 mm² 3.00 x 3.00 open-in-new 查找其它 DDR 存储器电源 IC

特性

  • Input Voltage: Supports 2.5-V Rail and 3.3-V Rail
  • VLDOIN Voltage Range: 1.1 V to 3.5 V
  • Sink and Source Termination Regulator Includes Droop Compensation
  • Requires Minimum Output Capacitance of 20-µF (Typically 3 × 10-µF MLCCs) for Memory Termination Applications (DDR)
  • PGOOD to Monitor Output Regulation
  • EN Input
  • REFIN Input Allows for Flexible Input Tracking Either Directly or Through Resistor Divider
  • Remote Sensing (VOSNS)
  • ±10-mA Buffered Reference (REFOUT)
  • Built-in Soft Start, UVLO, and OCL
  • Thermal Shutdown
  • Supports DDR, DDR2, DDR3, DDR3L, Low-Power DDR3, and DDR4 VTT Applications
  • 10-Pin VSON Package With Thermal Pad

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描述

The TPS51200 device is a sink and source double data rate (DDR) termination regulator specifically designed for low input voltage, low-cost, low-noise systems where space is a key consideration.

The TPS51200 maintains a fast transient response and requires a minimum output capacitance of only 20 µF. The TPS51200 supports a remote sensing function and all power requirements for DDR, DDR2, DDR3, DDR3L, Low-Power DDR3 and DDR4 VTT bus termination.

In addition, the TPS51200 provides an open-drain PGOOD signal to monitor the output regulation and an EN signal that can be used to discharge VTT during S3 (suspend to RAM) for DDR applications.

The TPS51200 is available in the thermally efficient 10-pin VSON thermal pad package, and is rated both Green and Pb-free. It is specified from –40°C to +85°C.

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技术文档

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用户指南 Using the TPS51120 2008年 5月 28日

设计与开发

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硬件开发

评估板 下载
$1,146.54
说明
J6Entry、RSP 和 TDA2E-17 CPU 板 EVM 是一种评估平台,用于加快信息娱乐系统、可重新配置的数字群集或集成数字化驾驶舱以及 ADAS 应用的开发速度,并缩短其上市时间。CPU 板集成了并行摄像头接口、CAN、千兆位以太网、FPD-Link、USB3.0 和 HDMI 等主要外设。
特性
  • 2GB DDR3L
  • LP8733/LP8732 电源解决方案
  • 板载 eMMC、NAND、NOR
  • USB3、USB2、PCIe、以太网、COM8Q、CAN、MLB、MicroSD 和 HDMI 连接器
评估板 下载
$2,324.44
说明

J6Entry/RSP EVM 是一种评估平台,用于加快信息娱乐系统、可重新配置的数字群集或集成数字化驾驶舱等应用的开发速度,并缩短其上市时间。

主 CPU 板集成了以太网或 HDMI 等主要外设,而信息娱乐应用子板 (JAMR3) 和 LCD/TS 子板将补充 CPU 板,从而提供完整的系统以快速开始评估和应用开发。

特性
  • 具有电容式触控功能的 10.1" 显示
  • JAMR3 无线电调谐器应用板
  • 2GB DDR3L
  • LP8733/LP8732 电源解决方案
  • 板载 eMMC、NAND、NOR
  • USB3、USB2、PCIe、以太网、COM8Q、CAN、MLB、MicroSD 和 HDMI 连接器
评估板 下载
document-generic 用户指南
$49.00
说明

TPS51200EVM 评估板(即 HPA322A)用于评估成本优化的 TI DDR/DDR2/DDR3/LP DDR3 VTT 终止稳压器(即 TPS51200)的性能和特性。TPS51200 用于提供合适的终止电压并为具有最少外部组件的 DDR 存储器(包括 DDR (2.5 V/1.25 V)、DDR2 (1.8 V/0.9 V)、DDR3 (1.5 V/0.75 V)、LP DDR3 (1.2 V/0.6 V) 等规格)提供 10mA 缓冲参考电压。

特性
  • 输入电压:支持 2.5V 电压轨和 3.3V 电压轨
  • VLDOIN、VDDQ 电压范围:1.2V-2.5V
  • 具有吸入和输出功能的内置瞬态负载开关可模拟吸入/输出瞬态行为,从而帮助评估动态性能。为了方面使用,瞬态载荷级和定时都能通过板载电阻修改,同时也能在电路板上监控电流信息。
    • DDR:+/-1.67A 吸入/输出瞬态负载
    • DDR2:+/-1.2A 吸入/输出瞬态负载
    • DDR3:+/-1.0A 吸入/输出瞬态负载
    • LP DDR3:+/-0.8A 吸入/输出瞬态负载
  • 具有启用功能的转换开关 S1
  • 便捷的测试点,用于探测 PGOOD、CLK_IN 和环路响应测试
  • 2 层 PCB,所有组件都位于底部
评估板 下载
BeagleBone AI Tool Folder
由 BeagleBoard.org Foundation 提供
document-generic 用户指南
说明
什么是 BeagleBone® AI?

BeagleBone® AI 基于成熟的 BeagleBoard.org® 开源 Linux 方法构建,填补了小型 SBC 和功能更强大的工业计算机之间的空白。借助德州仪器 (TI) 的 Sitara™ AM5729 处理器,开发人员可充分利用 BeagleBone® Black 出色的接头和机械兼容性,轻松访问高度集成且功能强大的 SoC。BeagleBone® AI 有助于使用 Sitara 机器学习工具套件 (...)

设计工具和仿真

仿真模型 下载
SLUM148.TSC (127 KB) - TINA-TI Reference Design
仿真模型 下载
SLUM149.ZIP (18 KB) - TINA-TI Spice Model
仿真模型 下载
SLUM150.TSC (755 KB) - TINA-TI Reference Design
仿真模型 下载
SLUM151.ZIP (17 KB) - TINA-TI Spice Model
仿真模型 下载
SLVM068A.ZIP (38 KB) - PSpice Model
仿真模型 下载
SLVM069.ZIP (30 KB) - PSpice Model
物料清单 (BOM) 下载
TIDR156A.PDF (595 KB)
物料清单 (BOM) 下载
ZHCR005.PDF (334 KB)
物料清单 (BOM) 下载
ZHCR006.PDF (304 KB)
CAD/CAE 符号 下载
SLVC210.ZIP (1 KB)
PCB 布局 下载
TIDU151.PDF (6781 KB)
原理图 下载
SLVR360.PDF (166 KB)
原理图 下载
TIDR155A.PDF (598 KB)

参考设计

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Integrated power supply reference design for NXP iMX 7D processor
TIDA-050034 TIDA-050034 is a fully functional development board combining a TI PMIC, TPS65218DO, with NXP i.MX 7Dual Application Processor.

The hardware design consists of DDR3L SDRAM (2x512MB), 64MB Serial NOR Flash, 8GB eMMC 5.0 iNAND, SD Card interface v3.0, 50 pin LCD Connector for external TFT display (...)

document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
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工业通信网关 PROFINET IRT 转 PROFIBUS 主设备参考设计
TIDEP-0075 — PROFINET 可实现高速度、确定性通信和企业连接,因此正在成为自动化领域领先的工业以太网协议。但是,PROFIBUS (...)
document-generic 原理图 document-generic 用户指南
参考设计 下载
适用于 AM572x 的 OPC UA 数据访问服务器参考设计
TIDEP0078 — OPC UA 是一种工业机器对机器协议,用于在根据工业 4.0 标准连接的所有机器之间实现互操作和通信。TIDEP0078 TI 设计演示了如何使用 MatrikonOPC™ OPC UA 服务器开发套件 (SDK) 利用在项目或设计中嵌入运行的 OPC UA 数据访问 (DA (...)
document-generic 原理图 document-generic 用户指南
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用于工业通信和电机控制的单芯片驱动器
TIDEP0025 此 TI 设计基于 HEIDENHAIN EnDat 2.2 标准实现适用于位置和旋转编码器的硬件接口解决方案。该平台还让设计人员可以在各类工业自动化设备中实现实时 EtherCAT 通信标准。它通过体积小、功耗低的单芯片解决方案在工业自动化、工厂自动化或工业通信等应用中为设计人员提供帮助。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
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适用于保护继电器处理器模块的高效电源架构参考设计
TIDA-010011 — This reference design showcases various power architectures for generating multiple voltage rails for an application processor module, requiring >1A load current and high efficiency . The required power supply is generated using 5-, 12- or 24-V DC input from the backplane. Power supplies are (...)
document-generic 原理图
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适用于 Xilinx Zynq® UltraScale+™ ZU2CG−ZU5EV MPSoC 的集成电源参考设计
TIDA-01480 TIDA-01480 参考设计是一种可扩展的电源设计,旨在为 Xilinx Zynq UltraScale+ (ZU+) 系列 MPSoC 器件供电。此设计接收来自标准直流电源的电力,并通过明确的 Samtec 插座端子板连接方式为 Xilinx 芯片组和 DDR 存储器的所有电源轨供电。

此设计具有可扩展性,能够支持整个 ZU+ 系列的器件:从最基础的具有双核 ARM® Cortex™-A53 应用处理器和双核 ARM® Cortex™-R5 实时处理器的 ZU2CG (...)

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适用于 Xilinx® Zynq®-7、Spartan®-7 和 Zynq®-7000 FPGA 的集成电源参考设计
TIDA-050000 该参考设计是一种可扩展的电源设计,旨在为基于 FPGA 的 Artix-7、Spartan-7 和 Zynq-7000 系列器件供电。此设计接收来自标准直流电源的电力,并通过明确的 Samtec 插座端子板连接方式为 Xilinx 芯片组和 DDR 存储器的所有电源轨供电。

此设计具有可扩展性,能够支持最基本的 Spartan-7 FPGA 器件和配备千兆位级收发器 (MGT) 的更复杂 Artix-7 FPGA,最高可支持配备双核Arm Cortex-A9 处理器。由于其设计可扩展且与 Xilinx 系列设备非常相似,所以该参考设计基于 Xilinx Zynq UltraScale+ MPSoC 的 TIDA-01480 电源参考设计。

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基于 AM572x 处理器并采用 DLP® 结构光的 3D 机器视觉参考设计
TIDEP0076 — TIDEP0076 3D 机器视觉设计介绍了基于结构光原理的嵌入式 3D 扫描仪。将数码相机与 Sitara™ AM57xx 处理器片上系统 (SoC) 搭配使用,采集来自基于 DLP4500 的投影仪的反射光图形。可在 AM57xx 处理器 SoC (...)
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
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符合 EMI/EMC 标准的工业温度级双端口千兆位以太网参考设计
TIDA-00204 此设计用于对两个工业级 DP83867IR 千兆位以太网 PHY 和 Sitara™ 主机处理器(含集成式以太网 MAC 和交换机)进行性能评估。此设计旨在满足关于 EMI 和 EMC 的工业要求。此设计的应用固件实现了适用于 PHY、UDP 和 TCP/IP 协议栈以及 HTTP Web (...)
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
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关于 AM57x 使用 OpenCL 实现 DSP 加速的蒙特卡罗模拟参考设计
TIDEP0046 TI 基于 ARM® Cortex®-A15 的高性能 AM57x 处理器还集成了 C66x DSP。这些 DSP 旨在处理工业、汽车和金融应用中通常需要的高信号和数据处理任务。AM57x OpenCL 实施方案便于用户利用 DSP 加速来执行高度计算任务,同时使用标准编程模型和语言,从而无需深度了解 DSP 架构。TIDEP0046 TI 参考设计举例说明了如何使用 DSP 加速来利用标准 C/C++ 代码生成极长的普通随机数序列。
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采用 TI AM57x 处理器时的电源和散热设计注意事项参考设计
TIDEP0047 此 TI 参考设计 (TIDEP0047) 是基于 AM57x 处理器和配套 TPS659037 电源管理集成电路 (PMIC) 的参考平台。此 TI 参考设计特别强调在采用 AM57x 和 TPS659037 进行系统设计时的重要功率和热设计注意事项和技术。它包括各种参考资料和文档,涵盖电源管理设计、配电网络 (PDN) 设计注意事项、热设计注意事项、预计功耗和功耗摘要。  
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具有集成 BiSS C 主控接口的 ARM MPU
TIDEP0022 BiSS C 主协议在工业通信子系统上的实施 (PRU-ICSS)。该设计提供可编程实时单元 (PRU) 的完整文档和源代码。
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具有集成 HIPERFACE DSL 主接口的 ARM MPU 参考设计
TIDEP0035 HIPERFACE DSL 主协议在工业通信子系统 (PRU-ICSS) 上的实现。两线接口允许位置反馈线集成到电机电缆中。完整的解决方案包括 AM437x PRU-ICSS 固件和 TIDA-00177 收发器参考设计。
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EnDat 2.2 系统参考设计
TIDEP0050 TIDEP0050 TI 参考设计基于 HEIDENHAIN EnDat 2.2 标准实现了适用于位置或旋转编码器的 EnDat 2.2 主协议栈和硬件接口解决方案。此设计包含 EnDat 2.2 主协议栈、使用 RS485 收发器的半双工通信以及在 Sitara AM437x 工业开发套件上实施的线路端接。此设计经过完全测试,符合 HEIDENHAIN EnDat 2.2 标准。AM437x IDK 还可与 EnDat 位置反馈一起支持工业通信和电机驱动(如 AM437x 单芯片电机控制设计指南中所述)。
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适用于变电站自动化的并行冗余协议 (PRP) 以太网参考设计
TIDEP0054 — TIDEP0054 TI 参考设计可实现高可靠性、低延迟网络通信解决方案,适用于智能电网传输和分配网络中的变电站自动化设备。它支持 IEC 62439 标准中的并行冗余协议 (PRP) 规范。此解决方案是 FPGA 方法的较低成本替代方法,可提供在无需额外组件的情况下添加 IEC 61850 支持等功能的灵活性和性能。
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适用于电信应用的参考设计 (0.9V@0.5A)
PMP4742 PMP4742.1 包含具有 TPS40210 的负输入(-10.8V 至 -13.2V)到正输出(平均值 12V@1A)逆变降压升压转换器;具有 TPS2420 的热交换电路可快速将输出电流限制到 2A 峰值。
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Altera Cyclone V (Cyclone 5) SOC 的电源 (.75V@.75A)
PMP8571 — PMP8571 is an easy to use power solution designed using integrated inductor power modules for Altera’s Cyclone 5 FPGA. This design used TPS84621 and TPS84320 along with TPS51200 to generate 5 rails to power the FPGA.
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针对 Arria V 的电源参考设计
PMP8610 Power Solution Reference Design for Arria V FPGA from Altera.  This solution uses integrated inductor modules for ease of use to help design power solution for Arria V FPGA from Altera.  This design incorporate sequencing need for the PFGA as well.

Special Note

Go to the TPS84 to LMZ3 part number cross (...)

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Altera Cyclone V SoC 电源
PMP9353 PMP9353 参考设计是 Altera Cyclone V SoC 器件的完整电源解决方案。此设计使用多个 LMZ3 系列模块、两个 LDO 和一个 DDR 终端稳压器提供为 SoC 芯片供电时所需的所有电源轨。此设计还显示了正确的加电顺序。
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Altera® Arria V FPGA 电源
PMP9357 PMP9357 参考设计是 Altera Arria V 系列 FPGA 的完整电源解决方案。此设计使用多个 TPS54620 同步降压转换器、多个 LDO 和一个 DDR 终端稳压器提供为 FPGA 供电时所需的所有电源轨。为提供正确的电源定序,此设计采用 UCD90120A 电源序列发生器和监视器,并可通过 I2C 对它们进行控制。
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Altera® Stratix® V FPGA 电源解决方案
PMP9365 PMP9365 参考设计提供为 Altera 的 Stratix V 系列 FPGA 供电时所需的所有电源轨。此设计使用多个 LMZ3 系列模块、多个 LDO 和一个 DDR 终端稳压器提供为 FPGA 供电时所需的所有电源轨。此外还具有用于灵活加电和断电排序的两个 LM3880。此设计采用 12V 输入电压。
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适用于 Artix 7 的模拟解决方案
PMP7977 该 Artix 7 电源管理参考设计板使用电源模块、线性稳压器和兼容 PMBus 的系统控制器来提供 FPGA(包括 DDR 存储器终端)所需的所有内核和辅助电压。数字电源图形用户界面用于监控电路板电源轨的电压和电流强度。
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适用于 Kintex 7 的模拟解决方案
PMP7978 — Xilinx chose TI as the power solution vendor to power Kintex 7 FPGA (along with other analog solution from TI). You will find Schematic and bill of material fo the solution Xilinx used on the development kits.
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采用 TMS320C6657 实现的高效 OPUS 编解码器解决方案参考设计
TIDEP0036 TIDEP0036 参考设计演示了如何在 TMS320C6657 器件上轻松运行经 TI 优化的 Opus 编码器/解码器。由于 Opus 支持各类比特率、帧大小和采样率且均延迟极低,因而适用于语音通信、联网音频甚至高性能音频处理应用。较之 ARM 等通用处理器,此设计还通过在 DSP 上实现 Opus 编解码器来提升性能。根据通用处理器上所运行代码的优化级别,通过在 C66x TI DSP 核心上实现 Opus 编解码器即可提供 3 倍于 ARM CORTEX A-15 方案的性能。
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用于 Xilinx® Zynq-7000 的电源参考设计
PMP7877 — This is a multi-output buck converter design that has an input voltage range of 10.8Vin to 13.2Vin and has seven regulated outputs: 1Vout @ 5A, 1.8Vout @ 2.5A, 1.5Vout @ 6A, 3.3Vout @ 5A, 3.3Vout @ 5A, 5Vout @ 2A, and 0.75Vout @ 1A continous/3Apeak. This design has been approved and tested by (...)
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适用于 Virtex 7 的模拟解决方案
PMP7976 — Xilinx chose TI as the power solution vendor to power Virtex 7 FPGA (along with other analog solution from TI). You will find Schematic and bill of material fo the solution Xilinx used on the development kits.
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适用于 Zynq 的模拟解决方案
PMP7975 — Xilinx chose TI as the power solution vendor to power Zynq FPGA (along with other analog solution from TI). You will find Schematic and bill of material fo the solution Xilinx used on the development kits.
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Altera® Arria® V GX FPGA 电源解决方案
PMP9449 PMP9449 参考设计提供为 Altera 的 Arria® V GX 系列 FPGA 供电时所需的所有电源轨。它使用 TPS38600 监控输入电流并提供上电定序。此设计采用低成本、小尺寸分立式 IC,由单个 5V 输入供电。
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CAD/CAE 符号

封装 引脚 下载
VSON (DRC) 10 视图选项

订购与质量

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