ZHCSN84G January 2021 – April 2024 AM6411 , AM6412 , AM6421 , AM6422 , AM6441 , AM6442
PRODUCTION DATA
表 6-85、图 6-71、表 6-86 和图 6-72 展示了 MMC1 的时序要求和开关特性 – UHS-I SDR25 模式。
编号 | 最小值 | 最大值 | 单位 | ||
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SDR251 | tsu(cmdV-clkH) | 建立时间,在 MMC1_CLK 上升沿之前 MMC1_CMD 有效 | 1.95 | ns | |
SDR252 | th(clkH-cmdV) | 保持时间,在 MMC1_CLK 上升沿之后 MMC1_CMD 有效 | 1.67 | ns | |
SDR253 | tsu(dV-clkH) | 建立时间,在 MMC1_CLK 上升沿之前 MMC1_DAT[3:0] 有效 | 1.95 | ns | |
SDR254 | th(clkH-dV) | 保持时间,在 MMC1_CLK 上升沿之后 MMC1_DAT[3:0] 有效 | 1.67 | ns |
编号 | 参数 | 最小值 | 最大值 | 单位 | |
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fop(clk) | 工作频率,MMC1_CLK | 50 | MHz | ||
SDR255 | tc(clk) | 周期时间,MMC1_CLK | 20 | ns | |
SDR256 | tw(clkH) | 脉冲持续时间,MMC1_CLK 高电平 | 9.2 | ns | |
SDR257 | tw(clkL) | 脉冲持续时间,MMC1_CLK 低电平 | 9.2 | ns | |
SDR258 | td(clkL-cmdV) | 延迟时间,MMC1_CLK 上升沿到 MMC1_CMD 转换 | 2.4 | 8 | ns |
SDR259 | td(clkL-dV) | 延迟时间,MMC1_CLK 上升沿到 MMC1_DAT[3:0] 转换 | 2.4 | 8 | ns |