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SN74LV00A

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4 通道、2 输入、2V 至 5.5V 与非门

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SN74LV00A

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产品详情

Technology family LV-A Number of channels 4 Inputs per channel 2 IOL (max) (mA) 12 IOH (max) (mA) -12 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV-A Number of channels 4 Inputs per channel 2 IOL (max) (mA) 12 IOH (max) (mA) -12 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
VQFN (RGY) 14 12.25 mm² (3.5 mm × 3.5 mm) SOIC (D) 14 51.9 mm² (8.65 mm × 6 mm) SSOP (DB) 14 48.36 mm² (6.2 mm × 7.8 mm) TSSOP (PW) 14 32 mm² (5 mm × 6.4 mm) TVSOP (DGV) 14 23.04 mm² (3.6 mm × 6.4 mm) SOP (NS) 14 79.56 mm² (10.2 mm × 7.8 mm)
  • 2-V to 5.5-V VCC Operation
  • Max tpd of 6.5 ns at 5 V
  • Typical VOLP (Output Ground Bounce)
    < 0.8 V at VCC = 3.3 V, TA = 25°C
  • Typical VOHV (Output VOH Undershoot)
    > 2.3 V at VCC = 3.3 V, TA = 25°C
  • Support Mixed-Mode Voltage Operation on
    All Ports
  • Ioff Supports Live Insertion, Partial Power Down Mode, and Back Drive Protection
  • Latch-Up Performance Exceeds 250 mA
    Per JESD 17
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model
    • 200-V Machine Model
    • 1000-V Charged-Device Model
  • 2-V to 5.5-V VCC Operation
  • Max tpd of 6.5 ns at 5 V
  • Typical VOLP (Output Ground Bounce)
    < 0.8 V at VCC = 3.3 V, TA = 25°C
  • Typical VOHV (Output VOH Undershoot)
    > 2.3 V at VCC = 3.3 V, TA = 25°C
  • Support Mixed-Mode Voltage Operation on
    All Ports
  • Ioff Supports Live Insertion, Partial Power Down Mode, and Back Drive Protection
  • Latch-Up Performance Exceeds 250 mA
    Per JESD 17
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model
    • 200-V Machine Model
    • 1000-V Charged-Device Model

These quadruple 2-input positive-NAND gates are designed for 2-V to 5.5-V VCC operation.

The SNx4LV00A devices perform the boolean function Y = A ● B or Y = A + B in positive logic.

These quadruple 2-input positive-NAND gates are designed for 2-V to 5.5-V VCC operation.

The SNx4LV00A devices perform the boolean function Y = A ● B or Y = A + B in positive logic.
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* 数据表 Quadruple 2-Input Positive-NAND Gates 数据表 (Rev. K) PDF | HTML 2015-2-27
技术文章 It’s all in the family: a brief guide to logic family selection PDF | HTML 2015-9-10

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
评估板

14-24-NL-LOGIC-EVM — 采用 14 引脚至 24 引脚无引线封装的逻辑产品通用评估模块

14-24-EVM 是一款灵活的评估模块 (EVM)，旨在支持具有 14 引脚至 24 引脚 BQA、BQB、RGY、RSV、RJW 或 RHL 封装的任何逻辑或转换器件。

用户指南: PDF | HTML
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
仿真模型

HSPICE MODEL OF SN74LV00A

SCEJ208.ZIP (36 KB) - HSpice 模型
支持的产品和硬件
仿真模型

SN74LV00A Behavioral SPICE Model

SCLM194.ZIP (7 KB) - PSpice 模型
支持的产品和硬件
仿真模型

SN74LV00A IBIS Model

SCEM119.ZIP (16 KB) - IBIS 模型
支持的产品和硬件
参考设计

PMP15035 — 1000W 双向12V 至12V 转换器参考设计

此参考设计是一款适用于 12V 至 12V 双电池系统汽车应用的双通道双向转换器。此参考设计具有宽输入范围（3V 至 40V），可以使用两个 LM5170-Q1 控制器在 9V 至 18V 的输入电压下提供满载 (1kW)。Vin = 18V、Vout = 12V、Iout = 40A 时，效率高达 98%。
支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
VQFN (RGY) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
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订购和质量

支持和培训

可获得 TI 工程师技术支持的 TI E2E™ 论坛

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